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Fitter report for A8255
Tue Sep 11 19:53:07 2007
Version 6.0 Build 202 06/20/2006 Service Pack 1 SJ Web Edition
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; Table of Contents ;
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1. Legal Notice
2. Fitter Summary
3. Fitter Settings
4. Fitter Device Options
5. Input Pins
6. Output Pins
7. All Package Pins
8. Control Signals
9. Global & Other Fast Signals
10. Cascade Chains
11. Non-Global High Fan-Out Signals
12. Local Routing Interconnect
13. MegaLAB Interconnect
14. LAB External Interconnect
15. MegaLAB Usage Summary
16. Row Interconnect
17. LAB Column Interconnect
18. ESB Column Interconnect
19. Fitter Resource Usage Summary
20. Fitter Resource Utilization by Entity
21. Delay Chain Summary
22. I/O Bank Usage
23. Pin-Out File
24. Fitter Messages
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; Legal Notice ;
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Copyright (C) 1991-2006 Altera Corporation
Your use of Altera Corporation's design tools, logic functions
and other software and tools, and its AMPP partner logic
functions, and any output files any of the foregoing
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without limitation, that your use is for the sole purpose of
programming logic devices manufactured by Altera and sold by
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; Fitter Summary ;
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; Fitter Status ; Successful - Tue Sep 11 19:53:07 2007 ;
; Quartus II Version ; 6.0 Build 202 06/20/2006 SP 1 SJ Web Edition ;
; Revision Name ; A8255 ;
; Top-level Entity Name ; a8255 ;
; Family ; APEX20KE ;
; Device ; EP20K30ETC144-1 ;
; Timing Models ; Final ;
; Total logic elements ; 184 / 1,200 ( 15 % ) ;
; Total pins ; 81 / 92 ( 88 % ) ;
; Total virtual pins ; 0 ;
; Total memory bits ; 0 / 24,576 ( 0 % ) ;
; Total PLLs ; 0 ;
+-----------------------+----------------------------------------------+
+------------------------------------------------------------------------------------------------+
; Fitter Settings ;
+------------------------------------------------------+--------------------+--------------------+
; Option ; Setting ; Default Value ;
+------------------------------------------------------+--------------------+--------------------+
; Device ; AUTO ; ;
; Fitter Effort ; Standard Fit ; Auto Fit ;
; SignalProbe signals routed during normal compilation ; Off ; Off ;
; Use smart compilation ; Off ; Off ;
; Router Timing Optimization Level ; Normal ; Normal ;
; Placement Effort Multiplier ; 1.0 ; 1.0 ;
; Router Effort Multiplier ; 1.0 ; 1.0 ;
; Optimize Timing ; Normal Compilation ; Normal compilation ;
; Optimize IOC Register Placement for Timing ; On ; On ;
; Limit to One Fitting Attempt ; Off ; Off ;
; Final Placement Optimizations ; Automatically ; Automatically ;
; Fitter Aggressive Routability Optimizations ; Automatically ; Automatically ;
; Fitter Initial Placement Seed ; 1 ; 1 ;
; Slow Slew Rate ; Off ; Off ;
; PCI I/O ; Off ; Off ;
; Turbo Bit ; On ; On ;
; Auto Global Memory Control Signals ; Off ; Off ;
; Auto Global Clock ; On ; On ;
; Auto Global Output Enable ; On ; On ;
; Auto Global Register Control Signals ; On ; On ;
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; Fitter Device Options ;
+----------------------------------------------+--------------------------+
; Option ; Setting ;
+----------------------------------------------+--------------------------+
; Enable user-supplied start-up clock (CLKUSR) ; Off ;
; Enable device-wide reset (DEV_CLRn) ; Off ;
; Enable device-wide output enable (DEV_OE) ; Off ;
; Enable INIT_DONE output ; Off ;
; Configuration scheme ; Passive Serial ;
; Reserve all unused pins ; As output driving ground ;
; Base pin-out file on sameframe device ; Off ;
+----------------------------------------------+--------------------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+---------+-------+-------------+--------------+------+---------+--------+--------------+-------------------------+---------------+-----------------+---------------+----------------------+--------------+
; Name ; Pin # ; MegaLAB Row ; MegaLAB Col. ; Col. ; Fan-Out ; Global ; I/O Register ; Use Local Routing Input ; Power Up High ; PCI I/O Enabled ; Single-Pin CE ; FastRow Interconnect ; I/O Standard ;
+---------+-------+-------------+--------------+------+---------+--------+--------------+-------------------------+---------------+-----------------+---------------+----------------------+--------------+
; PCIN[0] ; 111 ; -- ; 1 ; 3 ; 1 ; no ; no ; no ; no ; no ; no ; no ; LVTTL ;
; A[0] ; 8 ; B ; -- ; -- ; 41 ; no ; no ; no ; no ; no ; no ; no ; LVTTL ;
; A[1] ; 14 ; C ; -- ; -- ; 26 ; no ; no ; no ; no ; no ; no ; no ; LVTTL ;
; PBIN[0] ; 31 ; F ; -- ; -- ; 2 ; no ; no ; no ; no ; no ; no ; no ; LVTTL ;
; PAIN[0] ; 35 ; F ; -- ; -- ; 2 ; no ; no ; yes ; no ; no ; no ; no ; LVTTL ;
; PCIN[1] ; 104 ; A ; -- ; -- ; 1 ; no ; no ; no ; no ; no ; no ; no ; LVTTL ;
; PBIN[1] ; 29 ; E ; -- ; -- ; 2 ; no ; no ; no ; no ; no ; no ; no ; LVTTL ;
; PAIN[1] ; 27 ; E ; -- ; -- ; 2 ; no ; no ; yes ; no ; no ; no ; no ; LVTTL ;
; PCIN[2] ; 25 ; D ; -- ; -- ; 12 ; no ; no ; no ; no ; no ; no ; no ; LVTTL ;
; PBIN[2] ; 76 ; E ; -- ; -- ; 2 ; no ; no ; no ; no ; no ; no ; no ; LVTTL ;
; PAIN[2] ; 80 ; E ; -- ; -- ; 2 ; no ; no ; no ; no ; no ; no ; no ; LVTTL ;
; PCIN[3] ; 105 ; A ; -- ; -- ; 1 ; no ; no ; no ; no ; no ; no ; no ; LVTTL ;
; PBIN[3] ; 75 ; E ; -- ; -- ; 2 ; no ; no ; no ; no ; no ; no ; no ; LVTTL ;
; PAIN[3] ; 9 ; B ; -- ; -- ; 2 ; no ; no ; no ; no ; no ; no ; no ; LVTTL ;
; PCIN[4] ; 84 ; D ; -- ; -- ; 15 ; no ; no ; no ; no ; no ; no ; no ; LVTTL ;
; PBIN[4] ; 32 ; F ; -- ; -- ; 2 ; no ; no ; no ; no ; no ; no ; no ; LVTTL ;
; PAIN[4] ; 33 ; F ; -- ; -- ; 2 ; no ; no ; yes ; no ; no ; no ; no ; LVTTL ;
; PCIN[5] ; 102 ; A ; -- ; -- ; 1 ; no ; no ; no ; no ; no ; no ; no ; LVTTL ;
; PBIN[5] ; 7 ; A ; -- ; -- ; 2 ; no ; no ; no ; no ; no ; no ; no ; LVTTL ;
; PAIN[5] ; 103 ; A ; -- ; -- ; 2 ; no ; no ; no ; no ; no ; no ; no ; LVTTL ;
; PCIN[6] ; 2 ; A ; -- ; -- ; 7 ; no ; no ; yes ; no ; no ; no ; no ; LVTTL ;
; PBIN[6] ; 3 ; A ; -- ; -- ; 2 ; no ; no ; no ; no ; no ; no ; no ; LVTTL ;
; PAIN[6] ; 6 ; A ; -- ; -- ; 2 ; no ; no ; yes ; no ; no ; no ; no ; LVTTL ;
; PBIN[7] ; 39 ; -- ; 2 ; 2 ; 2 ; no ; no ; no ; no ; no ; no ; no ; LVTTL ;
; PAIN[7] ; 30 ; E ; -- ; -- ; 2 ; no ; no ; yes ; no ; no ; no ; no ; LVTTL ;
; PCIN[7] ; 26 ; E ; -- ; -- ; 1 ; no ; no ; yes ; no ; no ; no ; no ; LVTTL ;
; DIN[0] ; 15 ; C ; -- ; -- ; 13 ; no ; no ; no ; no ; no ; no ; no ; LVTTL ;
; CLK ; 95 ; -- ; -- ; -- ; 54 ; yes ; no ; no ; no ; no ; no ; no ; LVTTL ;
; RESET ; 127 ; -- ; -- ; -- ; 54 ; yes ; no ; no ; no ; no ; no ; no ; LVTTL ;
; nWR ; 49 ; -- ; 2 ; 9 ; 12 ; no ; no ; no ; no ; no ; no ; no ; LVTTL ;
; DIN[7] ; 11 ; C ; -- ; -- ; 7 ; no ; no ; no ; no ; no ; no ; no ; LVTTL ;
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