horse.v

来自「在maxplusII平台上开发的一个交通等内核」· Verilog 代码 · 共 6 行

6 行

module horse(clk,out);
input clk;
output[7:0] out;
reg[7:0] out

horse.v - 源码说明

本页面展示了「在maxplusII平台上开发的一个交通等内核」中的 horse.v 源码文件，采用 Verilog 编程语言编写，共 6 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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