📄 testfreq.fit.rpt
字号:
; Resource ; Usage ;
+---------------------------------------------+-------------------------------+
; Total logic elements ; 341 / 2,910 ( 12 % ) ;
; -- Combinational with no register ; 148 ;
; -- Register only ; 19 ;
; -- Combinational with a register ; 174 ;
; ; ;
; Logic element usage by number of LUT inputs ; ;
; -- 4 input functions ; 93 ;
; -- 3 input functions ; 62 ;
; -- 2 input functions ; 162 ;
; -- 1 input functions ; 12 ;
; -- 0 input functions ; 12 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 207 ;
; -- arithmetic mode ; 134 ;
; -- qfbk mode ; 39 ;
; -- register cascade mode ; 0 ;
; -- synchronous clear/load mode ; 98 ;
; -- asynchronous clear/load mode ; 20 ;
; ; ;
; Total registers ; 193 / 3,210 ( 6 % ) ;
; Total LABs ; 65 / 291 ( 22 % ) ;
; Logic elements in carry chains ; 145 ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 15 / 104 ( 14 % ) ;
; -- Clock pins ; 1 / 2 ( 50 % ) ;
; Global signals ; 5 ;
; M4Ks ; 0 / 13 ( 0 % ) ;
; Total memory bits ; 0 / 59,904 ( 0 % ) ;
; Total RAM block bits ; 0 / 59,904 ( 0 % ) ;
; PLLs ; 0 / 1 ( 0 % ) ;
; Global clocks ; 5 / 8 ( 63 % ) ;
; Average interconnect usage ; 2% ;
; Peak interconnect usage ; 3% ;
; Maximum fan-out node ; clk ;
; Maximum fan-out ; 157 ;
; Highest non-global fan-out signal ; Dec_to_BCD:inst|LessThan0~267 ;
; Highest non-global fan-out ; 56 ;
; Total fan-out ; 1310 ;
; Average fan-out ; 3.66 ;
+---------------------------------------------+-------------------------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+-------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+-------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; clk ; 16 ; 1 ; 0 ; 8 ; 2 ; 157 ; 0 ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; clock ; 143 ; 2 ; 2 ; 14 ; 0 ; 20 ; 0 ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
+-------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+--------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; Slow Slew Rate ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+--------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------+
; dan[0] ; 7 ; 1 ; 0 ; 10 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 10 pF ;
; dan[1] ; 6 ; 1 ; 0 ; 11 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 10 pF ;
; dan[2] ; 5 ; 1 ; 0 ; 11 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 10 pF ;
; dan[3] ; 4 ; 1 ; 0 ; 12 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 10 pF ;
; dan[4] ; 3 ; 1 ; 0 ; 12 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 10 pF ;
; dan[5] ; 2 ; 1 ; 0 ; 13 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 10 pF ;
; dan[6] ; 1 ; 1 ; 0 ; 13 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 10 pF ;
; wie[0] ; 33 ; 1 ; 0 ; 2 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 10 pF ;
; wie[1] ; 34 ; 1 ; 0 ; 2 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 10 pF ;
; wie[2] ; 35 ; 1 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 10 pF ;
; wie[3] ; 36 ; 1 ; 0 ; 1 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 10 pF ;
; wie[4] ; 37 ; 4 ; 2 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 10 pF ;
; wie[5] ; 38 ; 4 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 10 pF ;
+--------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------+
+------------------------------------------------------------+
; I/O Bank Usage ;
+----------+------------------+---------------+--------------+
; I/O Bank ; Usage ; VCCIO Voltage ; VREF Voltage ;
+----------+------------------+---------------+--------------+
; 1 ; 14 / 22 ( 64 % ) ; 3.3V ; -- ;
; 2 ; 1 / 28 ( 4 % ) ; 3.3V ; -- ;
; 3 ; 0 / 26 ( 0 % ) ; 3.3V ; -- ;
; 4 ; 2 / 28 ( 7 % ) ; 3.3V ; -- ;
+----------+------------------+---------------+--------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; I/O Type ; User Assignment ; Bus Hold ; Weak Pull Up ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; 1 ; 0 ; 1 ; dan[6] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 2 ; 1 ; 1 ; dan[5] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 3 ; 2 ; 1 ; dan[4] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 4 ; 3 ; 1 ; dan[3] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 5 ; 4 ; 1 ; dan[2] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 6 ; 5 ; 1 ; dan[1] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 7 ; 6 ; 1 ; dan[0] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 8 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 9 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 10 ; 7 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 11 ; 8 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 12 ; 9 ; 1 ; ~nCSO~ / RESERVED_INPUT_WITH_WEAK_PULLUP ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; 13 ; 10 ; 1 ; ^DATA0 ; input ; ; ; -- ; ; -- ; -- ;
; 14 ; 11 ; 1 ; ^nCONFIG ; ; ; ; -- ; ; -- ; -- ;
; 15 ; ; ; VCCA_PLL1 ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; 16 ; 12 ; 1 ; clk ; input ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 17 ; 13 ; 1 ; GND+ ; ; ; ; Row I/O ; ; -- ; -- ;
; 18 ; ; ; GNDA_PLL1 ; gnd ; ; ; -- ; ; -- ; -- ;
; 19 ; ; ; GNDG_PLL1 ; gnd ; ; ; -- ; ; -- ; -- ;
; 20 ; 14 ; 1 ; ^nCEO ; ; ; ; -- ; ; -- ; -- ;
; 21 ; 15 ; 1 ; ^nCE ; ; ; ; -- ; ; -- ; -- ;
; 22 ; 16 ; 1 ; ^MSEL0 ; ; ; ; -- ; ; -- ; -- ;
; 23 ; 17 ; 1 ; ^MSEL1 ; ; ; ; -- ; ; -- ; -- ;
; 24 ; 18 ; 1 ; ^DCLK ; bidir ; ; ; -- ; ; -- ; -- ;
; 25 ; 19 ; 1 ; ~ASDO~ / RESERVED_INPUT_WITH_WEAK_PULLUP ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; 26 ; 20 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 27 ; 21 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 28 ; 22 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 29 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 30 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 31 ; 23 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 32 ; 24 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 33 ; 25 ; 1 ; wie[0] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
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