📄 proj.tan.rpt
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; Cut off feedback from I/O pins ; On ; ; ; ;
; Report Combined Fast/Slow Timing ; Off ; ; ; ;
; Ignore Clock Settings ; Off ; ; ; ;
; Analyze latches as synchronous elements ; Off ; ; ; ;
; Enable Recovery/Removal analysis ; Off ; ; ; ;
; Enable Clock Latency ; Off ; ; ; ;
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; Clock Settings Summary ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; Clock Node Name ; Clock Setting Name ; Type ; Fmax Requirement ; Early Latency ; Late Latency ; Based on ; Multiply Base Fmax by ; Divide Base Fmax by ; Offset ; Phase offset ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; clk ; ; User Pin ; NONE ; 0.000 ns ; 0.000 ns ; NONE ; N/A ; N/A ; N/A ; ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Setup: 'clk' ;
+-----------------------------------------+-----------------------------------------------------+-------------------------+-------------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; Slack ; Actual fmax (period) ; From ; To ; From Clock ; To Clock ; Required Setup Relationship ; Required Longest P2P Time ; Actual Longest P2P Time ;
+-----------------------------------------+-----------------------------------------------------+-------------------------+-------------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; N/A ; 151.10 MHz ( period = 6.618 ns ) ; lcd:inst|state[2] ; lcd:inst|state[4] ; clk ; clk ; None ; None ; 5.314 ns ;
; N/A ; 151.13 MHz ( period = 6.617 ns ) ; lcd:inst|state[3] ; lcd:inst|state[4] ; clk ; clk ; None ; None ; 5.313 ns ;
; N/A ; 157.43 MHz ( period = 6.352 ns ) ; lcd:inst|counter[5] ; lcd:inst|state[9] ; clk ; clk ; None ; None ; 5.047 ns ;
; N/A ; 157.48 MHz ( period = 6.350 ns ) ; lcd:inst|state[2] ; lcd:inst|counter[0] ; clk ; clk ; None ; None ; 5.047 ns ;
; N/A ; 157.48 MHz ( period = 6.350 ns ) ; lcd:inst|state[2] ; lcd:inst|counter[1] ; clk ; clk ; None ; None ; 5.047 ns ;
; N/A ; 157.48 MHz ( period = 6.350 ns ) ; lcd:inst|state[2] ; lcd:inst|counter[2] ; clk ; clk ; None ; None ; 5.047 ns ;
; N/A ; 157.48 MHz ( period = 6.350 ns ) ; lcd:inst|state[2] ; lcd:inst|counter[4] ; clk ; clk ; None ; None ; 5.047 ns ;
; N/A ; 157.48 MHz ( period = 6.350 ns ) ; lcd:inst|state[2] ; lcd:inst|counter[6] ; clk ; clk ; None ; None ; 5.047 ns ;
; N/A ; 157.48 MHz ( period = 6.350 ns ) ; lcd:inst|state[2] ; lcd:inst|counter[3] ; clk ; clk ; None ; None ; 5.047 ns ;
; N/A ; 157.48 MHz ( period = 6.350 ns ) ; lcd:inst|state[2] ; lcd:inst|counter[5] ; clk ; clk ; None ; None ; 5.047 ns ;
; N/A ; 157.51 MHz ( period = 6.349 ns ) ; lcd:inst|state[3] ; lcd:inst|counter[0] ; clk ; clk ; None ; None ; 5.046 ns ;
; N/A ; 157.51 MHz ( period = 6.349 ns ) ; lcd:inst|state[3] ; lcd:inst|counter[1] ; clk ; clk ; None ; None ; 5.046 ns ;
; N/A ; 157.51 MHz ( period = 6.349 ns ) ; lcd:inst|state[3] ; lcd:inst|counter[2] ; clk ; clk ; None ; None ; 5.046 ns ;
; N/A ; 157.51 MHz ( period = 6.349 ns ) ; lcd:inst|state[3] ; lcd:inst|counter[4] ; clk ; clk ; None ; None ; 5.046 ns ;
; N/A ; 157.51 MHz ( period = 6.349 ns ) ; lcd:inst|state[3] ; lcd:inst|counter[6] ; clk ; clk ; None ; None ; 5.046 ns ;
; N/A ; 157.51 MHz ( period = 6.349 ns ) ; lcd:inst|state[3] ; lcd:inst|counter[3] ; clk ; clk ; None ; None ; 5.046 ns ;
; N/A ; 157.51 MHz ( period = 6.349 ns ) ; lcd:inst|state[3] ; lcd:inst|counter[5] ; clk ; clk ; None ; None ; 5.046 ns ;
; N/A ; 161.32 MHz ( period = 6.199 ns ) ; lcd:inst|state[7] ; lcd:inst|state[4] ; clk ; clk ; None ; None ; 4.895 ns ;
; N/A ; 162.84 MHz ( period = 6.141 ns ) ; lcd:inst|state[5] ; lcd:inst|state[4] ; clk ; clk ; None ; None ; 4.837 ns ;
; N/A ; 166.09 MHz ( period = 6.021 ns ) ; lcd:inst|counter[4] ; lcd:inst|state[9] ; clk ; clk ; None ; None ; 4.716 ns ;
; N/A ; 167.06 MHz ( period = 5.986 ns ) ; lcd:inst|div_counter[0] ; lcd:inst|state[4] ; clk ; clk ; None ; None ; 4.688 ns ;
; N/A ; 167.14 MHz ( period = 5.983 ns ) ; lcd:inst|counter[2] ; lcd:inst|state[9] ; clk ; clk ; None ; None ; 4.678 ns ;
; N/A ; 167.87 MHz ( period = 5.957 ns ) ; lcd:inst|counter[5] ; lcd:inst|counter[0] ; clk ; clk ; None ; None ; 4.653 ns ;
; N/A ; 167.87 MHz ( period = 5.957 ns ) ; lcd:inst|counter[5] ; lcd:inst|counter[1] ; clk ; clk ; None ; None ; 4.653 ns ;
; N/A ; 167.87 MHz ( period = 5.957 ns ) ; lcd:inst|counter[5] ; lcd:inst|counter[2] ; clk ; clk ; None ; None ; 4.653 ns ;
; N/A ; 167.87 MHz ( period = 5.957 ns ) ; lcd:inst|counter[5] ; lcd:inst|counter[4] ; clk ; clk ; None ; None ; 4.653 ns ;
; N/A ; 167.87 MHz ( period = 5.957 ns ) ; lcd:inst|counter[5] ; lcd:inst|counter[6] ; clk ; clk ; None ; None ; 4.653 ns ;
; N/A ; 167.87 MHz ( period = 5.957 ns ) ; lcd:inst|counter[5] ; lcd:inst|counter[3] ; clk ; clk ; None ; None ; 4.653 ns ;
; N/A ; 167.87 MHz ( period = 5.957 ns ) ; lcd:inst|counter[5] ; lcd:inst|counter[5] ; clk ; clk ; None ; None ; 4.653 ns ;
; N/A ; 168.61 MHz ( period = 5.931 ns ) ; lcd:inst|state[7] ; lcd:inst|counter[0] ; clk ; clk ; None ; None ; 4.628 ns ;
; N/A ; 168.61 MHz ( period = 5.931 ns ) ; lcd:inst|state[7] ; lcd:inst|counter[1] ; clk ; clk ; None ; None ; 4.628 ns ;
; N/A ; 168.61 MHz ( period = 5.931 ns ) ; lcd:inst|state[7] ; lcd:inst|counter[2] ; clk ; clk ; None ; None ; 4.628 ns ;
; N/A ; 168.61 MHz ( period = 5.931 ns ) ; lcd:inst|state[7] ; lcd:inst|counter[4] ; clk ; clk ; None ; None ; 4.628 ns ;
; N/A ; 168.61 MHz ( period = 5.931 ns ) ; lcd:inst|state[7] ; lcd:inst|counter[6] ; clk ; clk ; None ; None ; 4.628 ns ;
; N/A ; 168.61 MHz ( period = 5.931 ns ) ; lcd:inst|state[7] ; lcd:inst|counter[3] ; clk ; clk ; None ; None ; 4.628 ns ;
; N/A ; 168.61 MHz ( period = 5.931 ns ) ; lcd:inst|state[7] ; lcd:inst|counter[5] ; clk ; clk ; None ; None ; 4.628 ns ;
; N/A ; 168.83 MHz ( period = 5.923 ns ) ; lcd:inst|state[9] ; lcd:inst|state[4] ; clk ; clk ; None ; None ; 4.619 ns ;
; N/A ; 170.21 MHz ( period = 5.875 ns ) ; lcd:inst|state[4] ; lcd:inst|state[4] ; clk ; clk ; None ; None ; 4.571 ns ;
; N/A ; 170.27 MHz ( period = 5.873 ns ) ; lcd:inst|state[5] ; lcd:inst|counter[0] ; clk ; clk ; None ; None ; 4.570 ns ;
; N/A ; 170.27 MHz ( period = 5.873 ns ) ; lcd:inst|state[5] ; lcd:inst|counter[1] ; clk ; clk ; None ; None ; 4.570 ns ;
; N/A ; 170.27 MHz ( period = 5.873 ns ) ; lcd:inst|state[5] ; lcd:inst|counter[2] ; clk ; clk ; None ; None ; 4.570 ns ;
; N/A ; 170.27 MHz ( period = 5.873 ns ) ; lcd:inst|state[5] ; lcd:inst|counter[4] ; clk ; clk ; None ; None ; 4.570 ns ;
; N/A ; 170.27 MHz ( period = 5.873 ns ) ; lcd:inst|state[5] ; lcd:inst|counter[6] ; clk ; clk ; None ; None ; 4.570 ns ;
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