📄 up3_clock.tan.rpt
字号:
; N/A ; 146.58 MHz ( period = 6.822 ns ) ; CLK_COUNT_400HZ[9] ; CLK_COUNT_400HZ[19] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.561 ns ;
; N/A ; 146.58 MHz ( period = 6.822 ns ) ; CLK_COUNT_400HZ[9] ; CLK_COUNT_400HZ[18] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.561 ns ;
; N/A ; 147.56 MHz ( period = 6.777 ns ) ; BCD_TSEC[0] ; BCD_MIND0[2] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.516 ns ;
; N/A ; 147.56 MHz ( period = 6.777 ns ) ; BCD_TSEC[0] ; BCD_MIND0[1] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.516 ns ;
; N/A ; 147.56 MHz ( period = 6.777 ns ) ; BCD_TSEC[0] ; BCD_MIND0[3] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.516 ns ;
; N/A ; 147.56 MHz ( period = 6.777 ns ) ; BCD_TSEC[0] ; BCD_MIND0[0] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.516 ns ;
; N/A ; 147.60 MHz ( period = 6.775 ns ) ; BCD_TSEC[3] ; BCD_HRD0[1] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.514 ns ;
; N/A ; 147.60 MHz ( period = 6.775 ns ) ; BCD_TSEC[3] ; BCD_HRD0[0] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.514 ns ;
; N/A ; 148.19 MHz ( period = 6.748 ns ) ; CLK_COUNT_400HZ[8] ; CLK_COUNT_400HZ[0] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.487 ns ;
; N/A ; 148.19 MHz ( period = 6.748 ns ) ; CLK_COUNT_400HZ[8] ; CLK_COUNT_400HZ[1] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.487 ns ;
; N/A ; 148.19 MHz ( period = 6.748 ns ) ; CLK_COUNT_400HZ[8] ; CLK_COUNT_400HZ[2] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.487 ns ;
; N/A ; 148.19 MHz ( period = 6.748 ns ) ; CLK_COUNT_400HZ[8] ; CLK_COUNT_400HZ[3] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.487 ns ;
; N/A ; 148.19 MHz ( period = 6.748 ns ) ; CLK_COUNT_400HZ[8] ; CLK_COUNT_400HZ[8] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.487 ns ;
; N/A ; 148.19 MHz ( period = 6.748 ns ) ; CLK_COUNT_400HZ[8] ; CLK_COUNT_400HZ[7] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.487 ns ;
; N/A ; 148.19 MHz ( period = 6.748 ns ) ; CLK_COUNT_400HZ[8] ; CLK_COUNT_400HZ[6] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.487 ns ;
; N/A ; 148.19 MHz ( period = 6.748 ns ) ; CLK_COUNT_400HZ[8] ; CLK_COUNT_400HZ[4] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.487 ns ;
; N/A ; 148.19 MHz ( period = 6.748 ns ) ; CLK_COUNT_400HZ[8] ; CLK_COUNT_400HZ[5] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.487 ns ;
; N/A ; 148.19 MHz ( period = 6.748 ns ) ; CLK_COUNT_400HZ[8] ; CLK_COUNT_400HZ[9] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.487 ns ;
; N/A ; 148.26 MHz ( period = 6.745 ns ) ; BCD_HRD1[1] ; BCD_DAY0[1] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.484 ns ;
; N/A ; 148.26 MHz ( period = 6.745 ns ) ; BCD_HRD1[1] ; BCD_DAY0[0] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.484 ns ;
; N/A ; 148.39 MHz ( period = 6.739 ns ) ; BCD_MIND1[1] ; BCD_DAY0[3] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.498 ns ;
; N/A ; 148.39 MHz ( period = 6.739 ns ) ; BCD_MIND1[1] ; BCD_DAY0[2] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.498 ns ;
; N/A ; 148.57 MHz ( period = 6.731 ns ) ; BCD_SECD1[1] ; BCD_MIND1[1] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.432 ns ;
; N/A ; 148.63 MHz ( period = 6.728 ns ) ; BCD_TSEC[1] ; BCD_DAY0[3] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.478 ns ;
; N/A ; 148.63 MHz ( period = 6.728 ns ) ; BCD_TSEC[1] ; BCD_DAY0[2] ; clk_48Mhz ; clk_48Mhz ; None ; None ; 6.478 ns ;
; Timing analysis restricted to 200 rows. ; To change the limit use Settings (Assignments menu) ; ; ; ; ; ; ; ;
+-----------------------------------------+-----------------------------------------------------+---------------------+---------------------+------------+-----------+-----------------------------+---------------------------+-------------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; tsu ;
+-----------------------------------------+-----------------------------------------------------+------------+------------+----------------------------------+-----------+
; Slack ; Required tsu ; Actual tsu ; From ; To ; To Clock ;
+-----------------------------------------+-----------------------------------------------------+------------+------------+----------------------------------+-----------+
; N/A ; None ; 8.389 ns ; reset ; CLK_COUNT_400HZ[18] ; clk_48Mhz ;
; N/A ; None ; 8.389 ns ; reset ; CLK_COUNT_400HZ[19] ; clk_48Mhz ;
; N/A ; None ; 8.389 ns ; reset ; CLK_COUNT_400HZ[14] ; clk_48Mhz ;
; N/A ; None ; 8.389 ns ; reset ; CLK_COUNT_400HZ[13] ; clk_48Mhz ;
; N/A ; None ; 8.389 ns ; reset ; CLK_COUNT_400HZ[12] ; clk_48Mhz ;
; N/A ; None ; 8.389 ns ; reset ; CLK_COUNT_400HZ[11] ; clk_48Mhz ;
; N/A ; None ; 8.389 ns ; reset ; CLK_COUNT_400HZ[10] ; clk_48Mhz ;
; N/A ; None ; 8.389 ns ; reset ; CLK_COUNT_400HZ[16] ; clk_48Mhz ;
; N/A ; None ; 8.389 ns ; reset ; CLK_COUNT_400HZ[17] ; clk_48Mhz ;
; N/A ; None ; 8.389 ns ; reset ; CLK_COUNT_400HZ[15] ; clk_48Mhz ;
; N/A ; None ; 7.879 ns ; reset ; CLK_COUNT_400HZ[9] ; clk_48Mhz ;
; N/A ; None ; 7.879 ns ; reset ; CLK_COUNT_400HZ[5] ; clk_48Mhz ;
; N/A ; None ; 7.879 ns ; reset ; CLK_COUNT_400HZ[4] ; clk_48Mhz ;
; N/A ; None ; 7.879 ns ; reset ; CLK_COUNT_400HZ[6] ; clk_48Mhz ;
; N/A ; None ; 7.879 ns ; reset ; CLK_COUNT_400HZ[7] ; clk_48Mhz ;
; N/A ; None ; 7.879 ns ; reset ; CLK_COUNT_400HZ[8] ; clk_48Mhz ;
; N/A ; None ; 7.879 ns ; reset ; CLK_COUNT_400HZ[3] ; clk_48Mhz ;
; N/A ; None ; 7.879 ns ; reset ; CLK_COUNT_400HZ[2] ; clk_48Mhz ;
; N/A ; None ; 7.879 ns ; reset ; CLK_COUNT_400HZ[1] ; clk_48Mhz ;
; N/A ; None ; 7.879 ns ; reset ; CLK_COUNT_400HZ[0] ; clk_48Mhz ;
; N/A ; None ; 6.885 ns ; reset ; CLK_400HZ ; clk_48Mhz ;
; N/A ; None ; 2.354 ns ; SET_TIME ; next_command.write_char1 ; clk_48Mhz ;
; N/A ; None ; 2.174 ns ; SET_MOD ; BCD_MIND1[1] ; clk_48Mhz ;
; N/A ; None ; 2.135 ns ; SET_TIME ; BCD_MIND1[1] ; clk_48Mhz ;
; N/A ; None ; 2.112 ns ; SET_TIME ; next_command.write_display_char1 ; clk_48Mhz ;
; N/A ; None ; 1.708 ns ; SET_MOD ; BCD_MIND1[2] ; clk_48Mhz ;
; N/A ; None ; 1.669 ns ; SET_TIME ; BCD_MIND1[2] ; clk_48Mhz ;
; N/A ; None ; 1.328 ns ; SET_MOD ; next_command.write_char1 ; clk_48Mhz ;
; N/A ; None ; 1.190 ns ; SET_CHANGE ; BCD_MIND1[1] ; clk_48Mhz ;
; N/A ; None ; 1.141 ns ; SET_ADD ; BCD_MIND1[1] ; clk_48Mhz ;
; N/A ; None ; 1.086 ns ; SET_MOD ; next_command.write_display_char1 ; clk_48Mhz ;
; N/A ; None ;⌨️ 快捷键说明
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