display.tan.rpt
来自「用 vhdl 语言编写的1602的小程序」· RPT 代码 · 共 375 行 · 第 1/5 页
RPT
375 行
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Settings Summary ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; Clock Node Name ; Clock Setting Name ; Type ; Fmax Requirement ; Early Latency ; Late Latency ; Based on ; Multiply Base Fmax by ; Divide Base Fmax by ; Offset ; Phase offset ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; CLK ; ; User Pin ; None ; 0.000 ns ; 0.000 ns ; -- ; N/A ; N/A ; N/A ; ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Setup: 'CLK' ;
+-----------------------------------------+-----------------------------------------------------+---------------------+---------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; Slack ; Actual fmax (period) ; From ; To ; From Clock ; To Clock ; Required Setup Relationship ; Required Longest P2P Time ; Actual Longest P2P Time ;
+-----------------------------------------+-----------------------------------------------------+---------------------+---------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; N/A ; 137.78 MHz ( period = 7.258 ns ) ; CLK_COUNT_400HZ[6] ; CLK_COUNT_400HZ[0] ; CLK ; CLK ; None ; None ; 6.997 ns ;
; N/A ; 137.78 MHz ( period = 7.258 ns ) ; CLK_COUNT_400HZ[6] ; CLK_COUNT_400HZ[1] ; CLK ; CLK ; None ; None ; 6.997 ns ;
; N/A ; 137.78 MHz ( period = 7.258 ns ) ; CLK_COUNT_400HZ[6] ; CLK_COUNT_400HZ[2] ; CLK ; CLK ; None ; None ; 6.997 ns ;
; N/A ; 137.78 MHz ( period = 7.258 ns ) ; CLK_COUNT_400HZ[6] ; CLK_COUNT_400HZ[3] ; CLK ; CLK ; None ; None ; 6.997 ns ;
; N/A ; 137.78 MHz ( period = 7.258 ns ) ; CLK_COUNT_400HZ[6] ; CLK_COUNT_400HZ[9] ; CLK ; CLK ; None ; None ; 6.997 ns ;
; N/A ; 137.78 MHz ( period = 7.258 ns ) ; CLK_COUNT_400HZ[6] ; CLK_COUNT_400HZ[8] ; CLK ; CLK ; None ; None ; 6.997 ns ;
; N/A ; 137.78 MHz ( period = 7.258 ns ) ; CLK_COUNT_400HZ[6] ; CLK_COUNT_400HZ[7] ; CLK ; CLK ; None ; None ; 6.997 ns ;
; N/A ; 137.78 MHz ( period = 7.258 ns ) ; CLK_COUNT_400HZ[6] ; CLK_COUNT_400HZ[4] ; CLK ; CLK ; None ; None ; 6.997 ns ;
; N/A ; 137.78 MHz ( period = 7.258 ns ) ; CLK_COUNT_400HZ[6] ; CLK_COUNT_400HZ[6] ; CLK ; CLK ; None ; None ; 6.997 ns ;
; N/A ; 137.78 MHz ( period = 7.258 ns ) ; CLK_COUNT_400HZ[6] ; CLK_COUNT_400HZ[5] ; CLK ; CLK ; None ; None ; 6.997 ns ;
; N/A ; 140.96 MHz ( period = 7.094 ns ) ; CLK_COUNT_400HZ[7] ; CLK_COUNT_400HZ[0] ; CLK ; CLK ; None ; None ; 6.833 ns ;
; N/A ; 140.96 MHz ( period = 7.094 ns ) ; CLK_COUNT_400HZ[8] ; CLK_COUNT_400HZ[0] ; CLK ; CLK ; None ; None ; 6.833 ns ;
; N/A ; 140.96 MHz ( period = 7.094 ns ) ; CLK_COUNT_400HZ[7] ; CLK_COUNT_400HZ[1] ; CLK ; CLK ; None ; None ; 6.833 ns ;
; N/A ; 140.96 MHz ( period = 7.094 ns ) ; CLK_COUNT_400HZ[8] ; CLK_COUNT_400HZ[1] ; CLK ; CLK ; None ; None ; 6.833 ns ;
; N/A ; 140.96 MHz ( period = 7.094 ns ) ; CLK_COUNT_400HZ[7] ; CLK_COUNT_400HZ[2] ; CLK ; CLK ; None ; None ; 6.833 ns ;
; N/A ; 140.96 MHz ( period = 7.094 ns ) ; CLK_COUNT_400HZ[8] ; CLK_COUNT_400HZ[2] ; CLK ; CLK ; None ; None ; 6.833 ns ;
; N/A ; 140.96 MHz ( period = 7.094 ns ) ; CLK_COUNT_400HZ[7] ; CLK_COUNT_400HZ[3] ; CLK ; CLK ; None ; None ; 6.833 ns ;
; N/A ; 140.96 MHz ( period = 7.094 ns ) ; CLK_COUNT_400HZ[8] ; CLK_COUNT_400HZ[3] ; CLK ; CLK ; None ; None ; 6.833 ns ;
; N/A ; 140.96 MHz ( period = 7.094 ns ) ; CLK_COUNT_400HZ[7] ; CLK_COUNT_400HZ[9] ; CLK ; CLK ; None ; None ; 6.833 ns ;
; N/A ; 140.96 MHz ( period = 7.094 ns ) ; CLK_COUNT_400HZ[8] ; CLK_COUNT_400HZ[9] ; CLK ; CLK ; None ; None ; 6.833 ns ;
; N/A ; 140.96 MHz ( period = 7.094 ns ) ; CLK_COUNT_400HZ[7] ; CLK_COUNT_400HZ[8] ; CLK ; CLK ; None ; None ; 6.833 ns ;
; N/A ; 140.96 MHz ( period = 7.094 ns ) ; CLK_COUNT_400HZ[8] ; CLK_COUNT_400HZ[8] ; CLK ; CLK ; None ; None ; 6.833 ns ;
; N/A ; 140.96 MHz ( period = 7.094 ns ) ; CLK_COUNT_400HZ[7] ; CLK_COUNT_400HZ[7] ; CLK ; CLK ; None ; None ; 6.833 ns ;
; N/A ; 140.96 MHz ( period = 7.094 ns ) ; CLK_COUNT_400HZ[8] ; CLK_COUNT_400HZ[7] ; CLK ; CLK ; None ; None ; 6.833 ns ;
; N/A ; 140.96 MHz ( period = 7.094 ns ) ; CLK_COUNT_400HZ[7] ; CLK_COUNT_400HZ[4] ; CLK ; CLK ; None ; None ; 6.833 ns ;
; N/A ; 140.96 MHz ( period = 7.094 ns ) ; CLK_COUNT_400HZ[8] ; CLK_COUNT_400HZ[4] ; CLK ; CLK ; None ; None ; 6.833 ns ;
; N/A ; 140.96 MHz ( period = 7.094 ns ) ; CLK_COUNT_400HZ[7] ; CLK_COUNT_400HZ[6] ; CLK ; CLK ; None ; None ; 6.833 ns ;
; N/A ; 140.96 MHz ( period = 7.094 ns ) ; CLK_COUNT_400HZ[8] ; CLK_COUNT_400HZ[6] ; CLK ; CLK ; None ; None ; 6.833 ns ;
; N/A ; 140.96 MHz ( period = 7.094 ns ) ; CLK_COUNT_400HZ[7] ; CLK_COUNT_400HZ[5] ; CLK ; CLK ; None ; None ; 6.833 ns ;
; N/A ; 140.96 MHz ( period = 7.094 ns ) ; CLK_COUNT_400HZ[8] ; CLK_COUNT_400HZ[5] ; CLK ; CLK ; None ; None ; 6.833 ns ;
; N/A ; 143.16 MHz ( period = 6.985 ns ) ; CLK_COUNT_400HZ[5] ; CLK_COUNT_400HZ[0] ; CLK ; CLK ; None ; None ; 6.724 ns ;
; N/A ; 143.16 MHz ( period = 6.985 ns ) ; CLK_COUNT_400HZ[5] ; CLK_COUNT_400HZ[1] ; CLK ; CLK ; None ; None ; 6.724 ns ;
; N/A ; 143.16 MHz ( period = 6.985 ns ) ; CLK_COUNT_400HZ[5] ; CLK_COUNT_400HZ[2] ; CLK ; CLK ; None ; None ; 6.724 ns ;
; N/A ; 143.16 MHz ( period = 6.985 ns ) ; CLK_COUNT_400HZ[5] ; CLK_COUNT_400HZ[3] ; CLK ; CLK ; None ; None ; 6.724 ns ;
; N/A ; 143.16 MHz ( period = 6.985 ns ) ; CLK_COUNT_400HZ[5] ; CLK_COUNT_400HZ[9] ; CLK ; CLK ; None ; None ; 6.724 ns ;
; N/A ; 143.16 MHz ( period = 6.985 ns ) ; CLK_COUNT_400HZ[5] ; CLK_COUNT_400HZ[8] ; CLK ; CLK ; None ; None ; 6.724 ns ;
; N/A ; 143.16 MHz ( period = 6.985 ns ) ; CLK_COUNT_400HZ[5] ; CLK_COUNT_400HZ[7] ; CLK ; CLK ; None ; None ; 6.724 ns ;
; N/A ; 143.16 MHz ( period = 6.985 ns ) ; CLK_COUNT_400HZ[5] ; CLK_COUNT_400HZ[4] ; CLK ; CLK ; None ; None ; 6.724 ns ;
; N/A ; 143.16 MHz ( period = 6.985 ns ) ; CLK_COUNT_400HZ[5] ; CLK_COUNT_400HZ[6] ; CLK ; CLK ; None ; None ; 6.724 ns ;
; N/A ; 143.16 MHz ( period = 6.985 ns ) ; CLK_COUNT_400HZ[5] ; CLK_COUNT_400HZ[5] ; CLK ; CLK ; None ; None ; 6.724 ns ;
; N/A ; 148.08 MHz ( period = 6.753 ns ) ; CLK_COUNT_400HZ[6] ; CLK_COUNT_400HZ[13] ; CLK ; CLK ; None ; None ; 6.492 ns ;
; N/A ; 148.08 MHz ( period = 6.753 ns ) ; CLK_COUNT_400HZ[6] ; CLK_COUNT_400HZ[10] ; CLK ; CLK ; None ; None ; 6.492 ns ;
; N/A ; 148.08 MHz ( period = 6.753 ns ) ; CLK_COUNT_400HZ[6] ; CLK_COUNT_400HZ[11] ; CLK ; CLK ; None ; None ; 6.492 ns ;
; N/A ; 148.08 MHz ( period = 6.753 ns ) ; CLK_COUNT_400HZ[6] ; CLK_COUNT_400HZ[12] ; CLK ; CLK ; None ; None ; 6.492 ns ;
; N/A ; 148.08 MHz ( period = 6.753 ns ) ; CLK_COUNT_400HZ[6] ; CLK_COUNT_400HZ[19] ; CLK ; CLK ; None ; None ; 6.492 ns ;
; N/A ; 148.08 MHz ( period = 6.753 ns ) ; CLK_COUNT_400HZ[6] ; CLK_COUNT_400HZ[18] ; CLK ; CLK ; None ; None ; 6.492 ns ;
; N/A ; 148.08 MHz ( period = 6.753 ns ) ; CLK_COUNT_400HZ[6] ; CLK_COUNT_400HZ[17] ; CLK ; CLK ; None ; None ; 6.492 ns ;
; N/A ; 148.08 MHz ( period = 6.753 ns ) ; CLK_COUNT_400HZ[6] ; CLK_COUNT_400HZ[14] ; CLK ; CLK ; None ; None ; 6.492 ns ;
; N/A ; 148.08 MHz ( period = 6.753 ns ) ; CLK_COUNT_400HZ[6] ; CLK_COUNT_400HZ[15] ; CLK ; CLK ; None ; None ; 6.492 ns ;
; N/A ; 148.08 MHz ( period = 6.753 ns ) ; CLK_COUNT_400HZ[6] ; CLK_COUNT_400HZ[16] ; CLK ; CLK ; None ; None ; 6.492 ns ;
; N/A ; 151.77 MHz ( period = 6.589 ns ) ; CLK_COUNT_400HZ[7] ; CLK_COUNT_400HZ[13] ; CLK ; CLK ; None ; None ; 6.328 ns ;
; N/A ; 151.77 MHz ( period = 6.589 ns ) ; CLK_COUNT_400HZ[8] ; CLK_COUNT_400HZ[13] ; CLK ; CLK ; None ; None ; 6.328 ns ;
; N/A ; 151.77 MHz ( period = 6.589 ns ) ; CLK_COUNT_400HZ[7] ; CLK_COUNT_400HZ[10] ; CLK ; CLK ; None ; None ; 6.328 ns ;
; N/A ; 151.77 MHz ( period = 6.589 ns ) ; CLK_COUNT_400HZ[8] ; CLK_COUNT_400HZ[10] ; CLK ; CLK ; None ; None ; 6.328 ns ;
; N/A ; 151.77 MHz ( period = 6.589 ns ) ; CLK_COUNT_400HZ[7] ; CLK_COUNT_400HZ[11] ; CLK ; CLK ; None ; None ; 6.328 ns ;
; N/A ; 151.77 MHz ( period = 6.589 ns ) ; CLK_COUNT_400HZ[8] ; CLK_COUNT_400HZ[11] ; CLK ; CLK ; None ; None ; 6.328 ns ;
; N/A ; 151.77 MHz ( period = 6.589 ns ) ; CLK_COUNT_400HZ[7] ; CLK_COUNT_400HZ[12] ; CLK ; CLK ; None ; None ; 6.328 ns ;
; N/A ; 151.77 MHz ( period = 6.589 ns ) ; CLK_COUNT_400HZ[8] ; CLK_COUNT_400HZ[12] ; CLK ; CLK ; None ; None ; 6.328 ns ;
; N/A ; 151.77 MHz ( period = 6.589 ns ) ; CLK_COUNT_400HZ[7] ; CLK_COUNT_400HZ[19] ; CLK ; CLK ; None ; None ; 6.328 ns ;
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