📄 elec_lock.fit.rpt
字号:
; 3 ; 0 ;
; 4 ; 3 ;
; 5 ; 4 ;
; 6 ; 6 ;
+-----------------------------+----------------+
+---------------------------------------------+
; LAB External Interconnect ;
+----------------------------+----------------+
; LAB External Interconnects ; Number of LABs ;
+----------------------------+----------------+
; 0 ; 56 ;
; 1 ; 0 ;
; 2 ; 2 ;
; 3 ; 0 ;
; 4 ; 3 ;
; 5 ; 1 ;
; 6 ; 2 ;
; 7 ; 1 ;
; 8 ; 1 ;
; 9 ; 2 ;
; 10 ; 0 ;
; 11 ; 3 ;
; 12 ; 0 ;
; 13 ; 0 ;
; 14 ; 0 ;
; 15 ; 0 ;
; 16 ; 1 ;
+----------------------------+----------------+
+----------------------------------------------------------------------------------------+
; Row Interconnect ;
+-------+-------------------+-----------------------------+------------------------------+
; Row ; Interconnect Used ; Left Half Interconnect Used ; Right Half Interconnect Used ;
+-------+-------------------+-----------------------------+------------------------------+
; A ; 15 / 96 ( 16 % ) ; 6 / 48 ( 13 % ) ; 27 / 48 ( 56 % ) ;
; B ; 5 / 96 ( 5 % ) ; 4 / 48 ( 8 % ) ; 4 / 48 ( 8 % ) ;
; C ; 5 / 96 ( 5 % ) ; 0 / 48 ( 0 % ) ; 8 / 48 ( 17 % ) ;
; Total ; 25 / 288 ( 9 % ) ; 10 / 144 ( 7 % ) ; 39 / 144 ( 27 % ) ;
+-------+-------------------+-----------------------------+------------------------------+
+---------------------------+
; LAB Column Interconnect ;
+-------+-------------------+
; Col. ; Interconnect Used ;
+-------+-------------------+
; 1 ; 4 / 24 ( 17 % ) ;
; 2 ; 2 / 24 ( 8 % ) ;
; 3 ; 0 / 24 ( 0 % ) ;
; 4 ; 0 / 24 ( 0 % ) ;
; 5 ; 0 / 24 ( 0 % ) ;
; 6 ; 0 / 24 ( 0 % ) ;
; 7 ; 0 / 24 ( 0 % ) ;
; 8 ; 0 / 24 ( 0 % ) ;
; 9 ; 0 / 24 ( 0 % ) ;
; 10 ; 0 / 24 ( 0 % ) ;
; 11 ; 0 / 24 ( 0 % ) ;
; 12 ; 0 / 24 ( 0 % ) ;
; 13 ; 1 / 24 ( 4 % ) ;
; 14 ; 2 / 24 ( 8 % ) ;
; 15 ; 2 / 24 ( 8 % ) ;
; 16 ; 3 / 24 ( 13 % ) ;
; 17 ; 3 / 24 ( 13 % ) ;
; 18 ; 2 / 24 ( 8 % ) ;
; 19 ; 4 / 24 ( 17 % ) ;
; 20 ; 0 / 24 ( 0 % ) ;
; 21 ; 0 / 24 ( 0 % ) ;
; 22 ; 0 / 24 ( 0 % ) ;
; 23 ; 1 / 24 ( 4 % ) ;
; 24 ; 2 / 24 ( 8 % ) ;
; Total ; 26 / 576 ( 5 % ) ;
+-------+-------------------+
+---------------------------+
; LAB Column Interconnect ;
+-------+-------------------+
; Col. ; Interconnect Used ;
+-------+-------------------+
; 1 ; 0 / 24 ( 0 % ) ;
; Total ; 0 / 24 ( 0 % ) ;
+-------+-------------------+
+---------------------------------------------------------------------------------------------------------+
; Fitter Resource Usage Summary ;
+-----------------------------------+---------------------------------------------------------------------+
; Resource ; Usage ;
+-----------------------------------+---------------------------------------------------------------------+
; Registers ; 64 / 576 ( 11 % ) ;
; Total LABs ; 0 / 72 ( 0 % ) ;
; Logic elements in carry chains ; 6 ;
; User inserted logic elements ; 0 ;
; I/O pins ; 41 / 59 ( 69 % ) ;
; -- Clock pins ; 3 ;
; -- Dedicated input pins ; 8 / 4 ( 200 % ) ;
; Global signals ; 5 ;
; EABs ; 0 / 3 ( 0 % ) ;
; Total memory bits ; 0 / 6,144 ( 0 % ) ;
; Total RAM block bits ; 0 / 6,144 ( 0 % ) ;
; Maximum fan-out node ; lpm_counter:\counter:Q[0]_rtl_0|alt_counter_f10ke:wysi_counter|q[0] ;
; Maximum fan-out ; 40 ;
; Highest non-global fan-out signal ; lpm_counter:\counter:Q[0]_rtl_0|alt_counter_f10ke:wysi_counter|q[4] ;
; Highest non-global fan-out ; 20 ;
; Total fan-out ; 452 ;
; Average fan-out ; 2.76 ;
+-----------------------------------+---------------------------------------------------------------------+
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+----------------------------------------+-------------+--------------+-------------+------+--------------+-------------------+------------------+-----------------+------------+---------------------------------------------------------------------------+
; Compilation Hierarchy Node ; Logic Cells ; LC Registers ; Memory Bits ; Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Packed LCs ; Full Hierarchy Name ;
+----------------------------------------+-------------+--------------+-------------+------+--------------+-------------------+------------------+-----------------+------------+---------------------------------------------------------------------------+
; |elec_lock ; 123 (102) ; 64 ; 0 ; 41 ; 59 (56) ; 36 (33) ; 28 (13) ; 6 (0) ; 0 (0) ; |elec_lock ;
; |debouncing:\debounuing:U1| ; 5 (5) ; 4 ; 0 ; 0 ; 1 (1) ; 1 (1) ; 3 (3) ; 0 (0) ; 0 (0) ; |elec_lock|debouncing:\debounuing:U1 ;
; |debouncing:\debounuing:U2| ; 5 (5) ; 4 ; 0 ; 0 ; 1 (1) ; 1 (1) ; 3 (3) ; 0 (0) ; 0 (0) ; |elec_lock|debouncing:\debounuing:U2 ;
; |debouncing:\debounuing:U3| ; 5 (5) ; 4 ; 0 ; 0 ; 1 (1) ; 1 (1) ; 3 (3) ; 0 (0) ; 0 (0) ; |elec_lock|debouncing:\debounuing:U3 ;
; |lpm_counter:\counter:Q[0]_rtl_0| ; 6 (0) ; 6 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 6 (0) ; 6 (0) ; 0 (0) ; |elec_lock|lpm_counter:\counter:Q[0]_rtl_0 ;
; |alt_counter_f10ke:wysi_counter| ; 6 (6) ; 6 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 6 (6) ; 6 (6) ; 0 (0) ; |elec_lock|lpm_counter:\counter:Q[0]_rtl_0|alt_counter_f10ke:wysi_counter ;
+----------------------------------------+-------------+--------------+-------------+------+--------------+-------------------+------------------+-----------------+------------+---------------------------------------------------------------------------+
Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.
+---------------------------------------+
; Delay Chain Summary ;
+--------------+----------+-------------+
; Name ; Pin Type ; Pad to Core ;
+--------------+----------+-------------+
; CLK_4M ; Input ; OFF ;
; KEY_IN[1] ; Input ; OFF ;
; KEY_IN[0] ; Input ; OFF ;
; KEY_IN[2] ; Input ; OFF ;
; CLK_SCAN[0] ; Output ; OFF ;
; CLK_SCAN[1] ; Output ; OFF ;
; CLK_SCAN[2] ; Output ; OFF ;
; CLK_SCAN[3] ; Output ; OFF ;
; FLAG_NUMB ; Output ; OFF ;
; FLAG_FUNC ; Output ; OFF ;
; LED_COM ; Output ; OFF ;
; CLEAR ; Output ; OFF ;
; ENLOCK ; Output ; OFF ;
; NUMB_CNT[0] ; Output ; OFF ;
; NUMB_CNT[1] ; Output ; OFF ;
; NUMB_CNT[2] ; Output ; OFF ;
; BCD_CODE[0] ; Output ; OFF ;
; BCD_CODE[1] ; Output ; OFF ;
; BCD_CODE[2] ; Output ; OFF ;
; BCD_CODE[3] ; Output ; OFF ;
; BCD_CODE[4] ; Output ; OFF ;
; BCD_CODE[5] ; Output ; OFF ;
; BCD_CODE[6] ; Output ; OFF ;
; BCD_CODE[7] ; Output ; OFF ;
; BCD_CODE[8] ; Output ; OFF ;
; BCD_CODE[9] ; Output ; OFF ;
; BCD_CODE[10] ; Output ; OFF ;
; BCD_CODE[11] ; Output ; OFF ;
; BCD_CODE[12] ; Output ; OFF ;
; BCD_CODE[13] ; Output ; OFF ;
; BCD_CODE[14] ; Output ; OFF ;
; BCD_CODE[15] ; Output ; OFF ;
; SELOUT[0] ; Output ; OFF ;
; SELOUT[1] ; Output ; OFF ;
; SEGOUT[0] ; Output ; OFF ;
; SEGOUT[1] ; Output ; OFF ;
; SEGOUT[2] ; Output ; OFF ;
; SEGOUT[3] ; Output ; OFF ;
; SEGOUT[4] ; Output ; OFF ;
; SEGOUT[5] ; Output ; OFF ;
; SEGOUT[6] ; Output ; OFF ;
+--------------+----------+-------------+
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in F:/备赛资料/VHDL模块/elec_lock/elec_lock.pin.
+-----------------+
; Fitter Messages ;
+-----------------+
Info: *******************************************************************
Info: Running Quartus II Fitter
Info: Version 5.1 Build 176 10/26/2005 SJ Full Version
Info: Processing started: Mon Aug 06 10:38:40 2007
Info: Command: quartus_fit --read_settings_files=off --write_settings_files=off elec_lock -c elec_lock
Info: Selected device EPF10K10LC84-4 for design "elec_lock"
Info: Detected fmax, tsu, tco, and/or tpd requirements -- optimizing circuit to achieve only the specified requirements
Info: Inserted 0 logic cells in first fitting attempt
Info: Started fitting attempt 1 on Mon Aug 06 2007 at 10:38:44
Warning: Performance of this circuit may degrade because the Fitter Delay Information is not loaded.
Info: Fitter placement preparation operations beginning
Info: Fitter placement preparation operations ending: elapsed time is 00:00:00
Info: Fitter placement operations beginning
Info: Fitter placement operations ending: elapsed time is 00:00:01
Info: Fitter routing operations beginning
Info: Fitter routing operations ending: elapsed time is 00:00:00
Info: Quartus II Fitter was successful. 0 errors, 1 warning
Info: Processing ended: Mon Aug 06 10:38:48 2007
Info: Elapsed time: 00:00:09
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