📄 mux.fit.rpt
字号:
; 37 ; 36 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 38 ; 37 ; -- ; VCCIO ; power ; ; 5.0V ; ;
; 39 ; 38 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 40 ; 39 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 41 ; 40 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 42 ; 41 ; -- ; GND ; gnd ; ; ; ;
; 43 ; 42 ; -- ; VCCINT ; power ; ; 5.0V ; ;
; 44 ; 43 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 45 ; 44 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 46 ; 45 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 47 ; 46 ; -- ; GND ; gnd ; ; ; ;
; 48 ; 47 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 49 ; 48 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 50 ; 49 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 51 ; 50 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 52 ; 51 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 53 ; 52 ; -- ; VCCIO ; power ; ; 5.0V ; ;
; 54 ; 53 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 55 ; 54 ; -- ; d[6] ; output ; TTL ; ; Y ;
; 56 ; 55 ; -- ; d[2] ; output ; TTL ; ; Y ;
; 57 ; 56 ; -- ; d[7] ; output ; TTL ; ; Y ;
; 58 ; 57 ; -- ; d[3] ; output ; TTL ; ; Y ;
; 59 ; 58 ; -- ; GND ; gnd ; ; ; ;
; 60 ; 59 ; -- ; d[4] ; output ; TTL ; ; Y ;
; 61 ; 60 ; -- ; d[0] ; output ; TTL ; ; Y ;
; 62 ; 61 ; -- ; +TCK ; input ; TTL ; ; N ;
; 63 ; 62 ; -- ; d[5] ; output ; TTL ; ; Y ;
; 64 ; 63 ; -- ; d[1] ; output ; TTL ; ; Y ;
; 65 ; 64 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 66 ; 65 ; -- ; VCCIO ; power ; ; 5.0V ; ;
; 67 ; 66 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 68 ; 67 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 69 ; 68 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 70 ; 69 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 71 ; 70 ; -- ; *TDO ; output ; TTL ; ; N ;
; 72 ; 71 ; -- ; GND ; gnd ; ; ; ;
; 73 ; 72 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 74 ; 73 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 75 ; 74 ; -- ; en ; output ; TTL ; ; Y ;
; 76 ; 75 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 77 ; 76 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 78 ; 77 ; -- ; VCCIO ; power ; ; 5.0V ; ;
; 79 ; 78 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 80 ; 79 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 81 ; 80 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 82 ; 81 ; -- ; GND ; gnd ; ; ; ;
; 83 ; 82 ; -- ; GND+ ; ; ; ; ;
; 84 ; 83 ; -- ; GND+ ; ; ; ; ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
+-----------------------------------------------+
; Output Pin Default Load For Reported TCO ;
+--------------+-------+------------------------+
; I/O Standard ; Load ; Termination Resistance ;
+--------------+-------+------------------------+
; LVTTL ; 10 pF ; Not Available ;
; LVCMOS ; 10 pF ; Not Available ;
; TTL ; 0 pF ; Not Available ;
+--------------+-------+------------------------+
Note: User assignments will override these defaults. The user specified values are listed in the Output Pins and Bidir Pins tables.
+----------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+----------------------------+------------+------+---------------------+
; Compilation Hierarchy Node ; Macrocells ; Pins ; Full Hierarchy Name ;
+----------------------------+------------+------+---------------------+
; |mux ; 10 ; 20 ; |mux ;
+----------------------------+------------+------+---------------------+
+---------------------------------+
; Non-Global High Fan-Out Signals ;
+---------------+-----------------+
; Name ; Fan-Out ;
+---------------+-----------------+
; a ; 13 ;
; b[2] ; 9 ;
; b[1] ; 9 ;
; b[0] ; 9 ;
; c[2] ; 8 ;
; c[1] ; 8 ;
; c[0] ; 8 ;
; ~GND~0 ; 1 ;
; ~VCC~0 ; 1 ;
; reduce_or~540 ; 1 ;
; reduce_or~538 ; 1 ;
; reduce_or~537 ; 1 ;
; reduce_or~536 ; 1 ;
; reduce_or~535 ; 1 ;
; reduce_or~534 ; 1 ;
; reduce_or~533 ; 1 ;
; reduce_or~532 ; 1 ;
; reduce_or~531 ; 1 ;
; reduce_or~525 ; 1 ;
; reduce_or~520 ; 1 ;
; reduce_or~515 ; 1 ;
; reduce_or~510 ; 1 ;
; Decoder~30 ; 1 ;
+---------------+-----------------+
+-----------------------------------------------+
; Interconnect Usage Summary ;
+----------------------------+------------------+
; Interconnect Resource Type ; Usage ;
+----------------------------+------------------+
; Output enables ; 0 / 6 ( 0 % ) ;
; PIA buffers ; 14 / 288 ( 4 % ) ;
; PIAs ; 14 / 288 ( 4 % ) ;
+----------------------------+------------------+
+----------------------------------------------------------------------------+
; LAB External Interconnect ;
+----------------------------------------------+-----------------------------+
; LAB External Interconnects (Average = 1.75) ; Number of LABs (Total = 2) ;
+----------------------------------------------+-----------------------------+
; 0 ; 6 ;
; 1 ; 0 ;
; 2 ; 0 ;
; 3 ; 0 ;
; 4 ; 0 ;
; 5 ; 0 ;
; 6 ; 0 ;
; 7 ; 2 ;
+----------------------------------------------+-----------------------------+
+----------------------------------------------------------------------+
; LAB Macrocells ;
+----------------------------------------+-----------------------------+
; Number of Macrocells (Average = 1.25) ; Number of LABs (Total = 3) ;
+----------------------------------------+-----------------------------+
; 0 ; 5 ;
; 1 ; 1 ;
; 2 ; 1 ;
; 3 ; 0 ;
; 4 ; 0 ;
; 5 ; 0 ;
; 6 ; 0 ;
; 7 ; 1 ;
+----------------------------------------+-----------------------------+
+---------------------------------------------------------+
; Parallel Expander ;
+--------------------------+------------------------------+
; Parallel Expander Length ; Number of Parallel Expanders ;
+--------------------------+------------------------------+
; 0 ; 0 ;
; 1 ; 1 ;
+--------------------------+------------------------------+
+-------------------------------------------------------------------------------+
; Shareable Expander ;
+-------------------------------------------------+-----------------------------+
; Number of shareable expanders (Average = 0.75) ; Number of LABs (Total = 1) ;
+-------------------------------------------------+-----------------------------+
; 0 ; 7 ;
; 1 ; 0 ;
; 2 ; 0 ;
; 3 ; 0 ;
; 4 ; 0 ;
; 5 ; 0 ;
; 6 ; 1 ;
+-------------------------------------------------+-----------------------------+
+-----------------------------------------------------------------------------------------------------------------------------+
; Logic Cell Interconnection ;
+-----+------------+------------------------------------------------------------------------------------------+---------------+
; LAB ; Logic Cell ; Input ; Output ;
+-----+------------+------------------------------------------------------------------------------------------+---------------+
; F ; LC91 ; b[0], a, c[0], c[1], c[2], b[2], b[1] ; d[3] ;
; F ; LC85 ; c[2], c[1], a, c[0], b[2], b[1], b[0] ; d[6] ;
; F ; LC88 ; c[2], c[0], c[1], a, b[1], b[0], b[2] ; d[7] ;
; F ; LC93 ; reduce_or~540, b[0], b[1], b[2], a, c[1], c[2], c[0] ; d[4] ;
; F ; LC86 ; reduce_or~532, reduce_or~533, reduce_or~534, reduce_or~535, reduce_or~536, reduce_or~537 ; d[2] ;
; F ; LC92 ; b[0], b[1], b[2], a ; reduce_or~531 ;
; F ; LC94 ; ; d[0] ;
; G ; LC97 ; b[1], b[2], a, b[0], c[1], c[2], c[0] ; d[5] ;
; G ; LC99 ; a, c[2], c[1], b[2], b[1], b[0], c[0] ; d[1] ;
; H ; LC118 ; ; en ;
+-----+------------+------------------------------------------------------------------------------------------+---------------+
+-----------------+
; Fitter Messages ;
+-----------------+
Info: *******************************************************************
Info: Running Quartus II Fitter
Info: Version 5.0 Build 148 04/26/2005 SJ Full Version
Info: Processing started: Wed Oct 12 10:18:26 2005
Info: Command: quartus_fit --read_settings_files=off --write_settings_files=off mux -c mux
Info: Selected device EPM7128SLC84-15 for design "mux"
Info: Quartus II Fitter was successful. 0 errors, 0 warnings
Info: Processing ended: Wed Oct 12 10:18:27 2005
Info: Elapsed time: 00:00:02
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