基于cpld fpga的半整数分频器的设计.doc

来自「智能全数字锁相环的设计用VHDL语言在CPLD上实现串行通信」· DOC 代码 · 共 1 行

DOC
1 行
字号

基于cpld fpga的半整数分频器的设计.doc - 源码说明

本页面展示了「智能全数字锁相环的设计用VHDL语言在CPLD上实现串行通信」中的 基于cpld fpga的半整数分频器的设计.doc 源码文件，采用 DOC 编程语言编写，共 1 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

虫虫开发者社区收录了大量与锁相环相关的技术资源，包括源代码、技术文档、电路图等，是电子工程师和嵌入式开发者的专业学习平台。

⌨️ 快捷键说明

复制代码Ctrl + C
搜索代码Ctrl + F
全屏模式F11
增大字号Ctrl + =
减小字号Ctrl + -
显示快捷键?