sine_main.vhd

来自「三相直接数字频率合成器dds的VHDL源码」· VHDL 代码 · 共 6 行

VHD

6 行

--作者：轩兴洋
--时间：2007 4 10
--版本：xxy1.0
--功能描述：单/三相工频正弦信号产生模块
-----------可一随时通过设定内部寄存器改变相位差，切换输出方式（单相或三相）
--寄存器描述:

sine_main.vhd - 源码说明

本页面展示了「三相直接数字频率合成器dds的VHDL源码」中的 sine_main.vhd 源码文件，采用 VHDL 编程语言编写，共 6 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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