system1.sim.rpt

用VHDL语言实现的控制DS18B20构成测温仪表的程序

; |system1|rtl~828                                                                                                    ; |system1|rtl~828                                                                                                                    ; data_out0        ;
; |system1|\Reset1:temp2[4]                                                                                           ; |system1|\Reset1:temp2[4]                                                                                                           ; data_out0        ;
; |system1|\Reset1:temp2[3]                                                                                           ; |system1|\Reset1:temp2[3]                                                                                                           ; data_out0        ;
; |system1|\Reset1:temp2[1]                                                                                           ; |system1|\Reset1:temp2[1]                                                                                                           ; data_out0        ;
; |system1|\Reset1:temp2[2]                                                                                           ; |system1|\Reset1:temp2[2]                                                                                                           ; data_out0        ;
; |system1|rtl~829                                                                                                    ; |system1|rtl~829                                                                                                                    ; data_out0        ;
; |system1|allstate.tempstop_800m                                                                                     ; |system1|allstate.tempstop_800m                                                                                                     ; data_out0        ;
; |system1|allstate.rwait_9u                                                                                          ; |system1|allstate.rwait_9u                                                                                                          ; data_out0        ;
; |system1|allstate.rwait_55u                                                                                         ; |system1|allstate.rwait_55u                                                                                                         ; data_out0        ;
; |system1|allstate.display                                                                                           ; |system1|allstate.display                                                                                                           ; data_out0        ;
; |system1|\Reset1:temp13[3]                                                                                          ; |system1|\Reset1:temp13[3]                                                                                                          ; data_out0        ;
; |system1|\Reset1:temp13[1]                                                                                          ; |system1|\Reset1:temp13[1]                                                                                                          ; data_out0        ;
; |system1|rtl~830                                                                                                    ; |system1|rtl~830                                                                                                                    ; data_out0        ;
; |system1|Decoder~379                                                                                                ; |system1|Decoder~379                                                                                                                ; data_out0        ;
; |system1|Decoder~380                                                                                                ; |system1|Decoder~380                                                                                                                ; data_out0        ;
; |system1|Decoder~381                                                                                                ; |system1|Decoder~381                                                                                                                ; data_out0        ;
; |system1|Decoder~382                                                                                                ; |system1|Decoder~382                                                                                                                ; data_out0        ;
; |system1|Decoder~383                                                                                                ; |system1|Decoder~383                                                                                                                ; data_out0        ;
; |system1|Decoder~384                                                                                                ; |system1|Decoder~384                                                                                                                ; data_out0        ;
; |system1|Decoder~385                                                                                                ; |system1|Decoder~385                                                                                                                ; data_out0        ;
; |system1|Decoder~386                                                                                                ; |system1|Decoder~386                                                                                                                ; data_out0        ;
; |system1|Decoder~387                                                                                                ; |system1|Decoder~387                                                                                                                ; data_out0        ;
; |system1|lpm_add_sub:add_rtl_1|addcore:adder|a_csnbuffer:result_node|cs_buffer[3]                                   ; |system1|lpm_add_sub:add_rtl_1|addcore:adder|a_csnbuffer:result_node|cs_buffer[3]                                                   ; data_out0        ;
; |system1|lpm_add_sub:add_rtl_1|addcore:adder|a_csnbuffer:result_node|cs_buffer[3]                                   ; |system1|lpm_add_sub:add_rtl_1|addcore:adder|a_csnbuffer:result_node|cout[3]                                                        ; cout             ;
; |system1|lpm_add_sub:add_rtl_1|addcore:adder|a_csnbuffer:result_node|cs_buffer[2]                                   ; |system1|lpm_add_sub:add_rtl_1|addcore:adder|a_csnbuffer:result_node|cs_buffer[2]                                                   ; data_out0        ;
; |system1|lpm_add_sub:add_rtl_1|addcore:adder|a_csnbuffer:result_node|cs_buffer[2]                                   ; |system1|lpm_add_sub:add_rtl_1|addcore:adder|a_csnbuffer:result_node|cout[2]                                                        ; cout             ;
; |system1|lpm_add_sub:add_rtl_1|addcore:adder|a_csnbuffer:result_node|cs_buffer[1]                                   ; |system1|lpm_add_sub:add_rtl_1|addcore:adder|a_csnbuffer:result_node|cs_buffer[1]                                                   ; data_out0        ;
; |system1|lpm_add_sub:add_rtl_1|addcore:adder|a_csnbuffer:result_node|cs_buffer[1]                                   ; |system1|lpm_add_sub:add_rtl_1|addcore:adder|a_csnbuffer:result_node|cout[1]                                                        ; cout             ;
; |system1|\Reset1:temp7[0]                                                                                           ; |system1|\Reset1:temp7[0]                                                                                                           ; data_out0        ;
; |system1|lpm_add_sub:add_rtl_9|addcore:adder|unreg_res_node[6]                                                      ; |system1|lpm_add_sub:add_rtl_9|addcore:adder|unreg_res_node[6]                                                                      ; data_out0        ;
; |system1|allstate.wstop2                                                                                            ; |system1|allstate.wstop2                                                                                                            ; data_out0        ;
; |system1|\Reset1:temp14[5]                                                                                          ; |system1|\Reset1:temp14[5]                                                                                                          ; data_out0        ;
; |system1|\Reset1:temp14[4]                                                                                          ; |system1|\Reset1:temp14[4]                                                                                                          ; data_out0        ;
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