song.drc

来自「这是一个FPGA的实验源码」· DRC 代码 · 共 5 行

DRC
5 行
字号 
WARNING:DesignRules:372 - Netcheck: Gated clock. Clock net carry is sourced by a
   combinatorial pin. This is not good design practice. Use the CE pin to
   control the loading of data into the flip-flop.DRC detected 0 errors and 1 warnings.

song.drc - 源码说明

本页面展示了「这是一个FPGA的实验源码」中的 song.drc 源码文件，采用 DRC 编程语言编写，共 5 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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