twomuxs.v

来自「Verilog 编写的fir滤波器」· Verilog 代码 · 共 7 行

7 行

module twomuxs(a,b,sel,out);
output out;
input a,b,sel;
not(sel_,sel);
and(a1,a,sel_),(a2,b,sel);
or(out,a1,a2);
endmodule

twomuxs.v - 源码说明

本页面展示了「Verilog 编写的fir滤波器」中的 twomuxs.v 源码文件，采用 Verilog 编程语言编写，共 7 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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