📄 rec.map.rpt
字号:
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; |lpm_shiftreg:trigger_condition_deserialize| ; 33 (33) ; 33 ; 0 ; 0 ; 0 ; 0 (0) ; 33 (33) ; 0 (0) ; 0 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_basic_multi_level_trigger:\basic_multi_level_mbpm_trigger_gen:multi_level_mbpm|lpm_shiftreg:trigger_condition_deserialize ;
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; |sld_sbpmg:\gen_sbpmg_pipeline_less_than_two:sm0:10:sm1| ; 3 (3) ; 2 ; 0 ; 0 ; 0 ; 1 (1) ; 1 (1) ; 1 (1) ; 0 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_basic_multi_level_trigger:\basic_multi_level_mbpm_trigger_gen:multi_level_mbpm|sld_mbpmg:\trigger_modules_gen:0:trigger_match|sld_sbpmg:\gen_sbpmg_pipeline_less_than_two:sm0:10:sm1 ;
; |sld_sbpmg:\gen_sbpmg_pipeline_less_than_two:sm0:1:sm1| ; 3 (3) ; 2 ; 0 ; 0 ; 0 ; 1 (1) ; 1 (1) ; 1 (1) ; 0 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_basic_multi_level_trigger:\basic_multi_level_mbpm_trigger_gen:multi_level_mbpm|sld_mbpmg:\trigger_modules_gen:0:trigger_match|sld_sbpmg:\gen_sbpmg_pipeline_less_than_two:sm0:1:sm1 ;
; |sld_sbpmg:\gen_sbpmg_pipeline_less_than_two:sm0:2:sm1| ; 3 (3) ; 2 ; 0 ; 0 ; 0 ; 1 (1) ; 1 (1) ; 1 (1) ; 0 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_basic_multi_level_trigger:\basic_multi_level_mbpm_trigger_gen:multi_level_mbpm|sld_mbpmg:\trigger_modules_gen:0:trigger_match|sld_sbpmg:\gen_sbpmg_pipeline_less_than_two:sm0:2:sm1 ;
; |sld_sbpmg:\gen_sbpmg_pipeline_less_than_two:sm0:3:sm1| ; 3 (3) ; 2 ; 0 ; 0 ; 0 ; 1 (1) ; 1 (1) ; 1 (1) ; 0 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_basic_multi_level_trigger:\basic_multi_level_mbpm_trigger_gen:multi_level_mbpm|sld_mbpmg:\trigger_modules_gen:0:trigger_match|sld_sbpmg:\gen_sbpmg_pipeline_less_than_two:sm0:3:sm1 ;
; |sld_sbpmg:\gen_sbpmg_pipeline_less_than_two:sm0:4:sm1| ; 3 (3) ; 2 ; 0 ; 0 ; 0 ; 1 (1) ; 1 (1) ; 1 (1) ; 0 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_basic_multi_level_trigger:\basic_multi_level_mbpm_trigger_gen:multi_level_mbpm|sld_mbpmg:\trigger_modules_gen:0:trigger_match|sld_sbpmg:\gen_sbpmg_pipeline_less_than_two:sm0:4:sm1 ;
; |sld_sbpmg:\gen_sbpmg_pipeline_less_than_two:sm0:5:sm1| ; 3 (3) ; 2 ; 0 ; 0 ; 0 ; 1 (1) ; 1 (1) ; 1 (1) ; 0 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_basic_multi_level_trigger:\basic_multi_level_mbpm_trigger_gen:multi_level_mbpm|sld_mbpmg:\trigger_modules_gen:0:trigger_match|sld_sbpmg:\gen_sbpmg_pipeline_less_than_two:sm0:5:sm1 ;
; |sld_sbpmg:\gen_sbpmg_pipeline_less_than_two:sm0:6:sm1| ; 3 (3) ; 2 ; 0 ; 0 ; 0 ; 1 (1) ; 1 (1) ; 1 (1) ; 0 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_basic_multi_level_trigger:\basic_multi_level_mbpm_trigger_gen:multi_level_mbpm|sld_mbpmg:\trigger_modules_gen:0:trigger_match|sld_sbpmg:\gen_sbpmg_pipeline_less_than_two:sm0:6:sm1 ;
; |sld_sbpmg:\gen_sbpmg_pipeline_less_than_two:sm0:7:sm1| ; 3 (3) ; 2 ; 0 ; 0 ; 0 ; 1 (1) ; 1 (1) ; 1 (1) ; 0 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_basic_multi_level_trigger:\basic_multi_level_mbpm_trigger_gen:multi_level_mbpm|sld_mbpmg:\trigger_modules_gen:0:trigger_match|sld_sbpmg:\gen_sbpmg_pipeline_less_than_two:sm0:7:sm1 ;
; |sld_sbpmg:\gen_sbpmg_pipeline_less_than_two:sm0:8:sm1| ; 3 (3) ; 2 ; 0 ; 0 ; 0 ; 1 (1) ; 1 (1) ; 1 (1) ; 0 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_basic_multi_level_trigger:\basic_multi_level_mbpm_trigger_gen:multi_level_mbpm|sld_mbpmg:\trigger_modules_gen:0:trigger_match|sld_sbpmg:\gen_sbpmg_pipeline_less_than_two:sm0:8:sm1 ;
; |sld_sbpmg:\gen_sbpmg_pipeline_less_than_two:sm0:9:sm1| ; 3 (3) ; 2 ; 0 ; 0 ; 0 ; 1 (1) ; 1 (1) ; 1 (1) ; 0 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_basic_multi_level_trigger:\basic_multi_level_mbpm_trigger_gen:multi_level_mbpm|sld_mbpmg:\trigger_modules_gen:0:trigger_match|sld_sbpmg:\gen_sbpmg_pipeline_less_than_two:sm0:9:sm1 ;
; |sld_ela_level_seq_mgr:ela_level_seq_mgr| ; 9 (9) ; 2 ; 0 ; 0 ; 0 ; 7 (7) ; 0 (0) ; 2 (2) ; 0 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_level_seq_mgr:ela_level_seq_mgr ;
; |sld_ela_post_trigger_counter:\gen_non_zero_sample_depth:tc1| ; 13 (1) ; 12 ; 0 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 12 (0) ; 12 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_post_trigger_counter:\gen_non_zero_sample_depth:tc1 ;
; |lpm_counter:post_trigger_counter| ; 12 (0) ; 12 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 12 (0) ; 12 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_post_trigger_counter:\gen_non_zero_sample_depth:tc1|lpm_counter:post_trigger_counter ;
; |cntr_oo8:auto_generated| ; 12 (12) ; 12 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 12 (12) ; 12 (12) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_post_trigger_counter:\gen_non_zero_sample_depth:tc1|lpm_counter:post_trigger_counter|cntr_oo8:auto_generated ;
; |sld_ela_seg_state_machine:sm2| ; 4 (4) ; 3 ; 0 ; 0 ; 0 ; 1 (1) ; 2 (2) ; 1 (1) ; 0 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_seg_state_machine:sm2 ;
; |sld_ela_segment_mgr:\gen_non_zero_sample_depth_segment:seg_mgr| ; 21 (1) ; 13 ; 0 ; 0 ; 0 ; 8 (0) ; 0 (0) ; 13 (1) ; 12 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_segment_mgr:\gen_non_zero_sample_depth_segment:seg_mgr ;
; |lpm_compare:\non_zero_sample_depth_gen:segment_addr_compare| ; 8 (0) ; 0 ; 0 ; 0 ; 0 ; 8 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_segment_mgr:\gen_non_zero_sample_depth_segment:seg_mgr|lpm_compare:\non_zero_sample_depth_gen:segment_addr_compare ;
; |comptree:comparator| ; 8 (0) ; 0 ; 0 ; 0 ; 0 ; 8 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_segment_mgr:\gen_non_zero_sample_depth_segment:seg_mgr|lpm_compare:\non_zero_sample_depth_gen:segment_addr_compare|comptree:comparator ;
; |cmpchain:cmp_end| ; 8 (0) ; 0 ; 0 ; 0 ; 0 ; 8 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_segment_mgr:\gen_non_zero_sample_depth_segment:seg_mgr|lpm_compare:\non_zero_sample_depth_gen:segment_addr_compare|comptree:comparator|cmpchain:cmp_end ;
; |comptree:comp| ; 8 (0) ; 0 ; 0 ; 0 ; 0 ; 8 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_segment_mgr:\gen_non_zero_sample_depth_segment:seg_mgr|lpm_compare:\non_zero_sample_depth_gen:segment_addr_compare|comptree:comparator|cmpchain:cmp_end|comptree:comp ;
; |comptree:sub_comptree| ; 8 (0) ; 0 ; 0 ; 0 ; 0 ; 8 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_segment_mgr:\gen_non_zero_sample_depth_segment:seg_mgr|lpm_compare:\non_zero_sample_depth_gen:segment_addr_compare|comptree:comparator|cmpchain:cmp_end|comptree:comp|comptree:sub_comptree ;
; |comptree:sub_comptree| ; 8 (0) ; 0 ; 0 ; 0 ; 0 ; 8 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_segment_mgr:\gen_non_zero_sample_depth_segment:seg_mgr|lpm_compare:\non_zero_sample_depth_gen:segment_addr_compare|comptree:comparator|cmpchain:cmp_end|comptree:comp|comptree:sub_comptree|comptree:sub_comptree ;
; |cmpchain:cmp_end| ; 8 (8) ; 0 ; 0 ; 0 ; 0 ; 8 (8) ; 0 (0) ; 0 (0) ; 0 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_segment_mgr:\gen_non_zero_sample_depth_segment:seg_mgr|lpm_compare:\non_zero_sample_depth_gen:segment_addr_compare|comptree:comparator|cmpchain:cmp_end|comptree:comp|comptree:sub_comptree|comptree:sub_comptree|cmpchain:cmp_end ;
; |lpm_counter:\non_zero_sample_depth_gen:segment_addr_counter| ; 12 (0) ; 12 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 12 (0) ; 12 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_segment_mgr:\gen_non_zero_sample_depth_segment:seg_mgr|lpm_counter:\non_zero_sample_depth_gen:segment_addr_counter ;
; |cntr_g29:auto_generated| ; 12 (12) ; 12 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 12 (12) ; 12 (12) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_segment_mgr:\gen_non_zero_sample_depth_segment:seg_mgr|lpm_counter:\non_zero_sample_depth_gen:segment_addr_counter|cntr_g29:auto_generated ;
; |sld_ela_state_machine:sm1| ; 5 (5) ; 3 ; 0 ; 0 ; 0 ; 2 (2) ; 1 (1) ; 2 (2) ; 0 (0) ; |rec|sld_signaltap:rec|sld_ela_control:ela_control|sld_ela_state_machine:sm1 ;
; |sld_offload_buffer_mgr:\stp_non_zero_depth_offload_gen:stp_offload_buff_mgr_inst| ; 57 (4) ; 52 ; 0 ; 0 ; 0 ; 5 (4) ; 0 (0) ; 52 (0) ; 17 (0) ; |rec|sld_signaltap:rec|sld_offload_buffer_mgr:\stp_non_zero_depth_offload_gen:stp_offload_buff_mgr_inst ;
; |lpm_counter:\adv_point_3_and_more:advance_pointer_counter| ; 5 (0) ; 4 ; 0 ; 0 ; 0 ; 1 (0) ; 0 (0) ; 4 (0) ; 5 (0) ; |rec|sld_signaltap:rec|sld_offload_buffer_mgr:\stp_non_zero_depth_offload_gen:stp_offload_buff_mgr_inst|lpm_counter:\adv_point_3_and_more:advance_pointer_counter ;
; |cntr_8v7:auto_generated| ; 5 (5) ; 4 ; 0 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 4 (4) ; 5 (5) ; |rec|sld_signaltap:rec|sld_offload_buffer_mgr:\stp_non_zero_depth_offload_gen:stp_offload_buff_mgr_inst|lpm_counter:\adv_point_3_and_more:advance_pointer_counter|cntr_8v7:auto_generated ;
; |lpm_counter:read_pointer_counter| ; 12 (0) ; 12 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 12 (0) ; 12 (0) ; |rec|sld_signaltap:rec|sld_offload_buffer_mgr:\stp_non_zero_depth_offload_gen:stp_offload_buff_mgr_inst|lpm_counter:read_pointer_counter ;
; |cntr_rn7:auto_generated| ; 12 (12) ; 12 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 12 (12) ; 12 (12) ; |rec|sld_signaltap:rec|sld_offload_buffer_mgr:\stp_non_zero_depth_offload_gen:stp_offload_buff_mgr_inst|lpm_counter:read_pointer_counter|cntr_rn7:auto_generated ;
; |lpm_shiftreg:info_data_shift_out| ; 25 (25) ; 25 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 25 (25) ; 0 (0) ; |rec|sld_signaltap:rec|sld_offload_buffer_mgr:\stp_non_zero_depth_offload_gen:stp_offload_buff_mgr_inst|lpm_shiftreg:info_data_shift_out ;
; |lpm_shiftreg:ram_data_shift_out| ; 11 (11) ; 11 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 11 (11) ; 0 (0) ; |rec|sld_signaltap:rec|sld_offload_buffer_mgr:\stp_non_zero_depth_offload_gen:stp_offload_buff_mgr_inst|lpm_shiftreg:ram_data_shift_out ;
; |sld_rom_sr:crc_rom_sr| ; 17 (17) ; 8 ; 0 ; 0 ; 0 ; 9 (9) ; 2 (2) ; 6 (6) ; 0 (0) ; |rec|sld_signaltap:rec|sld_rom_sr:crc_rom_sr ;
; |test_rec:inst1| ; 41 (41) ; 22 ; 0 ; 0 ; 0 ; 19 (19) ; 8 (8) ; 14 (14) ; 5 (5) ; |rec|test_rec:inst1 ;
+---------------------------------------------------------------------------------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis RAM Summary ;
+-------------------------------------------------------------------------------------------------------------+------+------------------+--------------+--------------+--------------+--------------+-------+------+
; Name ; Type ; Mode ; Port A Depth ; Port A Width ; Port B Depth ; Port B Width ; Size ; MIF ;
+-------------------------------------------------------------------------------------------------------------+------+------------------+--------------+--------------+--------------+--------------+-------+------+
; sld_signaltap:rec|altsyncram:\stp_non_zero_ram_gen:stp_buffer_ram|altsyncram_rh92:auto_generated|ALTSYNCRAM ; AUTO ; Simple Dual Port ; 4096 ; 11 ; 4096 ; 11 ; 45056 ; None ;
+-------------------------------------------------------------------------------------------------------------+------+------------------+--------------+--------------+--------------+--------------+-------+------+
+------------------------------------------------------+
; General Register Statistics ;
+----------------------------------------------+-------+
; Statistic ; Value ;
+----------------------------------------------+-------+
; Total registers ; 317 ;
; Number of registers using Synchronous Clear ; 28 ;
; Number of registers using Synchronous Load ; 8 ;
; Number of registers using Asynchronous Clear ; 222 ;
; Number of registers using Asynchronous Load ; 0 ;
; Number of registers using Clock Enable ; 180 ;
; Number of registers using Preset ; 0 ;
+----------------------------------------------+-------+
+--------------------------------------------------+
; Inverted Register Statistics ;
+----------------------------------------+---------+
; Inverted Register ; Fan out ;
+----------------------------------------+---------+
; sld_hub:sld_hub_inst|hub_tdo ; 1 ;
; Total number of inverted registers = 1 ; ;
+----------------------------------------+---------+
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