uart_top.jhd

来自「Verilog HDl代码」· JHD 代码 · 共 10 行

JHD
10 行
字号 
MODULE uart_top
   SUBMODULE baudrate_generator
   SUBMODULE counter
   SUBMODULE detector
   SUBMODULE parity_verifier
   SUBMODULE shift_register
   SUBMODULE switch
   SUBMODULE switch_bus
   SUBMODULE uart_core

uart_top.jhd - 源码说明

本页面展示了「Verilog HDl代码」中的 uart_top.jhd 源码文件，采用 JHD 编程语言编写，共 10 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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