📄 decoder.fit.rpt
字号:
; 9 ; 14 ; -- ; VCCIO ; power ; ; 3.3V ; ;
; 10 ; 15 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 11 ; 16 ; -- ; GND ; gnd ; ; ; ;
; 12 ; 17 ; -- ; Y[0] ; output ; LVTTL ; ; Y ;
; 13 ; 18 ; -- ; Y[1] ; output ; LVTTL ; ; Y ;
; 14 ; 19 ; -- ; Y[2] ; output ; LVTTL ; ; Y ;
; 15 ; 20 ; -- ; Y[3] ; output ; LVTTL ; ; Y ;
; 16 ; 21 ; -- ; GND ; gnd ; ; ; ;
; 17 ; 22 ; -- ; VCCINT ; power ; ; 3.3V ; ;
; 18 ; 23 ; -- ; Y[4] ; output ; LVTTL ; ; Y ;
; 19 ; 24 ; -- ; Y[5] ; output ; LVTTL ; ; Y ;
; 20 ; 25 ; -- ; Y[6] ; output ; LVTTL ; ; Y ;
; 21 ; 26 ; -- ; Y[7] ; output ; LVTTL ; ; Y ;
; 22 ; 27 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 23 ; 28 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 24 ; 29 ; -- ; GND ; gnd ; ; ; ;
; 25 ; 30 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 26 ; 31 ; -- ; +TCK ; input ; LVTTL ; ; N ;
; 27 ; 32 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 28 ; 33 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 29 ; 34 ; -- ; VCCIO ; power ; ; 3.3V ; ;
; 30 ; 35 ; -- ; GND ; gnd ; ; ; ;
; 31 ; 36 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 32 ; 37 ; -- ; *TDO ; output ; LVTTL ; ; N ;
; 33 ; 38 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 34 ; 39 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 35 ; 40 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 36 ; 41 ; -- ; GND ; gnd ; ; ; ;
; 37 ; 42 ; -- ; clk ; input ; LVTTL ; ; Y ;
; 38 ; 43 ; -- ; en ; input ; LVTTL ; ; Y ;
; 39 ; 0 ; -- ; GND+ ; ; ; ; ;
; 40 ; 1 ; -- ; GND+ ; ; ; ; ;
; 41 ; 2 ; -- ; VCCINT ; power ; ; 3.3V ; ;
; 42 ; 3 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 43 ; 4 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 44 ; 5 ; -- ; RESERVED_INPUT ; ; ; ; ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
+--------------------------------------------------------------------------------------------------+
; I/O Standard ;
+--------------+------------+----------------------+-------------------+-------------------+-------+
; I/O Standard ; Input Vref ; Dedicated Input Pins ; Pins in I/O Bank1 ; Pins in I/O Bank2 ; Total ;
+--------------+------------+----------------------+-------------------+-------------------+-------+
; LVTTL ; - ; 2 ; 0 ; 0 ; 2 ;
+--------------+------------+----------------------+-------------------+-------------------+-------+
+--------------------------------------------------------------------+
; Dedicated Inputs I/O ;
+------+-------+-------+-------+--------------+------------+---------+
; Name ; Pin # ; Type ; VCCIO ; I/O Standard ; Input Vref ; Current ;
+------+-------+-------+-------+--------------+------------+---------+
; clk ; 37 ; Input ; -- ; LVTTL ; - ; 0 mA ;
; en ; 38 ; Input ; -- ; LVTTL ; - ; 0 mA ;
+------+-------+-------+-------+--------------+------------+---------+
+-----------------------------------------------+
; Output Pin Default Load For Reported TCO ;
+--------------+-------+------------------------+
; I/O Standard ; Load ; Termination Resistance ;
+--------------+-------+------------------------+
; LVTTL ; 10 pF ; Not Available ;
; LVCMOS ; 10 pF ; Not Available ;
; 3.3-V PCI ; 10 pF ; 25 Ohm (Parallel) ;
; 2.5 V ; 10 pF ; Not Available ;
+--------------+-------+------------------------+
Note: User assignments will override these defaults. The user specified values are listed in the Output Pins and Bidir Pins tables.
+----------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+----------------------------+------------+------+---------------------+
; Compilation Hierarchy Node ; Macrocells ; Pins ; Full Hierarchy Name ;
+----------------------------+------------+------+---------------------+
; |top ; 8 ; 17 ; |top ;
; |decoder:inst| ; 8 ; 0 ; |top|decoder:inst ;
+----------------------------+------------+------+---------------------+
+---------------------------------------------------------------------------------------------+
; Control Signals ;
+------+----------+---------+--------------+--------+----------------------+------------------+
; Name ; Location ; Fan-Out ; Usage ; Global ; Global Resource Used ; Global Line Name ;
+------+----------+---------+--------------+--------+----------------------+------------------+
; clk ; PIN_37 ; 8 ; Clock ; yes ; On ; -- ;
; en ; PIN_38 ; 8 ; Clock enable ; no ; -- ; -- ;
+------+----------+---------+--------------+--------+----------------------+------------------+
+---------------------------------------------------------------------+
; Global & Other Fast Signals ;
+------+----------+---------+----------------------+------------------+
; Name ; Location ; Fan-Out ; Global Resource Used ; Global Line Name ;
+------+----------+---------+----------------------+------------------+
; clk ; PIN_37 ; 8 ; On ; -- ;
+------+----------+---------+----------------------+------------------+
+---------------------------------+
; Non-Global High Fan-Out Signals ;
+-------------------+-------------+
; Name ; Fan-Out ;
+-------------------+-------------+
; sel[0] ; 8 ;
; sel[1] ; 8 ;
; sel[2] ; 8 ;
; en ; 8 ;
; decoder:inst|Y[7] ; 1 ;
; decoder:inst|Y[0] ; 1 ;
; decoder:inst|Y[1] ; 1 ;
; decoder:inst|Y[2] ; 1 ;
; decoder:inst|Y[3] ; 1 ;
; decoder:inst|Y[4] ; 1 ;
; decoder:inst|Y[5] ; 1 ;
; decoder:inst|Y[6] ; 1 ;
+-------------------+-------------+
+----------------------------------------------+
; Interconnect Usage Summary ;
+----------------------------+-----------------+
; Interconnect Resource Type ; Usage ;
+----------------------------+-----------------+
; Output enables ; 0 / 6 ( 0 % ) ;
; PIA buffers ; 8 / 72 ( 11 % ) ;
+----------------------------+-----------------+
+----------------------------------------------------------------------+
; LAB Macrocells ;
+----------------------------------------+-----------------------------+
; Number of Macrocells (Average = 4.00) ; Number of LABs (Total = 2) ;
+----------------------------------------+-----------------------------+
; 0 ; 0 ;
; 1 ; 0 ;
; 2 ; 0 ;
; 3 ; 0 ;
; 4 ; 2 ;
+----------------------------------------+-----------------------------+
+-------------------------------------------------------------+
; Logic Cell Interconnection ;
+-----+------------+---------------------------------+--------+
; LAB ; Logic Cell ; Input ; Output ;
+-----+------------+---------------------------------+--------+
; A ; LC16 ; clk, sel[0], sel[1], sel[2], en ; Y[3] ;
; A ; LC15 ; clk, sel[0], sel[1], sel[2], en ; Y[2] ;
; A ; LC14 ; clk, sel[0], sel[1], sel[2], en ; Y[1] ;
; A ; LC13 ; clk, sel[0], sel[1], sel[2], en ; Y[0] ;
; B ; LC30 ; clk, sel[1], sel[0], sel[2], en ; Y[6] ;
; B ; LC31 ; clk, sel[1], sel[0], sel[2], en ; Y[5] ;
; B ; LC32 ; clk, sel[1], sel[0], sel[2], en ; Y[4] ;
; B ; LC29 ; clk, sel[1], sel[0], sel[2], en ; Y[7] ;
+-----+------------+---------------------------------+--------+
+-----------------+
; Fitter Messages ;
+-----------------+
Info: *******************************************************************
Info: Running Quartus II Fitter
Info: Version 5.0 Build 148 04/26/2005 SJ Full Version
Info: Processing started: Wed Sep 13 10:12:49 2006
Info: Command: quartus_fit --read_settings_files=off --write_settings_files=off decoder -c decoder
Info: Selected device EPM3032ATC44-10 for design "decoder"
Info: Quartus II Fitter was successful. 0 errors, 0 warnings
Info: Processing ended: Wed Sep 13 10:12:49 2006
Info: Elapsed time: 00:00:01
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