📄 seq_gen.fit.rpt
字号:
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; Fitter Equations ;
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The equations can be found in D:/work/fpga temple/seq_gen 576/seq_gen.fit.eqn.
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in D:/work/fpga temple/seq_gen 576/seq_gen.pin.
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; Fitter Resource Usage Summary ;
+-------------------------------+------------------------------------------------+
; Resource ; Usage ;
+-------------------------------+------------------------------------------------+
; Logic cells ; 37 / 256 ( 14 % ) ;
; Registers ; 22 / 256 ( 8 % ) ;
; Number of pterms used ; 102 ;
; User inserted logic elements ; 0 ;
; I/O pins ; 12 / 84 ( 14 % ) ;
; -- Clock pins ; 1 / 2 ( 50 % ) ;
; -- Dedicated input pins ; 0 / 2 ( 0 % ) ;
; Global signals ; 1 ;
; Shareable expanders ; 14 / 256 ( 5 % ) ;
; Parallel expanders ; 5 / 240 ( 2 % ) ;
; Cells using turbo bit ; 37 / 256 ( 14 % ) ;
; Maximum fan-out node ; lpm_counter:\hcount:hcountreg[0]_rtl_0|dffs[1] ;
; Maximum fan-out ; 24 ;
; Total fan-out ; 411 ;
; Average fan-out ; 6.52 ;
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; Input Pins ;
+---------+-------+----------+-----+-----------------------+--------------------+--------+----------------+---------------+--------------+----------------------+
; Name ; Pin # ; I/O Bank ; LAB ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; I/O Standard ; Location assigned by ;
+---------+-------+----------+-----+-----------------------+--------------------+--------+----------------+---------------+--------------+----------------------+
; clk_seq ; 87 ; -- ; -- ; 23 ; 0 ; yes ; no ; no ; LVTTL ; User ;
; rst_seq ; 21 ; -- ; 3 ; 2 ; 0 ; no ; no ; no ; LVTTL ; Fitter ;
+---------+-------+----------+-----+-----------------------+--------------------+--------+----------------+---------------+--------------+----------------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+------------+-------+----------+-----+-----------------+---------------+----------------+------------+---------------+--------------+----------------------+-------------+
; Name ; Pin # ; I/O Bank ; LAB ; Output Register ; Power Up High ; Slow Slew Rate ; Open Drain ; TRI Primitive ; I/O Standard ; Location assigned by ; Load ;
+------------+-------+----------+-----+-----------------+---------------+----------------+------------+---------------+--------------+----------------------+-------------+
; blank_out ; 7 ; -- ; 2 ; no ; no ; no ; no ; no ; LVTTL ; User ; Unspecified ;
; lcd_dataen ; 6 ; -- ; 2 ; no ; no ; no ; no ; no ; LVTTL ; Fitter ; Unspecified ;
; lcd_vs_out ; 5 ; -- ; 2 ; no ; no ; no ; no ; no ; LVTTL ; Fitter ; Unspecified ;
; pix_clk ; 2 ; -- ; 1 ; no ; no ; no ; no ; no ; LVTTL ; Fitter ; Unspecified ;
; rgb ; 97 ; -- ; 5 ; no ; no ; no ; no ; no ; LVTTL ; User ; Unspecified ;
; sync_out ; 45 ; -- ; 12 ; no ; no ; no ; no ; no ; LVTTL ; User ; Unspecified ;
+------------+-------+----------+-----+-----------------+---------------+----------------+------------+---------------+--------------+----------------------+-------------+
+-------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; User Assignment ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
; 1 ; 12 ; -- ; GND* ; ; ; ; ;
; 2 ; 13 ; -- ; pix_clk ; output ; LVTTL ; ; N ;
; 3 ; 14 ; -- ; VCCIO ; power ; ; 3.3V ; ;
; 4 ; 15 ; -- ; +TDI ; input ; LVTTL ; ; N ;
; 5 ; 16 ; -- ; lcd_vs_out ; output ; LVTTL ; ; N ;
; 6 ; 17 ; -- ; lcd_dataen ; output ; LVTTL ; ; N ;
; 7 ; 18 ; -- ; blank_out ; output ; LVTTL ; ; Y ;
; 8 ; 19 ; -- ; GND* ; ; ; ; ;
; 9 ; 20 ; -- ; GND* ; ; ; ; ;
; 10 ; 21 ; -- ; GND* ; ; ; ; ;
; 11 ; 22 ; -- ; GND ; gnd ; ; ; ;
; 12 ; 23 ; -- ; GND* ; ; ; ; ;
; 13 ; 24 ; -- ; GND* ; ; ; ; ;
; 14 ; 25 ; -- ; GND* ; ; ; ; ;
; 15 ; 26 ; -- ; +TMS ; input ; LVTTL ; ; N ;
; 16 ; 27 ; -- ; GND* ; ; ; ; ;
; 17 ; 28 ; -- ; GND* ; ; ; ; ;
; 18 ; 29 ; -- ; VCCIO ; power ; ; 3.3V ; ;
; 19 ; 30 ; -- ; GND* ; ; ; ; ;
; 20 ; 31 ; -- ; GND* ; ; ; ; ;
; 21 ; 32 ; -- ; rst_seq ; input ; LVTTL ; ; N ;
; 22 ; 33 ; -- ; GND* ; ; ; ; ;
; 23 ; 34 ; -- ; GND* ; ; ; ; ;
; 24 ; 35 ; -- ; GND* ; ; ; ; ;
; 25 ; 36 ; -- ; GND* ; ; ; ; ;
; 26 ; 37 ; -- ; GND ; gnd ; ; ; ;
; 27 ; 38 ; -- ; GND* ; ; ; ; ;
; 28 ; 39 ; -- ; GND* ; ; ; ; ;
; 29 ; 40 ; -- ; GND* ; ; ; ; ;
; 30 ; 41 ; -- ; GND* ; ; ; ; ;
; 31 ; 42 ; -- ; GND* ; ; ; ; ;
; 32 ; 43 ; -- ; GND* ; ; ; ; ;
; 33 ; 44 ; -- ; GND* ; ; ; ; ;
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