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📄 lcd.tan.rpt

📁 用Verilog HDL 语言写的在LCD液晶上显示文字的源程序
💻 RPT
📖 第 1 页 / 共 5 页
字号:
; N/A                                     ; 103.09 MHz ( period = 9.700 ns )                    ; xpage[0]     ; state.s6     ; clk        ; clk      ; None                        ; None                      ; 8.600 ns                ;
; N/A                                     ; 103.09 MHz ( period = 9.700 ns )                    ; addr1[6]     ; xpage[3]     ; clk        ; clk      ; None                        ; None                      ; 8.600 ns                ;
; N/A                                     ; 103.09 MHz ( period = 9.700 ns )                    ; addr[5]      ; addr[0]      ; clk        ; clk      ; None                        ; None                      ; 8.600 ns                ;
; N/A                                     ; 103.09 MHz ( period = 9.700 ns )                    ; state.s16    ; addr[1]      ; clk        ; clk      ; None                        ; None                      ; 8.600 ns                ;
; N/A                                     ; 103.09 MHz ( period = 9.700 ns )                    ; addr[3]      ; addr[3]      ; clk        ; clk      ; None                        ; None                      ; 8.600 ns                ;
; N/A                                     ; 103.09 MHz ( period = 9.700 ns )                    ; addr[2]      ; addr[4]      ; clk        ; clk      ; None                        ; None                      ; 8.600 ns                ;
; N/A                                     ; 103.09 MHz ( period = 9.700 ns )                    ; xpage[5]     ; test[1]~reg0 ; clk        ; clk      ; None                        ; None                      ; 8.600 ns                ;
; N/A                                     ; 103.09 MHz ( period = 9.700 ns )                    ; xpage[0]     ; test[1]~reg0 ; clk        ; clk      ; None                        ; None                      ; 8.600 ns                ;
; N/A                                     ; 103.09 MHz ( period = 9.700 ns )                    ; state.s9     ; data[7]~reg0 ; clk        ; clk      ; None                        ; None                      ; 8.600 ns                ;
; N/A                                     ; 103.09 MHz ( period = 9.700 ns )                    ; xpage[7]     ; data[7]~reg0 ; clk        ; clk      ; None                        ; None                      ; 8.600 ns                ;
; N/A                                     ; 103.09 MHz ( period = 9.700 ns )                    ; state.s13    ; data[3]~reg0 ; clk        ; clk      ; None                        ; None                      ; 8.600 ns                ;
; N/A                                     ; 103.09 MHz ( period = 9.700 ns )                    ; state.s13    ; data[0]~reg0 ; clk        ; clk      ; None                        ; None                      ; 8.600 ns                ;
; N/A                                     ; 104.17 MHz ( period = 9.600 ns )                    ; xpage[1]     ; xpage[0]     ; clk        ; clk      ; None                        ; None                      ; 8.500 ns                ;
; N/A                                     ; 104.17 MHz ( period = 9.600 ns )                    ; xpage[1]     ; xpage[1]     ; clk        ; clk      ; None                        ; None                      ; 8.500 ns                ;
; N/A                                     ; 104.17 MHz ( period = 9.600 ns )                    ; xpage[5]     ; xpage[6]     ; clk        ; clk      ; None                        ; None                      ; 8.500 ns                ;
; N/A                                     ; 104.17 MHz ( period = 9.600 ns )                    ; addr[4]      ; addr[5]      ; clk        ; clk      ; None                        ; None                      ; 8.500 ns                ;
; N/A                                     ; 104.17 MHz ( period = 9.600 ns )                    ; state.s13    ; addr[3]      ; clk        ; clk      ; None                        ; None                      ; 8.500 ns                ;
; N/A                                     ; 104.17 MHz ( period = 9.600 ns )                    ; addr[6]      ; addr[4]      ; clk        ; clk      ; None                        ; None                      ; 8.500 ns                ;
; N/A                                     ; 104.17 MHz ( period = 9.600 ns )                    ; state.s16    ; data[5]~reg0 ; clk        ; clk      ; None                        ; None                      ; 8.500 ns                ;
; N/A                                     ; 104.17 MHz ( period = 9.600 ns )                    ; state.s2     ; data[5]~reg0 ; clk        ; clk      ; None                        ; None                      ; 8.500 ns                ;
; N/A                                     ; 104.17 MHz ( period = 9.600 ns )                    ; state.s18    ; data[3]~reg0 ; clk        ; clk      ; None                        ; None                      ; 8.500 ns                ;
; N/A                                     ; 105.26 MHz ( period = 9.500 ns )                    ; xpage[1]     ; state.s9     ; clk        ; clk      ; None                        ; None                      ; 8.400 ns                ;
; N/A                                     ; 105.26 MHz ( period = 9.500 ns )                    ; xpage[1]     ; state.s2     ; clk        ; clk      ; None                        ; None                      ; 8.400 ns                ;
; N/A                                     ; 105.26 MHz ( period = 9.500 ns )                    ; xpage[1]     ; state.s6     ; clk        ; clk      ; None                        ; None                      ; 8.400 ns                ;
; N/A                                     ; 105.26 MHz ( period = 9.500 ns )                    ; state.s18    ; addr[1]      ; clk        ; clk      ; None                        ; None                      ; 8.400 ns                ;
; N/A                                     ; 105.26 MHz ( period = 9.500 ns )                    ; addr[5]      ; addr[1]      ; clk        ; clk      ; None                        ; None                      ; 8.400 ns                ;
; N/A                                     ; 105.26 MHz ( period = 9.500 ns )                    ; state.s18    ; addr[3]      ; clk        ; clk      ; None                        ; None                      ; 8.400 ns                ;
; N/A                                     ; 105.26 MHz ( period = 9.500 ns )                    ; xpage[1]     ; test[1]~reg0 ; clk        ; clk      ; None                        ; None                      ; 8.400 ns                ;
; N/A                                     ; 105.26 MHz ( period = 9.500 ns )                    ; addr1[0]     ; addr1[6]     ; clk        ; clk      ; None                        ; None                      ; 8.400 ns                ;
; N/A                                     ; 105.26 MHz ( period = 9.500 ns )                    ; data[6]~reg0 ; data[6]~reg0 ; clk        ; clk      ; None                        ; None                      ; 8.400 ns                ;
; N/A                                     ; 105.26 MHz ( period = 9.500 ns )                    ; state.s9     ; data[5]~reg0 ; clk        ; clk      ; None                        ; None                      ; 8.400 ns                ;
; N/A                                     ; 105.26 MHz ( period = 9.500 ns )                    ; state.s2     ; data[3]~reg0 ; clk        ; clk      ; None                        ; None                      ; 8.400 ns                ;
; N/A                                     ; 105.26 MHz ( period = 9.500 ns )                    ; state.s18    ; data[1]~reg0 ; clk        ; clk      ; None                        ; None                      ; 8.400 ns                ;
; Timing analysis restricted to 200 rows. ; To change the limit use Settings (Assignments menu) ;              ;              ;            ;          ;                             ;                           ;                         ;
+-----------------------------------------+-----------------------------------------------------+--------------+--------------+------------+----------+-----------------------------+---------------------------+-------------------------+


+--------------------------------------------------------------------+
; tsu                                                                ;
+-------+--------------+------------+------+--------------+----------+
; Slack ; Required tsu ; Actual tsu ; From ; To           ; To Clock ;
+-------+--------------+------------+------+--------------+----------+
; N/A   ; None         ; 9.400 ns   ; rst  ; data[4]~reg0 ; clk      ;
; N/A   ; None         ; 7.600 ns   ; rst  ; data[2]~reg0 ; clk      ;
; N/A   ; None         ; 7.400 ns   ; rst  ; data[7]~reg0 ; clk      ;
; N/A   ; None         ; 7.200 ns   ; rst  ; data[0]~reg0 ; clk      ;
; N/A   ; None         ; 6.300 ns   ; rst  ; data[5]~reg0 ; clk      ;
; N/A   ; None         ; 5.800 ns   ; rst  ; data[3]~reg0 ; clk      ;
; N/A   ; None         ; 5.700 ns   ; rst  ; data[6]~reg0 ; clk      ;
; N/A   ; None         ; 4.600 ns   ; rst  ; data[1]~reg0 ; clk      ;
; N/A   ; None         ; 3.000 ns   ; rst  ; xpage[1]     ; clk      ;
; N/A   ; None         ; 3.000 ns   ; rst  ; xpage[0]     ; clk      ;
; N/A   ; None         ; 2.900 ns   ; rst  ; xpage[2]     ; clk      ;
; N/A   ; None         ; 1.700 ns   ; rst  ; state.s6     ; clk      ;
; N/A   ; None         ; 1.700 ns   ; rst  ; state.s2     ; clk      ;
; N/A   ; None         ; 1.700 ns   ; rst  ; state.01110  ; clk      ;
; N/A   ; None         ; 1.700 ns   ; rst  ; xpage[6]     ; clk      ;
; N/A   ; None         ; 1.400 ns   ; rst  ; xpage[4]     ; clk      ;
; N/A   ; None         ; 1.400 ns   ; rst  ; xpage[5]     ; clk      ;
; N/A   ; None         ; 1.400 ns   ; rst  ; state.s5     ; clk      ;
; N/A   ; None         ; 1.300 ns   ; rst  ; xpage[3]     ; clk      ;
; N/A   ; None         ; 0.600 ns   ; rst  ; state.s9     ; clk      ;
; N/A   ; None         ; 0.500 ns   ; rst  ; state.s11    ; clk      ;
; N/A   ; None         ; 0.400 ns   ; rst  ; state.s19    ; clk      ;
; N/A   ; None         ; 0.400 ns   ; rst  ; state.s17    ; clk      ;
; N/A   ; None         ; 0.300 ns   ; rst  ; state.s16    ; clk      ;
; N/A   ; None         ; 0.300 ns   ; rst  ; state.s13    ; clk      ;
; N/A   ; None         ; 0.200 ns   ; rst  ; state.s12    ; clk      ;
; N/A   ; None         ; 0.100 ns   ; rst  ; state.s18    ; clk      ;
; N/A   ; None         ; -0.100 ns  ; rst  ; cs2~reg0     ; clk      ;
; N/A   ; None         ; -1.000 ns  ; rst  ; xpage[7]     ; clk      ;
; N/A   ; None         ; -1.100 ns  ; rst  ; state.s4     ; clk      ;
; N/A   ; None         ; -1.200 ns  ; rst  ; test[0]~reg0 ; clk      ;
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; N/A   ; None         ; -1.200 ns  ; rst  ; test[1]~reg0 ; clk      ;
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