📄 a6850.fit.rpt
字号:
; 31 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ;
; 32 ; ; ; GND ; gnd ; ; ; -- ; ;
; 33 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 34 ; 35 ; 4 ; reset ; input ; LVTTL ; ; Column I/O ; N ;
; 35 ; 36 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 36 ; 39 ; 4 ; di[5] ; input ; LVTTL ; ; Column I/O ; N ;
; 37 ; 40 ; 4 ; di[6] ; input ; LVTTL ; ; Column I/O ; N ;
; 38 ; 44 ; 4 ; cts ; input ; LVTTL ; ; Column I/O ; N ;
; 39 ; 45 ; 4 ; rts ; output ; LVTTL ; ; Column I/O ; N ;
; 40 ; 46 ; 4 ; rw_n ; input ; LVTTL ; ; Column I/O ; N ;
; 41 ; 49 ; 4 ; rs ; input ; LVTTL ; ; Column I/O ; N ;
; 42 ; 50 ; 4 ; dcd ; input ; LVTTL ; ; Column I/O ; N ;
; 43 ; ; ; GND ; gnd ; ; ; -- ; ;
; 44 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 45 ; ; ; GND ; gnd ; ; ; -- ; ;
; 46 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ;
; 47 ; 51 ; 4 ; do[5] ; output ; LVTTL ; ; Column I/O ; N ;
; 48 ; 52 ; 4 ; do[7] ; output ; LVTTL ; ; Column I/O ; N ;
; 49 ; 55 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 50 ; 56 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 51 ; 57 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 52 ; 58 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 53 ; 59 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 54 ; 60 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 55 ; 61 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 56 ; 62 ; 3 ; do[2] ; output ; LVTTL ; ; Row I/O ; N ;
; 57 ; 63 ; 3 ; do[6] ; output ; LVTTL ; ; Row I/O ; N ;
; 58 ; ; ; GND ; gnd ; ; ; -- ; ;
; 59 ; ; 3 ; VCCIO3 ; power ; ; 3.3V ; -- ; ;
; 60 ; 68 ; 3 ; ^CONF_DONE ; ; ; ; -- ; ;
; 61 ; 69 ; 3 ; ^nSTATUS ; ; ; ; -- ; ;
; 62 ; 70 ; 3 ; #TCK ; input ; ; ; -- ; ;
; 63 ; 71 ; 3 ; #TMS ; input ; ; ; -- ; ;
; 64 ; 72 ; 3 ; #TDO ; output ; ; ; -- ; ;
; 65 ; 73 ; 3 ; do[4] ; output ; LVTTL ; ; Row I/O ; N ;
; 66 ; 75 ; 3 ; rxclk ; input ; LVTTL ; ; Row I/O ; N ;
; 67 ; 77 ; 3 ; #TDI ; input ; ; ; -- ; ;
; 68 ; 78 ; 3 ; do[3] ; output ; LVTTL ; ; Row I/O ; N ;
; 69 ; 79 ; 3 ; irq_n ; output ; LVTTL ; ; Row I/O ; N ;
; 70 ; 80 ; 3 ; txdata ; output ; LVTTL ; ; Row I/O ; N ;
; 71 ; 81 ; 3 ; cs[2] ; input ; LVTTL ; ; Row I/O ; N ;
; 72 ; 82 ; 3 ; cs[1] ; input ; LVTTL ; ; Row I/O ; N ;
; 73 ; 84 ; 3 ; cs[0] ; input ; LVTTL ; ; Row I/O ; N ;
; 74 ; 87 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 75 ; 88 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 76 ; 89 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 77 ; 90 ; 2 ; e ; input ; LVTTL ; ; Column I/O ; N ;
; 78 ; 93 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 79 ; 94 ; 2 ; do[0] ; output ; LVTTL ; ; Column I/O ; N ;
; 80 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ;
; 81 ; ; ; GND ; gnd ; ; ; -- ; ;
; 82 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 83 ; ; ; GND ; gnd ; ; ; -- ; ;
; 84 ; 95 ; 2 ; rxdata ; input ; LVTTL ; ; Column I/O ; N ;
; 85 ; 96 ; 2 ; di[0] ; input ; LVTTL ; ; Column I/O ; N ;
; 86 ; 99 ; 2 ; do[1] ; output ; LVTTL ; ; Column I/O ; N ;
; 87 ; 100 ; 2 ; di[3] ; input ; LVTTL ; ; Column I/O ; N ;
; 88 ; 101 ; 2 ; di[1] ; input ; LVTTL ; ; Column I/O ; N ;
; 89 ; 105 ; 2 ; di[7] ; input ; LVTTL ; ; Column I/O ; N ;
; 90 ; 106 ; 2 ; di[2] ; input ; LVTTL ; ; Column I/O ; N ;
; 91 ; 109 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 92 ; 110 ; 2 ; di[4] ; input ; LVTTL ; ; Column I/O ; N ;
; 93 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 94 ; ; ; GND ; gnd ; ; ; -- ; ;
; 95 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ;
; 96 ; ; ; GND ; gnd ; ; ; -- ; ;
; 97 ; 111 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 98 ; 112 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 99 ; 115 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 100 ; 116 ; 2 ; GND* ; ; ; ; Column I/O ; ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+
+------------------------------------------------------------------+
; Output Pin Default Load For Reported TCO ;
+---------------------+-------+------------------------------------+
; I/O Standard ; Load ; Termination Resistance ;
+---------------------+-------+------------------------------------+
; LVTTL ; 10 pF ; Not Available ;
; LVCMOS ; 10 pF ; Not Available ;
; 2.5 V ; 10 pF ; Not Available ;
; 1.8 V ; 10 pF ; Not Available ;
; 1.5 V ; 10 pF ; Not Available ;
; SSTL-3 Class I ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-3 Class II ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class I ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class II ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; Differential SSTL-2 ; 30 pF ; (See SSTL-2) ;
+---------------------+-------+------------------------------------+
Note: User assignments will override these defaults. The user specified values are listed in the Output Pins and Bidir Pins tables.
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+----------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+-------------------------------+
; Compilation Hierarchy Node ; Logic Cells ; LC Registers ; Memory Bits ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Full Hierarchy Name ;
+----------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+-------------------------------+
; |a6850 ; 190 (2) ; 111 ; 0 ; 31 ; 0 ; 79 (2) ; 10 (0) ; 101 (0) ; 17 (0) ; |a6850 ;
; |bus_cntl:u7| ; 25 (25) ; 16 ; 0 ; 0 ; 0 ; 9 (9) ; 8 (8) ; 8 (8) ; 0 (0) ; |a6850|bus_cntl:u7 ;
; |cntl_reg:u6| ; 9 (9) ; 8 ; 0 ; 0 ; 0 ; 1 (1) ; 1 (1) ; 7 (7) ; 0 (0) ; |a6850|cntl_reg:u6 ;
; |par_tree:u2| ; 2 (2) ; 0 ; 0 ; 0 ; 0 ; 2 (2) ; 0 (0) ; 0 (0) ; 0 (0) ; |a6850|par_tree:u2 ;
; |rcv_reg:u3| ; 8 (8) ; 8 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 8 (8) ; 0 (0) ; |a6850|rcv_reg:u3 ;
; |rxcntl:u1| ; 54 (0) ; 26 ; 0 ; 0 ; 0 ; 28 (0) ; 0 (0) ; 26 (0) ; 10 (0) ; |a6850|rxcntl:u1 ;
; |datcount:u2| ; 6 (6) ; 4 ; 0 ; 0 ; 0 ; 2 (2) ; 0 (0) ; 4 (4) ; 4 (4) ; |a6850|rxcntl:u1|datcount:u2 ;
; |framerr:u4| ; 1 (1) ; 1 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 1 (1) ; 0 (0) ; |a6850|rxcntl:u1|framerr:u4 ;
; |rxcntlsm:u1| ; 36 (36) ; 15 ; 0 ; 0 ; 0 ; 21 (21) ; 0 (0) ; 15 (15) ; 0 (0) ; |a6850|rxcntl:u1|rxcntlsm:u1 ;
; |rxcount:u3| ; 11 (11) ; 6 ; 0 ; 0 ; 0 ; 5 (5) ; 0 (0) ; 6 (6) ; 6 (6) ; |a6850|rxcntl:u1|rxcount:u3 ;
; |rxshftrg:u5| ; 18 (18) ; 9 ; 0 ; 0 ; 0 ; 9 (9) ; 0 (0) ; 9 (9) ; 0 (0) ; |a6850|rxshftrg:u5 ;
; |srpargen:u9| ; 15 (0) ; 9 ; 0 ; 0 ; 0 ; 6 (0) ; 0 (0) ; 9 (0) ; 0 (0) ; |a6850|srpargen:u9 ;
; |brkmux:u5| ; 2 (2) ; 0 ; 0 ; 0 ; 0 ; 2 (2) ; 0 (0) ; 0 (0) ; 0 (0) ; |a6850|srpargen:u9|brkmux:u5 ;
; |datamux:u1| ; 1 (1) ; 0 ; 0 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 0 (0) ; 0 (0) ; |a6850|srpargen:u9|datamux:u1 ;
; |pargen:u2| ; 3 (3) ; 1 ; 0 ; 0 ; 0 ; 2 (2) ; 0 (0) ; 1 (1) ; 0 (0) ; |a6850|srpargen:u9|pargen:u2 ;
; |tshftrg:u3| ; 9 (9) ; 8 ; 0 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 8 (8) ; 0 (0) ; |a6850|srpargen:u9|tshftrg:u3 ;
; |stsrg:u4| ; 16 (1) ; 11 ; 0 ; 0 ; 0 ; 5 (1) ; 1 (0) ; 10 (0) ; 0 (0) ; |a6850|stsrg:u4 ;
; |rx_stsrg:u2| ; 11 (11) ; 8 ; 0 ; 0 ; 0 ; 3 (3) ; 0 (0) ; 8 (8) ; 0 (0) ; |a6850|stsrg:u4|rx_stsrg:u2 ;
; |tx_stsrg:u1| ; 4 (4) ; 3 ; 0 ; 0 ; 0 ; 1 (1) ; 1 (1) ; 2 (2) ; 0 (0) ; |a6850|stsrg:u4|tx_stsrg:u1 ;
; |tcntl:u8| ; 32 (0) ; 16 ; 0 ; 0 ; 0 ; 16 (0) ; 0 (0) ; 16 (0) ; 7 (0) ; |a6850|tcntl:u8 ;
; |datacnt:u2| ; 5 (5) ; 3 ; 0 ; 0 ; 0 ; 2 (2) ; 0 (0) ; 3 (3) ; 0 (0) ; |a6850|tcntl:u8|datacnt:u2 ;
; |transm:u1| ; 15 (15) ; 6 ; 0 ; 0 ; 0 ; 9 (9) ; 0 (0) ; 6 (6) ; 0 (0) ; |a6850|tcntl:u8|transm:u1 ;
; |txclkcnt:u3| ; 12 (12) ; 7 ; 0 ; 0 ; 0 ; 5 (5) ; 0 (0) ; 7 (7) ; 7 (7) ; |a6850|tcntl:u8|txclkcnt:u3 ;
; |xmit_reg:u10| ; 9 (9) ; 8 ; 0 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 8 (8) ; 0 (0) ; |a6850|xmit_reg:u10 ;
+----------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+-------------------------------+
Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.
+---------------------------------------------------------------------------------+
; Delay Chain Summary ;
+--------+----------+---------------+---------------+-----------------------+-----+
; Name ; Pin Type ; Pad to Core 0 ; Pad to Core 1 ; Pad to Input Register ; TCO ;
+--------+----------+---------------+---------------+-----------------------+-----+
; rs ; Input ; ON ; ON ; -- ; -- ;
; rxclk ; Input ; OFF ; OFF ; -- ; -- ;
; reset ; Input ; OFF ; OFF ; -- ; -- ;
; cts ; Input ; ON ; ON ; -- ; -- ;
; txclk ; Input ; OFF ; OFF ; -- ; -- ;
; dcd ; Input ; ON ; ON ; -- ; -- ;
; rxdata ; Input ; ON ; ON ; -- ; -- ;
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