smarti_params.v

来自「USBRTL电路的VHDL和Verilog代码」· Verilog 代码 · 共 4 行

4 行

`define num_size 8 //1 byte
`define num_fifo 5 //2^5 =32 byte : fifo size + 1
`define full     6'd31

smarti_params.v - 源码说明

本页面展示了「USBRTL电路的VHDL和Verilog代码」中的 smarti_params.v 源码文件，采用 Verilog 编程语言编写，共 4 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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