📄 automat.fit.rpt
字号:
; 133 ; 188 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 134 ; 189 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 135 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 136 ; ; ; GND ; gnd ; ; ; -- ; ;
; 137 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ;
; 138 ; ; ; GND ; gnd ; ; ; -- ; ;
; 139 ; 190 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 140 ; 191 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 141 ; 192 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 142 ; 193 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 143 ; 196 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 144 ; 197 ; 2 ; GND* ; ; ; ; Column I/O ; ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+
+------------------------------------------------------------------+
; Output Pin Default Load For Reported TCO ;
+---------------------+-------+------------------------------------+
; I/O Standard ; Load ; Termination Resistance ;
+---------------------+-------+------------------------------------+
; LVTTL ; 10 pF ; Not Available ;
; LVCMOS ; 10 pF ; Not Available ;
; 2.5 V ; 10 pF ; Not Available ;
; 1.8 V ; 10 pF ; Not Available ;
; 1.5 V ; 10 pF ; Not Available ;
; SSTL-3 Class I ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-3 Class II ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class I ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class II ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; Differential SSTL-2 ; 30 pF ; (See SSTL-2) ;
; 3.3-V PCI ; 10 pF ; 25 Ohm (Parallel) ;
; LVDS ; 4 pF ; 100 Ohm (Differential) ;
; RSDS ; 0 pF ; 100 Ohm (Differential) ;
+---------------------+-------+------------------------------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+----------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+---------------------+
; Compilation Hierarchy Node ; Logic Cells ; LC Registers ; Memory Bits ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Full Hierarchy Name ;
+----------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+---------------------+
; |Automat ; 31 (31) ; 6 ; 0 ; 10 ; 0 ; 25 (25) ; 1 (1) ; 5 (5) ; 0 (0) ; |Automat ;
+----------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+---------------------+
+-----------------------------------------------------------------------------------------+
; Delay Chain Summary ;
+----------------+----------+---------------+---------------+-----------------------+-----+
; Name ; Pin Type ; Pad to Core 0 ; Pad to Core 1 ; Pad to Input Register ; TCO ;
+----------------+----------+---------------+---------------+-----------------------+-----+
; choice[1] ; Input ; ON ; ON ; -- ; -- ;
; choice[0] ; Input ; ON ; ON ; -- ; -- ;
; clk ; Input ; OFF ; OFF ; -- ; -- ;
; rst ; Input ; OFF ; OFF ; -- ; -- ;
; din[1] ; Input ; OFF ; ON ; -- ; -- ;
; din[0] ; Input ; OFF ; ON ; -- ; -- ;
; commodity[1] ; Output ; -- ; -- ; -- ; -- ;
; commodity[0] ; Output ; -- ; -- ; -- ; -- ;
; give_change[1] ; Output ; -- ; -- ; -- ; -- ;
; give_change[0] ; Output ; -- ; -- ; -- ; -- ;
+----------------+----------+---------------+---------------+-----------------------+-----+
+----------------------------------------------------+
; Pad To Core Delay Chain Fanout ;
+----------------------+-------------------+---------+
; Source Pin / Fanout ; Pad To Core Index ; Setting ;
+----------------------+-------------------+---------+
; choice[1] ; ; ;
; - reduce_nor~3 ; 0 ; ON ;
; - Select~180 ; 0 ; ON ;
; - cur_state.st3 ; 0 ; ON ;
; - Select~616 ; 0 ; ON ;
; - Select~41 ; 0 ; ON ;
; - process1~6 ; 0 ; ON ;
; - Select~624 ; 0 ; ON ;
; choice[0] ; ; ;
; - reduce_nor~3 ; 0 ; ON ;
; - Select~180 ; 0 ; ON ;
; - cur_state.st3 ; 0 ; ON ;
; - Select~616 ; 0 ; ON ;
; - Select~41 ; 0 ; ON ;
; - process1~6 ; 0 ; ON ;
; - Select~624 ; 0 ; ON ;
; clk ; ; ;
; rst ; ; ;
; din[1] ; ; ;
; - Select~27 ; 1 ; ON ;
; - Select~26 ; 1 ; ON ;
; - Select~617 ; 1 ; ON ;
; - cur_state.st1 ; 1 ; ON ;
; - Select~139 ; 1 ; ON ;
; - Select~619 ; 1 ; ON ;
; - Select~171 ; 1 ; ON ;
; - Select~620 ; 1 ; ON ;
; - Select~622 ; 1 ; ON ;
; - Select~623 ; 1 ; ON ;
; din[0] ; ; ;
; - Select~27 ; 1 ; ON ;
; - Select~26 ; 1 ; ON ;
; - Select~617 ; 1 ; ON ;
; - cur_state.st1 ; 1 ; ON ;
; - Select~139 ; 1 ; ON ;
; - Select~619 ; 1 ; ON ;
; - Select~171 ; 1 ; ON ;
; - Select~620 ; 1 ; ON ;
; - Select~622 ; 1 ; ON ;
; - Select~623 ; 1 ; ON ;
+----------------------+-------------------+---------+
+---------------------------------------------------------------------------------------------+
; Control Signals ;
+------+----------+---------+--------------+--------+----------------------+------------------+
; Name ; Location ; Fan-Out ; Usage ; Global ; Global Resource Used ; Global Line Name ;
+------+----------+---------+--------------+--------+----------------------+------------------+
; clk ; PIN_17 ; 6 ; Clock ; yes ; Global clock ; GCLK3 ;
; rst ; PIN_16 ; 6 ; Async. clear ; yes ; Global clock ; GCLK2 ;
+------+----------+---------+--------------+--------+----------------------+------------------+
+---------------------------------------------------------------------+
; Global & Other Fast Signals ;
+------+----------+---------+----------------------+------------------+
; Name ; Location ; Fan-Out ; Global Resource Used ; Global Line Name ;
+------+----------+---------+----------------------+------------------+
; clk ; PIN_17 ; 6 ; Global clock ; GCLK3 ;
; rst ; PIN_16 ; 6 ; Global clock ; GCLK2 ;
+------+----------+---------+----------------------+------------------+
+---------------------------------+
; Non-Global High Fan-Out Signals ;
+----------------------+----------+
; Name ; Fan-Out ;
+----------------------+----------+
; din[0] ; 10 ;
; din[1] ; 10 ;
; choice[0] ; 7 ;
; choice[1] ; 7 ;
; cur_state.st5 ; 5 ;
; Select~34 ; 5 ;
; cur_state.st2 ; 4 ;
; cur_state.st0 ; 4 ;
; process1~6 ; 4 ;
; cur_state.st4 ; 4 ;
; Select~615 ; 4 ;
; Select~180 ; 4 ;
; Select~624 ; 3 ;
; cur_state.st1 ; 3 ;
; reduce_nor~3 ; 3 ;
; next_state.st1 ; 2 ;
; next_state.st0 ; 2 ;
; next_state.st3 ; 2 ;
; give_change[0]$latch ; 2 ;
; give_change[1]$latch ; 2 ;
; commodity[0]$latch ; 2 ;
; commodity[1]$latch ; 2 ;
; cur_state.st3 ; 2 ;
; Select~623 ; 1 ;
; Select~622 ; 1 ;
; Select~621 ; 1 ;
; Select~620 ; 1 ;
; next_state.st2 ; 1 ;
; Select~171 ; 1 ;
; Select~619 ; 1 ;
; Select~139 ; 1 ;
; Select~618 ; 1 ;
; next_state.st5 ; 1 ;
; Select~617 ; 1 ;
; next_state.st4 ; 1 ;
; Select~26 ; 1 ;
; Select~27 ; 1 ;
; Select~41 ; 1 ;
; Select~616 ; 1 ;
; Select~39 ; 1 ;
+----------------------+----------+
+----------------------------------------------------+
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