📄 divider.fit.rpt
字号:
; 66 ; VCC_IO ; ;
; 67 ; dividend[0] ; LVTTL/LVCMOS ;
; 68 ; dividend[1] ; LVTTL/LVCMOS ;
; 69 ; dividend[2] ; LVTTL/LVCMOS ;
; 70 ; dividend[3] ; LVTTL/LVCMOS ;
; 71 ; GND* ; ;
; 72 ; VCC_INT ; ;
; 73 ; GND* ; ;
; 74 ; GND* ; ;
; 75 ; GND* ; ;
; 76 ; GND ; ;
; 77 ; VCC_CKLK ; ;
; 78 ; GND+ ; ;
; 79 ; clock ; LVTTL/LVCMOS ;
; 80 ; GND+ ; ;
; 81 ; GND_CKLK ; ;
; 82 ; GND ; ;
; 83 ; GND* ; ;
; 84 ; VCC_IO ; ;
; 85 ; GND* ; ;
; 86 ; GND* ; ;
; 87 ; GND* ; ;
; 88 ; GND* ; ;
; 89 ; GND* ; ;
; 90 ; GND* ; ;
; 91 ; VCC_INT ; ;
; 92 ; GND* ; ;
; 93 ; GND* ; ;
; 94 ; GND* ; ;
; 95 ; GND* ; ;
; 96 ; GND* ; ;
; 97 ; GND* ; ;
; 98 ; VCC_IO ; ;
; 99 ; GND* ; ;
; 100 ; GND* ; ;
; 101 ; GND* ; ;
; 102 ; GND* ; ;
; 103 ; GND* ; ;
; 104 ; GND* ; ;
; 105 ; ^nCONFIG ; ;
; 106 ; VCC_INT ; ;
; 107 ; ^MSEL1 ; ;
; 108 ; ^MSEL0 ; ;
; 109 ; GND ; ;
; 110 ; VCC_IO ; ;
; 111 ; remainder[0] ; LVTTL/LVCMOS ;
; 112 ; remainder[1] ; LVTTL/LVCMOS ;
; 113 ; remainder[2] ; LVTTL/LVCMOS ;
; 114 ; remainder[3] ; LVTTL/LVCMOS ;
; 115 ; remainder[4] ; LVTTL/LVCMOS ;
; 116 ; remainder[5] ; LVTTL/LVCMOS ;
; 117 ; GND ; ;
; 118 ; VCC_IO ; ;
; 119 ; remainder[6] ; LVTTL/LVCMOS ;
; 120 ; remainder[7] ; LVTTL/LVCMOS ;
; 121 ; GND* ; ;
; 122 ; GND* ; ;
; 123 ; GND ; ;
; 124 ; VCC_INT ; ;
; 125 ; GND* ; ;
; 126 ; GND* ; ;
; 127 ; GND* ; ;
; 128 ; GND* ; ;
; 129 ; GND ; ;
; 130 ; VCC_INT ; ;
; 131 ; GND* ; ;
; 132 ; GND* ; ;
; 133 ; GND* ; ;
; 134 ; GND* ; ;
; 135 ; GND* ; ;
; 136 ; GND* ; ;
; 137 ; GND ; ;
; 138 ; VCC_IO ; ;
; 139 ; GND* ; ;
; 140 ; GND* ; ;
; 141 ; GND* ; ;
; 142 ; GND* ; ;
; 143 ; GND* ; ;
; 144 ; GND* ; ;
; 145 ; GND ; ;
; 146 ; VCC_IO ; ;
; 147 ; GND* ; ;
; 148 ; GND* ; ;
; 149 ; GND* ; ;
; 150 ; GND* ; ;
; 151 ; GND ; ;
; 152 ; VCC_INT ; ;
; 153 ; #TDI ; ;
; 154 ; ^nCE ; ;
; 155 ; ^DCLK ; ;
; 156 ; ^DATA0 ; ;
; 157 ; GND* ; ;
; 158 ; GND* ; ;
; 159 ; GND* ; ;
; 160 ; GND* ; ;
; 161 ; GND* ; ;
; 162 ; GND* ; ;
; 163 ; GND* ; ;
; 164 ; GND* ; ;
; 165 ; VCC_IO ; ;
; 166 ; GND* ; ;
; 167 ; GND* ; ;
; 168 ; GND* ; ;
; 169 ; GND* ; ;
; 170 ; GND* ; ;
; 171 ; GND ; ;
; 172 ; GND* ; ;
; 173 ; GND* ; ;
; 174 ; GND* ; ;
; 175 ; GND* ; ;
; 176 ; GND* ; ;
; 177 ; GND* ; ;
; 178 ; VCC_IO ; ;
; 179 ; GND* ; ;
; 180 ; GND* ; ;
; 181 ; GND ; ;
; 182 ; GND+ ; ;
; 183 ; GND+ ; ;
; 184 ; GND+ ; ;
; 185 ; VCC_INT ; ;
; 186 ; GND* ; ;
; 187 ; GND* ; ;
; 188 ; GND ; ;
; 189 ; GND* ; ;
; 190 ; GND* ; ;
; 191 ; GND* ; ;
; 192 ; GND* ; ;
; 193 ; finish ; LVTTL/LVCMOS ;
; 194 ; VCC_IO ; ;
; 195 ; GND* ; ;
; 196 ; GND* ; ;
; 197 ; GND* ; ;
; 198 ; GND* ; ;
; 199 ; GND* ; ;
; 200 ; GND* ; ;
; 201 ; VCC_INT ; ;
; 202 ; GND* ; ;
; 203 ; GND* ; ;
; 204 ; GND* ; ;
; 205 ; GND* ; ;
; 206 ; GND* ; ;
; 207 ; GND* ; ;
; 208 ; GND* ; ;
+-------+----------------+--------------+
+--------------------------------------------------------------+
; Control Signals ;
+------------+---------+---------+--------------+--------------+
; Name ; Pin # ; Fan-Out ; Usage ; Global Usage ;
+------------+---------+---------+--------------+--------------+
; clock ; 79 ; 18 ; Clock ; Pin ;
; drreg[2]~4 ; LC8_J42 ; 4 ; Clock enable ; Non-global ;
+------------+---------+---------+--------------+--------------+
+----------------------------------+
; Global & Other Fast Signals ;
+-------+-------+---------+--------+
; Name ; Pin # ; Fan-Out ; Global ;
+-------+-------+---------+--------+
; clock ; 79 ; 18 ; yes ;
+-------+-------+---------+--------+
+----------------+
; Cascade Chains ;
+--------+-------+
; Length ; Count ;
+--------+-------+
; 2 ; 2 ;
+--------+-------+
+---------------------------------+
; Non-Global High Fan-Out Signals ;
+-------------------+-------------+
; Name ; Fan-Out ;
+-------------------+-------------+
; count2[1]~44 ; 21 ;
; count2[0]~45 ; 21 ;
; remainder[7]~2135 ; 9 ;
; finish~2 ; 8 ;
; remainder[6]~2134 ; 6 ;
; remainder[5]~2133 ; 6 ;
; remainder[4]~2141 ; 5 ;
; reduce_nor~43 ; 5 ;
; remainder[0]~2129 ; 4 ;
; remainder[3]~2132 ; 4 ;
; drreg[2]~12 ; 4 ;
; remainder~2140 ; 4 ;
; remainder[1]~2130 ; 4 ;
; remainder[2]~2131 ; 4 ;
; count[0]~19 ; 4 ;
; remainder~2142 ; 3 ;
; remainder[8]~2136 ; 3 ;
; count[1]~18 ; 3 ;
; drreg[0]~9 ; 2 ;
; reduce_nor~42 ; 2 ;
; carries[0]~361 ; 2 ;
; tcbuffout[1]~56 ; 2 ;
; tcbuffout[2]~55 ; 2 ;
; carries[1]~362 ; 2 ;
; drreg[3]~11 ; 1 ;
; adderout[3]~356 ; 1 ;
; dividend[3] ; 1 ;
; drreg[1]~10 ; 1 ;
; divisor[2] ; 1 ;
; remainder~2150 ; 1 ;
; drreg[2]~8 ; 1 ;
; dividend[0] ; 1 ;
; adderout[3]~355 ; 1 ;
; dividend[1] ; 1 ;
; quotient~47 ; 1 ;
; remainder~2146 ; 1 ;
; divisor[0] ; 1 ;
; remainder_r~31 ; 1 ;
; remainder_r~30 ; 1 ;
; divisor[1] ; 1 ;
; remainder~2137 ; 1 ;
; remainder~2139 ; 1 ;
; remainder_r~32 ; 1 ;
; quotient~48 ; 1 ;
; remainder~2144 ; 1 ;
; remainder~2138 ; 1 ;
; remainder~2147 ; 1 ;
; divisor[3] ; 1 ;
; remainder~2149 ; 1 ;
; add_op~31 ; 1 ;
+-------------------+-------------+
+-------------------------------------------+
; LAB ;
+--------------------------+----------------+
; Number of Logic Elements ; Number of LABs ;
+--------------------------+----------------+
; 0 ; 617 ;
; 1 ; 0 ;
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