📄 counter.fit.rpt
字号:
; H2 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 5 ; 8 ; 0 ; 0 ; 0 ;
; I1 ; 14 / 160 ( 8 % ) ; 5 ; 0 ; 3 ; 1 ; 1 ; 2 ; 8 ; 20 ; 7 ; 1 ;
; I2 ; 0 / 160 ( 0 % ) ; 1 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ;
; J1 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; J2 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; K1 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; K2 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; L1 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; L2 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ;
; M1 ; 0 / 160 ( 0 % ) ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ;
; M2 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; N1 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; N2 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; O1 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; O2 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; P1 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; P2 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; Q1 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; Q2 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; R1 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; R2 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; S1 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; S2 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; T1 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; T2 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; U1 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; U2 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; V1 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; V2 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; W1 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; W2 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; X1 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; X2 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; Y1 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; Y2 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; Z1 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; Z2 ; 0 / 160 ( 0 % ) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
+--------------+-------------------+----------------------+-------------------------------------+--------------------------------------+----------------------------------+-----------------------------------+--------+---------+--------------------+---------------------------+-----------------+
+-------------------------------------------------------------------------------+
; Row Interconnect ;
+-------+------------------------+---------------------+------------------------+
; Row ; Interconnect Available ; Interconnect Used ; Half Interconnect Used ;
+-------+------------------------+---------------------+------------------------+
; A ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; B ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; C ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; D ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; E ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; F ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; G ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; H ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; I ; 100 ; 2 / 100 ( 2 % ) ; 0 / 200 ( 0 % ) ;
; J ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; K ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; L ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; M ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; N ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; O ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; P ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; Q ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; R ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; S ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; T ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; U ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; V ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; W ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; X ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; Y ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; Z ; 100 ; 0 / 100 ( 0 % ) ; 0 / 200 ( 0 % ) ;
; Total ; 2600 ; 2 / 2600 ( < 1 % ) ; 0 / 5200 ( 0 % ) ;
+-------+------------------------+---------------------+------------------------+
+-------------------------------------------------------------------------------------------+
; LAB Column Interconnect ;
+--------------+------+------------------------+-------------------+------------------------+
; MegaLAB Col. ; Col. ; Interconnect Available ; Interconnect Used ; Half Interconnect Used ;
+--------------+------+------------------------+-------------------+------------------------+
; 1 ; 1 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 1 ; 2 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 1 ; 3 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 1 ; 4 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 1 ; 5 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 1 ; 6 ; 80 ; 0 / 80 ( 0 % ) ; 3 / 160 ( 1 % ) ;
; 1 ; 7 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 1 ; 8 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 1 ; 9 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 1 ; 10 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 1 ; 11 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 1 ; 12 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 1 ; 13 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 1 ; 14 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 1 ; 15 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 1 ; 16 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 1 ; 17 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 2 ; 1 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 2 ; 2 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 2 ; 3 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 2 ; 4 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 2 ; 5 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 2 ; 6 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 2 ; 7 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 2 ; 8 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 2 ; 9 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 2 ; 10 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 2 ; 11 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 2 ; 12 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 2 ; 13 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 2 ; 14 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 2 ; 15 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 2 ; 16 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 2 ; 17 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; Total ; ; 2720 ; 0 / 2720 ( 0 % ) ; 3 / 5440 ( < 1 % ) ;
+--------------+------+------------------------+-------------------+------------------------+
+-----------------------------------------------------------------------------+
; ESB Column Interconnect ;
+-------+------------------------+-------------------+------------------------+
; Col. ; Interconnect Available ; Interconnect Used ; Half Interconnect Used ;
+-------+------------------------+-------------------+------------------------+
; 0 ; 128 ; 0 / 128 ( 0 % ) ; 0 / 256 ( 0 % ) ;
; 1 ; 128 ; 0 / 128 ( 0 % ) ; 0 / 256 ( 0 % ) ;
; Total ; 256 ; 0 / 256 ( 0 % ) ; 0 / 512 ( 0 % ) ;
+-------+------------------------+-------------------+------------------------+
+-------------------------------------------------------+
; Fitter Resource Usage Summary ;
+--------------------------------+----------------------+
; Resource ; Usage ;
+--------------------------------+----------------------+
; Logic cells ; 14 / 8,320 ( < 1 % ) ;
; Registers ; 8 / 8,320 ( < 1 % ) ;
; Logic elements in carry chains ; 0 ;
; User inserted logic cells ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 10 / 376 ( 2 % ) ;
; -- Clock pins ; 0 / 4 ( 0 % ) ;
; -- Dedicated input pins ; 0 / 4 ( 0 % ) ;
; Global signals ; 1 ;
; ESBs ; 0 / 52 ( 0 % ) ;
; Macrocells ; 0 / 832 ( 0 % ) ;
; ESB pterm bits used ; 0 / 106,496 ( 0 % ) ;
; ESB CAM bits used ; 0 / 106,496 ( 0 % ) ;
; Total memory bits ; 0 / 106,496 ( 0 % ) ;
; Total RAM block bits ; 0 / 106,496 ( 0 % ) ;
; FastRow interconnects ; 0 / 120 ( 0 % ) ;
; PLLs ; 0 / 2 ( 0 % ) ;
; Maximum fan-out node ; counter_clear ;
; Maximum fan-out ; 8 ;
; Total fan-out ; 68 ;
; Average fan-out ; 2.83 ;
+--------------------------------+----------------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+----------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+---------------------+
; Compilation Hierarchy Node ; Logic Cells ; LC Registers ; Memory Bits ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Full Hierarchy Name ;
+----------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+---------------------+
; |counter ; 14 (14) ; 8 ; 0 ; 10 ; 0 ; 6 (6) ; 0 (0) ; 8 (8) ; 0 (0) ; |counter ;
+----------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+---------------------+
+----------------------------------------------------------------------------------------------------------------------+
; Delay Chain Summary ;
+---------------+----------+-------------+-----------------------+-------------------------+---------------------+-----+
; Name ; Pin Type ; Pad to Core ; Pad to Input Register ; Core to Output Register ; Core to CE Register ; TCO ;
+---------------+----------+-------------+-----------------------+-------------------------+---------------------+-----+
; counter_clear ; Input ; ON ; OFF ; OFF ; OFF ; OFF ;
; clk ; Input ; OFF ; OFF ; OFF ; OFF ; OFF ;
; dout1[3] ; Output ; OFF ; OFF ; OFF ; OFF ; OFF ;
; dout1[2] ; Output ; OFF ; OFF ; OFF ; OFF ; OFF ;
; dout1[1] ; Output ; OFF ; OFF ; OFF ; OFF ; OFF ;
; dout1[0] ; Output ; OFF ; OFF ; OFF ; OFF ; OFF ;
; dout10[3] ; Output ; OFF ; OFF ; OFF ; OFF ; OFF ;
; dout10[2] ; Output ; OFF ; OFF ; OFF ; OFF ; OFF ;
; dout10[1] ; Output ; OFF ; OFF ; OFF ; OFF ; OFF ;
; dout10[0] ; Output ; OFF ; OFF ; OFF ; OFF ; OFF ;
+---------------+----------+-------------+-----------------------+-------------------------+---------------------+-----+
+----------------------------+
; I/O Bank Usage ;
+----------+-----------------+
; I/O Bank ; Usage ;
+----------+-----------------+
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