📄 mcs_51.fit.rpt
字号:
; 30 ; GND* ; ;
; 31 ; P0[6] ; LVTTL/LVCMOS ;
; 32 ; DATAOUT1[1] ; LVTTL/LVCMOS ;
; 33 ; GND* ; ;
; 34 ; #TMS ; ;
; 35 ; ^nSTATUS ; ;
; 36 ; GND* ; ;
; 37 ; GND* ; ;
; 38 ; GND* ; ;
; 39 ; GND* ; ;
; 40 ; GND_INT ; ;
; 41 ; WR ; LVTTL/LVCMOS ;
; 42 ; DATAOUT2[0] ; LVTTL/LVCMOS ;
; 43 ; GND* ; ;
; 44 ; P2[5] ; LVTTL/LVCMOS ;
; 45 ; VCC_IO ; ;
; 46 ; DATAOUT2[1] ; LVTTL/LVCMOS ;
; 47 ; DATAOUT1[2] ; LVTTL/LVCMOS ;
; 48 ; GND* ; ;
; 49 ; GND* ; ;
; 50 ; VCC_INT ; ;
; 51 ; GND* ; ;
; 52 ; GND_INT ; ;
; 53 ; VCC_CKLK ; ;
; 54 ; P2[6] ; LVTTL/LVCMOS ;
; 55 ; ALE ; LVTTL/LVCMOS ;
; 56 ; P2[7] ; LVTTL/LVCMOS ;
; 57 ; GND_CKLK ; ;
; 58 ; GND_INT ; ;
; 59 ; GND* ; ;
; 60 ; GND* ; ;
; 61 ; VCC_IO ; ;
; 62 ; GND* ; ;
; 63 ; GND* ; ;
; 64 ; GND* ; ;
; 65 ; GND* ; ;
; 66 ; GND_INT ; ;
; 67 ; P2[0] ; LVTTL/LVCMOS ;
; 68 ; GND* ; ;
; 69 ; GND* ; ;
; 70 ; GND* ; ;
; 71 ; VCC_IO ; ;
; 72 ; GND* ; ;
; 73 ; GND* ; ;
; 74 ; ^nCONFIG ; ;
; 75 ; VCC_INT ; ;
; 76 ; ^MSEL1 ; ;
; 77 ; ^MSEL0 ; ;
; 78 ; GND* ; ;
; 79 ; GND* ; ;
; 80 ; DATAIN1[5] ; LVTTL/LVCMOS ;
; 81 ; P0[5] ; LVTTL/LVCMOS ;
; 82 ; DATAIN1[6] ; LVTTL/LVCMOS ;
; 83 ; GND* ; ;
; 84 ; GND_INT ; ;
; 85 ; VCC_INT ; ;
; 86 ; DATAIN1[0] ; LVTTL/LVCMOS ;
; 87 ; DATAIN1[4] ; LVTTL/LVCMOS ;
; 88 ; DATAOUT1[3] ; LVTTL/LVCMOS ;
; 89 ; DATAIN1[3] ; LVTTL/LVCMOS ;
; 90 ; DATAIN1[1] ; LVTTL/LVCMOS ;
; 91 ; DATAIN1[2] ; LVTTL/LVCMOS ;
; 92 ; GND* ; ;
; 93 ; GND_INT ; ;
; 94 ; VCC_IO ; ;
; 95 ; AD_CS ; LVTTL/LVCMOS ;
; 96 ; DATAOUT2[2] ; LVTTL/LVCMOS ;
; 97 ; DATAOUT1[6] ; LVTTL/LVCMOS ;
; 98 ; GND* ; ;
; 99 ; GND* ; ;
; 100 ; GND* ; ;
; 101 ; GND* ; ;
; 102 ; DATAIN1[7] ; LVTTL/LVCMOS ;
; 103 ; VCC_INT ; ;
; 104 ; GND_INT ; ;
; 105 ; #TDI ; ;
; 106 ; ^nCE ; ;
; 107 ; ^DCLK ; ;
; 108 ; ^DATA0 ; ;
; 109 ; GND* ; ;
; 110 ; GND* ; ;
; 111 ; P2[2] ; LVTTL/LVCMOS ;
; 112 ; DATAOUT1[5] ; LVTTL/LVCMOS ;
; 113 ; GND* ; ;
; 114 ; GND* ; ;
; 115 ; VCC_IO ; ;
; 116 ; GND* ; ;
; 117 ; P2[3] ; LVTTL/LVCMOS ;
; 118 ; GND* ; ;
; 119 ; GND* ; ;
; 120 ; P2[1] ; LVTTL/LVCMOS ;
; 121 ; GND* ; ;
; 122 ; GND* ; ;
; 123 ; GND_INT ; ;
; 124 ; P2[4] ; LVTTL/LVCMOS ;
; 125 ; LATCH1 ; LVTTL/LVCMOS ;
; 126 ; GND+ ; ;
; 127 ; VCC_INT ; ;
; 128 ; GND* ; ;
; 129 ; GND_INT ; ;
; 130 ; GND* ; ;
; 131 ; GND* ; ;
; 132 ; GND* ; ;
; 133 ; DATAOUT2[3] ; LVTTL/LVCMOS ;
; 134 ; VCC_IO ; ;
; 135 ; RD ; LVTTL/LVCMOS ;
; 136 ; GND* ; ;
; 137 ; GND* ; ;
; 138 ; GND* ; ;
; 139 ; GND_INT ; ;
; 140 ; GND* ; ;
; 141 ; GND* ; ;
; 142 ; GND* ; ;
; 143 ; GND* ; ;
; 144 ; READY ; LVTTL/LVCMOS ;
+-------+-------------+--------------+
+-----------------------------------------------------------------------------+
; Control Signals ;
+--------------------------+---------+---------+---------------+--------------+
; Name ; Pin # ; Fan-Out ; Usage ; Global Usage ;
+--------------------------+---------+---------+---------------+--------------+
; mcs_51:inst|process5~2 ; LC1_C25 ; 8 ; Output enable ; Non-global ;
; ALE ; 55 ; 8 ; Clock ; Pin ;
; mcs_51:inst|WR_ENABLE1~0 ; LC1_C26 ; 8 ; Clock ; Internal ;
; LATCH1 ; 125 ; 8 ; Clock ; Pin ;
; mcs_51:inst|WR_ENABLE2~0 ; LC1_C24 ; 8 ; Clock ; Non-global ;
+--------------------------+---------+---------+---------------+--------------+
+-------------------------------------------------------+
; Global & Other Fast Signals ;
+--------------------------+---------+---------+--------+
; Name ; Pin # ; Fan-Out ; Global ;
+--------------------------+---------+---------+--------+
; ALE ; 55 ; 8 ; yes ;
; P2[4] ; 124 ; 2 ; no ;
; P2[6] ; 54 ; 2 ; no ;
; P2[7] ; 56 ; 2 ; no ;
; mcs_51:inst|WR_ENABLE1~0 ; LC1_C26 ; 8 ; yes ;
; LATCH1 ; 125 ; 8 ; yes ;
+--------------------------+---------+---------+--------+
+---------------------------------------+
; Non-Global High Fan-Out Signals ;
+-----------------------------+---------+
; Name ; Fan-Out ;
+-----------------------------+---------+
; mcs_51:inst|process5~2 ; 8 ;
; mcs_51:inst|WR_ENABLE2~0 ; 8 ;
; P0[4] ; 3 ;
; P0[3] ; 3 ;
; P0[0] ; 3 ;
; P0[1] ; 3 ;
; P0[2] ; 3 ;
; P0[5] ; 3 ;
; P0[6] ; 3 ;
; P0[7] ; 3 ;
; mcs_51:inst|LATCH_ADDRES[1] ; 3 ;
; mcs_51:inst|LATCH_ADDRES[2] ; 3 ;
; mcs_51:inst|LATCH_ADDRES[5] ; 2 ;
; mcs_51:inst|LATCH_ADDRES[6] ; 2 ;
; P2[5] ; 2 ;
; mcs_51:inst|WR_ENABLE1~65 ; 2 ;
; P2[7] ; 2 ;
; mcs_51:inst|process5~122 ; 2 ;
; mcs_51:inst|LATCH_ADDRES[7] ; 2 ;
; P2[6] ; 2 ;
; mcs_51:inst|process5~123 ; 2 ;
; mcs_51:inst|LATCH_ADDRES[0] ; 2 ;
; P2[4] ; 2 ;
; mcs_51:inst|LATCH_ADDRES[4] ; 2 ;
; mcs_51:inst|LATCH_ADDRES[3] ; 2 ;
; mcs_51:inst|process5~120 ; 2 ;
; mcs_51:inst|LATCH_OUT2[2] ; 1 ;
; DATAIN1[5] ; 1 ;
; DATAIN1[2] ; 1 ;
; mcs_51:inst|LATCH_OUT2[3] ; 1 ;
; RD ; 1 ;
; DATAIN1[7] ; 1 ;
; mcs_51:inst|WR_ENABLE1~63 ; 1 ;
; P2[3] ; 1 ;
; mcs_51:inst|LATCH_IN1[0] ; 1 ;
; mcs_51:inst|LATCH_IN1[7] ; 1 ;
; mcs_51:inst|LATCH_IN1[1] ; 1 ;
; mcs_51:inst|process5~121 ; 1 ;
; mcs_51:inst|LATCH_IN1[2] ; 1 ;
; mcs_51:inst|LATCH_OUT1[0] ; 1 ;
; mcs_51:inst|LATCH_IN1[3] ; 1 ;
; P2[0] ; 1 ;
; mcs_51:inst|AD_CS ; 1 ;
; mcs_51:inst|LATCH_OUT2[1] ; 1 ;
; mcs_51:inst|LATCH_IN1[6] ; 1 ;
; mcs_51:inst|LATCH_IN1[5] ; 1 ;
; mcs_51:inst|LATCH_OUT1[2] ; 1 ;
; mcs_51:inst|process5~124 ; 1 ;
; DATAIN1[1] ; 1 ;
; mcs_51:inst|LATCH_OUT2[4] ; 1 ;
+-----------------------------+---------+
+-------------------------------------------------------------------------------------------------------------+
; Peripheral Signals ;
+--------------------------+---------+---------------+-----------------+---------------------------+----------+
; Peripheral Signal ; Source ; Usage ; Dedicated Clock ; Peripheral Control Signal ; Polarity ;
+--------------------------+---------+---------------+-----------------+---------------------------+----------+
; mcs_51:inst|process5~2 ; LC1_C25 ; Output enable ; no ; yes ; +ve ;
; mcs_51:inst|WR_ENABLE1~0 ; LC1_C26 ; Clock ; no ; yes ; +ve ;
+--------------------------+---------+---------------+-----------------+---------------------------+----------+
+-------------------------------------------+
; LAB ;
+--------------------------+----------------+
; Number of Logic Elements ; Number of LABs ;
+--------------------------+----------------+
; 0 ; 196 ;
; 1 ; 15 ;
; 2 ; 1 ;
; 3 ; 0 ;
; 4 ; 0 ;
; 5 ; 1 ;
; 6 ; 0 ;
; 7 ; 1 ;
; 8 ; 2 ;
+--------------------------+----------------+
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