📄 key_scan.fit.rpt
字号:
; DATAOUT4[1] ; 23 ; B ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
; DATAOUT4[0] ; 36 ; -- ; 24 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
; scan[3] ; 78 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
; scan[2] ; 80 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
; scan[1] ; 83 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
; scan[0] ; 81 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
; P07 ; 98 ; A ; -- ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
; P06 ; 112 ; -- ; 3 ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
; P05 ; 117 ; -- ; 6 ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
; P04 ; 72 ; -- ; 4 ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
; P03 ; 120 ; -- ; 9 ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
; P02 ; 30 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
; P01 ; 95 ; A ; -- ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
; P00 ; 116 ; -- ; 5 ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
+-------------+-------+-----+------+--------------+--------------------------+---------------+----------------+---------------+---------------+------------+---------------+--------------+
+------------------------------------+
; All Package Pins ;
+-------+-------------+--------------+
; Pin # ; Usage ; I/O Standard ;
+-------+-------------+--------------+
; 1 ; #TCK ; ;
; 2 ; ^CONF_DONE ; ;
; 3 ; ^nCEO ; ;
; 4 ; #TDO ; ;
; 5 ; VCC_IO ; ;
; 6 ; VCC_INT ; ;
; 7 ; DATAOUT3[1] ; TTL ;
; 8 ; DATAOUT1[5] ; TTL ;
; 9 ; GND* ; ;
; 10 ; GND* ; ;
; 11 ; DATAOUT4[7] ; TTL ;
; 12 ; GND* ; ;
; 13 ; GND* ; ;
; 14 ; GND* ; ;
; 15 ; GND_IO ; ;
; 16 ; GND_INT ; ;
; 17 ; p5 ; TTL ;
; 18 ; GND* ; ;
; 19 ; DATAOUT1[3] ; TTL ;
; 20 ; DATAOUT2[3] ; TTL ;
; 21 ; DATAOUT3[6] ; TTL ;
; 22 ; DATAOUT2[1] ; TTL ;
; 23 ; DATAOUT4[1] ; TTL ;
; 24 ; VCC_IO ; ;
; 25 ; VCC_INT ; ;
; 26 ; GND* ; ;
; 27 ; DATAOUT1[7] ; TTL ;
; 28 ; GND* ; ;
; 29 ; GND* ; ;
; 30 ; P02 ; TTL ;
; 31 ; GND* ; ;
; 32 ; GND* ; ;
; 33 ; GND* ; ;
; 34 ; #TMS ; ;
; 35 ; ^nSTATUS ; ;
; 36 ; DATAOUT4[0] ; TTL ;
; 37 ; DATAOUT4[3] ; TTL ;
; 38 ; GND* ; ;
; 39 ; GND* ; ;
; 40 ; GND_IO ; ;
; 41 ; DATAOUT2[6] ; TTL ;
; 42 ; DATAOUT3[7] ; TTL ;
; 43 ; GND* ; ;
; 44 ; kin[1] ; TTL ;
; 45 ; VCC_IO ; ;
; 46 ; GND* ; ;
; 47 ; p0 ; TTL ;
; 48 ; GND* ; ;
; 49 ; GND* ; ;
; 50 ; GND_IO ; ;
; 51 ; p3 ; TTL ;
; 52 ; VCC_INT ; ;
; 53 ; VCC_INT ; ;
; 54 ; p7 ; TTL ;
; 55 ; WR ; TTL ;
; 56 ; p6 ; TTL ;
; 57 ; GND_INT ; ;
; 58 ; GND_INT ; ;
; 59 ; DATAOUT2[4] ; TTL ;
; 60 ; GND* ; ;
; 61 ; VCC_IO ; ;
; 62 ; DATAOUT4[2] ; TTL ;
; 63 ; DATAOUT1[4] ; TTL ;
; 64 ; GND* ; ;
; 65 ; GND* ; ;
; 66 ; GND_IO ; ;
; 67 ; GND* ; ;
; 68 ; kin[3] ; TTL ;
; 69 ; GND* ; ;
; 70 ; p4 ; TTL ;
; 71 ; VCC_IO ; ;
; 72 ; P04 ; TTL ;
; 73 ; DATAOUT1[1] ; TTL ;
; 74 ; ^nCONFIG ; ;
; 75 ; VCC_INT ; ;
; 76 ; ^MSEL1 ; ;
; 77 ; ^MSEL0 ; ;
; 78 ; scan[3] ; TTL ;
; 79 ; GND* ; ;
; 80 ; scan[2] ; TTL ;
; 81 ; scan[0] ; TTL ;
; 82 ; GND* ; ;
; 83 ; scan[1] ; TTL ;
; 84 ; GND_INT ; ;
; 85 ; GND_IO ; ;
; 86 ; DATAOUT4[5] ; TTL ;
; 87 ; DATAOUT2[2] ; TTL ;
; 88 ; DATAOUT3[5] ; TTL ;
; 89 ; DATAOUT4[4] ; TTL ;
; 90 ; DATAOUT2[5] ; TTL ;
; 91 ; GND* ; ;
; 92 ; p1 ; TTL ;
; 93 ; VCC_INT ; ;
; 94 ; VCC_IO ; ;
; 95 ; P01 ; TTL ;
; 96 ; kin[0] ; TTL ;
; 97 ; DATAOUT3[2] ; TTL ;
; 98 ; P07 ; TTL ;
; 99 ; kin[2] ; TTL ;
; 100 ; GND* ; ;
; 101 ; GND* ; ;
; 102 ; DATAOUT1[2] ; TTL ;
; 103 ; GND_INT ; ;
; 104 ; GND_IO ; ;
; 105 ; #TDI ; ;
; 106 ; ^nCE ; ;
; 107 ; ^DCLK ; ;
; 108 ; ^DATA0 ; ;
; 109 ; GND* ; ;
; 110 ; GND* ; ;
; 111 ; p2 ; TTL ;
; 112 ; P06 ; TTL ;
; 113 ; GND* ; ;
; 114 ; GND* ; ;
; 115 ; VCC_IO ; ;
; 116 ; P00 ; TTL ;
; 117 ; P05 ; TTL ;
; 118 ; GND* ; ;
; 119 ; DATAOUT1[0] ; TTL ;
; 120 ; P03 ; TTL ;
; 121 ; GND* ; ;
; 122 ; DATAOUT3[4] ; TTL ;
; 123 ; VCC_INT ; ;
; 124 ; GND+ ; ;
; 125 ; clock ; TTL ;
; 126 ; ALE ; TTL ;
; 127 ; GND_INT ; ;
; 128 ; GND* ; ;
; 129 ; GND_IO ; ;
; 130 ; GND* ; ;
; 131 ; GND* ; ;
; 132 ; GND* ; ;
; 133 ; GND* ; ;
; 134 ; VCC_IO ; ;
; 135 ; GND* ; ;
; 136 ; DATAOUT4[6] ; TTL ;
; 137 ; DATAOUT1[6] ; TTL ;
; 138 ; DATAOUT2[7] ; TTL ;
; 139 ; GND_IO ; ;
; 140 ; GND* ; ;
; 141 ; GND* ; ;
; 142 ; DATAOUT3[3] ; TTL ;
; 143 ; DATAOUT3[0] ; TTL ;
; 144 ; DATAOUT2[0] ; TTL ;
+-------+-------------+--------------+
+---------------------------------------------------------------------------------+
; Control Signals ;
+-------------------------------+---------+---------+--------------+--------------+
; Name ; Pin # ; Fan-Out ; Usage ; Global Usage ;
+-------------------------------+---------+---------+--------------+--------------+
; WR ; 55 ; 32 ; Clock ; Pin ;
; ALE ; 126 ; 8 ; Clock ; Pin ;
; clock ; 125 ; 15 ; Clock ; Pin ;
; Keyboard:inst|Clock_1[14] ; LC1_C16 ; 8 ; Clock ; Internal ;
; FPGA_S51_0:inst5|reduce_nor~0 ; LC5_B2 ; 8 ; Clock enable ; Non-global ;
; FPGA_S51_0:inst5|reduce_nor~3 ; LC6_B2 ; 8 ; Clock enable ; Non-global ;
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