step_motor.tan.rpt
来自「步进电机控制器,控制电机的VHDL源程序」· RPT 代码 · 共 304 行 · 第 1/5 页
RPT
304 行
; N/A ; 32.26 MHz ( period = 31.000 ns ) ; comp[6] ; lpm_counter:d_ff_rtl_0|dffs[11] ; f ; f ; None ; None ; 17.000 ns ;
; N/A ; 32.26 MHz ( period = 31.000 ns ) ; comp[0] ; lpm_counter:d_ff_rtl_0|dffs[11] ; f ; f ; None ; None ; 17.000 ns ;
; N/A ; 32.26 MHz ( period = 31.000 ns ) ; comp[10] ; lpm_counter:d_ff_rtl_0|dffs[11] ; f ; f ; None ; None ; 17.000 ns ;
; N/A ; 32.26 MHz ( period = 31.000 ns ) ; comp[9] ; lpm_counter:d_ff_rtl_0|dffs[11] ; f ; f ; None ; None ; 17.000 ns ;
; N/A ; 32.26 MHz ( period = 31.000 ns ) ; comp[7] ; lpm_counter:d_ff_rtl_0|dffs[11] ; f ; f ; None ; None ; 17.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[5] ; lpm_counter:d_ff_rtl_0|dffs[3] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[4] ; lpm_counter:d_ff_rtl_0|dffs[3] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[3] ; lpm_counter:d_ff_rtl_0|dffs[3] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[2] ; lpm_counter:d_ff_rtl_0|dffs[3] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[1] ; lpm_counter:d_ff_rtl_0|dffs[3] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[5] ; lpm_counter:d_ff_rtl_0|dffs[4] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[4] ; lpm_counter:d_ff_rtl_0|dffs[4] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[3] ; lpm_counter:d_ff_rtl_0|dffs[4] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[2] ; lpm_counter:d_ff_rtl_0|dffs[4] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[1] ; lpm_counter:d_ff_rtl_0|dffs[4] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[5] ; lpm_counter:d_ff_rtl_0|dffs[5] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[4] ; lpm_counter:d_ff_rtl_0|dffs[5] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[3] ; lpm_counter:d_ff_rtl_0|dffs[5] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[2] ; lpm_counter:d_ff_rtl_0|dffs[5] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[1] ; lpm_counter:d_ff_rtl_0|dffs[5] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[5] ; lpm_counter:d_ff_rtl_0|dffs[6] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[4] ; lpm_counter:d_ff_rtl_0|dffs[6] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[3] ; lpm_counter:d_ff_rtl_0|dffs[6] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[2] ; lpm_counter:d_ff_rtl_0|dffs[6] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[1] ; lpm_counter:d_ff_rtl_0|dffs[6] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[5] ; lpm_counter:d_ff_rtl_0|dffs[7] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[4] ; lpm_counter:d_ff_rtl_0|dffs[7] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[3] ; lpm_counter:d_ff_rtl_0|dffs[7] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[2] ; lpm_counter:d_ff_rtl_0|dffs[7] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[1] ; lpm_counter:d_ff_rtl_0|dffs[7] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[5] ; lpm_counter:d_ff_rtl_0|dffs[8] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[4] ; lpm_counter:d_ff_rtl_0|dffs[8] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[3] ; lpm_counter:d_ff_rtl_0|dffs[8] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[2] ; lpm_counter:d_ff_rtl_0|dffs[8] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[1] ; lpm_counter:d_ff_rtl_0|dffs[8] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[5] ; lpm_counter:d_ff_rtl_0|dffs[9] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[4] ; lpm_counter:d_ff_rtl_0|dffs[9] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[3] ; lpm_counter:d_ff_rtl_0|dffs[9] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[2] ; lpm_counter:d_ff_rtl_0|dffs[9] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[1] ; lpm_counter:d_ff_rtl_0|dffs[9] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[5] ; lpm_counter:d_ff_rtl_0|dffs[10] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[4] ; lpm_counter:d_ff_rtl_0|dffs[10] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[3] ; lpm_counter:d_ff_rtl_0|dffs[10] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[2] ; lpm_counter:d_ff_rtl_0|dffs[10] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[1] ; lpm_counter:d_ff_rtl_0|dffs[10] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[5] ; lpm_counter:d_ff_rtl_0|dffs[11] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[4] ; lpm_counter:d_ff_rtl_0|dffs[11] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[3] ; lpm_counter:d_ff_rtl_0|dffs[11] ; f ; f ; None ; None ; 25.000 ns ;
; N/A ; 33.33 MHz ( period = 30.000 ns ) ; lpm_counter:d_ff_rtl_0|dffs[2] ; lpm_counter:d_ff_rtl_0|dffs[11] ; f ; f ; None ; None ; 25.000 ns ;
; Timing analysis restricted to 200 rows. ; To change the limit use Settings (Assignments menu) ; ; ; ; ; ; ; ;
+-----------------------------------------+-----------------------------------------------------+--------------------------------+---------------------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Hold: 'f' ;
+------------------------------------------+-----------+-------------+------------+----------+----------------------------+----------------------------+--------------------------+
; Minimum Slack ; From ; To ; From Clock ; To Clock ; Required Hold Relationship ; Required Shortest P2P Time ; Actual Shortest P2P Time ;
+------------------------------------------+-----------+-------------+------------+----------+----------------------------+----------------------------+--------------------------+
; Not operational: Clock Skew > Data Delay ; DIRECTION ; ind_coil[3] ; f ; f ; None ; None ; 8.000 ns ;
; Not operational: Clock Skew > Data Delay ; PHASE ; ind_coil[3] ; f ; f ; None ; None ; 8.000 n
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