本文系统分析了Turbo 乘积码的原理及性能,详细讨论了各种因素对TPC译码性能的影响,提出了一种适合在FPGA中全数字实现的串行迭代译码算法,然后根据FPC编译码算法,采用Verilog硬件描述语言在FPGA中完成了TPC编译码器的设计、综合和仿真验证。最后在实际的数字接收机中进行了实验测试。实验测试结果表明,本文设计的编译码器能够完成码率高达10Mbps信号的实时TPc编译码,在误码率为10
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