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利用CPLD对输入信号测量幅度
利用CPLD对输入信号测量幅度
VHDL/FPGA/Verilog
2 K
155 次下载
2017-09-11
资源详细信息
文件格式
RAR
文件大小
2 K
资源分类
VHDL/FPGA/Verilog
上传者
wangshengzaishi
发布时间
2017-09-11 20:30
下载统计
155
次
所需积分
2 积分
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利用CPLD对输入信号测量幅度,保存数值
利用CPLD对输入信号测量幅度 - 源码文件列表
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1
voltage_measure.vhd
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