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VHDL/FPGA/Verilog资源 文件大小：124 K

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文件格式
RAR
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VHDL/FPGA/Verilog
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VHDL实现 SPWM 通过ADC1407转换实现变频控制和变幅控制； 通过LCD1602实现频率和调制比显示

源码文件列表

📂 共 14 个源码文件 点击文件名可在线查看源代码

1 📄
spwm_adc_lcd.ise
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2 📄
spwm.vhd
大小: 2.88 KB
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3 📄
spwm_adc_lcd.ucf
大小: 1.37 KB
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4 📄
divhz.vhd
大小: 1.45 KB
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5 📄
adc.vhd
大小: 4.73 KB
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6 📄
zxianbo.vhd
大小: 28.02 KB
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7 📄
lcd.vhd
大小: 8.77 KB
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8 📄
spwm_adc_lcd.vhd
大小: 3.8 KB
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9 📄
mem.vhd
大小: 24.1 KB
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10 📄
spwm_adc_lcd_tb.vhd
大小: 3.63 KB
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11 📄
spwm_adc_lcd.bit
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12 📄
comp.vhd
大小: 2.17 KB
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13 📄
adc_hz.vhd
大小: 2.38 KB
查看源码
14 📄
sanjiaobo.vhd
大小: 2.59 KB
查看源码
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