一个verilog源代码，可用ISE等实现，功能为I2C接口标准建模。
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1
FILE
_primary.vhd
272 B
包内组件
2
FILE
hdllib.ref
39 B
包内组件
3
FILE
adder_ncdtout_tcl.rsp
18 B
包内组件
4
FILE
adder.xst
980 B
包内组件
5
FILE
runxst_tcl.rsp
33 B
包内组件
6
FILE
adder_flowplus.gfl
107 B
包内组件
7
FILE
nc1toncd_tcl.rsp
12 B
包内组件
8
FILE
edntongd_tcl.rsp
56 B
包内组件
9
FILE
bitgen.rsp
518 B
包内组件
10
FILE
adder.gfl
1.5 KB
包内组件
11
FILE
parentassignpackagepinsapp_tcl.rsp
18 B
包内组件
12
FILE
_primary.vhd (子目录 #2)
76 B
包内组件