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DDR SDRAM的veilog hdl程序

VHDL/FPGA/Verilog 465 K 116 次下载 2017-08-11

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465 K

资源分类

VHDL/FPGA/Verilog

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发布时间

2017-08-11 10:03

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DDR SDRAM的veilog hdl程序 - 资源详细说明

DDR SDRAM的veilog hdl程序，经过验证效果不错

DDR SDRAM的veilog hdl程序 - 源码文件列表

本资源包含 34 个源码文件支持在线预览，点击文件名即可查看

1

使用说明请参看右侧注释====〉〉.txt

2

mem_interface_top_rd_data_0.txt

3

mem_interface_top_ddr_controller_0.txt

4

mem_interface_top_data_path_0.txt

5

mem_interface_top_v4_dqs_iob.txt

6

mem_interface_top_rd_data_fifo_0.txt

7

mem_interface_top_infrastructure_iobs_0.txt

8

mem_interface_top_main_0.txt

9

mem_interface_top_v4_dm_iob.txt

10

mem_interface_top_pattern_compare8.txt

11

mem_interface_top_data_tap_inc.txt

12

mem_interface_top_backend_rom_0.txt

13

mem_interface_top_rd_wr_addr_fifo_0.txt

14

mem_interface_top_addr_gen_0.txt

15

mem_interface_top_data_gen_16.txt

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