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verilogHDL编写的QPSK选相法调制模块

VHDL/FPGA/Verilog 4853 K 184 次下载 2014-09-11

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RAR

文件大小

4853 K

资源分类

VHDL/FPGA/Verilog

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发布时间

2014-09-11 16:00

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verilogHDL编写的QPSK选相法调制模块 - 资源详细说明

verilogHDL编写的QPSK选相法调制模块，在ISE软件中仿真过，可综合，绝对是正确的

verilogHDL编写的QPSK选相法调制模块 - 源码文件列表

本资源包含 96 个源码文件支持在线预览，点击文件名即可查看

1

m_00000000000866782574_2073120511.c

2

m_00000000000661176848_0609951620.c

3

testt_isim_beh.exe_main.c

4

m_00000000001635180176_2194018704.c

5

testt_isim_beh.exe_lib.c

6

m_00000000001567445528_0076399963.c

7

m_00000000002533748229_1720636399.c

8

m_00000000002427443818_3381044154.c

9

m_00000000003850842932_0592851335.c

10

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11

m_00000000000757852270_0068589415.c

12

m_00000000003085344840_0722107781.c

13

m_00000000003085344840_1221313003.c

14

m_00000000003085344840_2830945601.c

15

m_00000000003085344840_3161674455.c

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