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VHDL/FPGA/Verilog
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用VHDL语言编写的可以实现(7
用VHDL语言编写的可以实现(7
VHDL/FPGA/Verilog
663 K
191 次下载
2017-04-17
资源详细信息
文件格式
压缩包
文件大小
663 K
资源分类
VHDL/FPGA/Verilog
上传者
xukejia
发布时间
2017-04-17 10:27
下载统计
191
次
所需积分
2 积分
用VHDL语言编写的可以实现(7 - 资源详细说明
用VHDL语言编写的可以实现(7,4)汉明码编解码的程序。
用VHDL语言编写的可以实现(7 - 源码文件列表
本资源包含 26 个源码文件
支持在线预览,点击文件名即可查看
1
variable_decoder.eds_overflow
查看源码
2
variable_decoder.cmp.logdb
查看源码
3
variable_decoder.map.qmsg
查看源码
4
variable_decoder.hif
查看源码
5
variable_decoder.fit.qmsg
查看源码
6
variable_decoder.cmp.kpt
查看源码
7
variable_decoder.asm.qmsg
查看源码
8
variable_decoder.sim.qmsg
查看源码
9
variable_decoder.db_info
查看源码
10
wed.zsf
查看源码
11
variable_decoder.sim.vwf
查看源码
12
variable_decoder.map.logdb
查看源码
13
variable_decoder.tan.qmsg
查看源码
14
variable_decoder.eds_overflow
查看源码
15
variable_decoder.cmp.logdb
查看源码
查看完整源码列表 (共 26 个文件) →
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