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VHDL/FPGA/Verilog
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基于FPGA的RS编译码器实现 我是新手 刚学的写的很简单的
基于FPGA的RS编译码器实现 我是新手 刚学的写的很简单的代码
VHDL/FPGA/Verilog
2 K
87 次下载
2014-12-03
资源详细信息
文件格式
RAR
文件大小
2 K
资源分类
VHDL/FPGA/Verilog
上传者
bi_yangfeng
发布时间
2014-12-03 18:34
下载统计
87
次
所需积分
2 积分
基于FPGA的RS编译码器实现 我是新手 刚学的写的很简单的代码 - 资源详细说明
基于FPGA的RS编译码器实现 我是新手 刚学的写的很简单的代码
基于FPGA的RS编译码器实现 我是新手 刚学的写的很简单的代码 - 源码文件列表
本资源包含 6 个源码文件
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1
cycle.v
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2
mult.v
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3
decoder1.v
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4
mult4x4.v
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5
rs(10,8)encode.v
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6
decoder2.v
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