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自己在设计中的总结的设计要点
自己在设计中的总结的设计要点
VHDL/FPGA/Verilog
100 K
52 次下载
2017-01-15
资源详细信息
文件格式
压缩包
文件大小
100 K
资源分类
VHDL/FPGA/Verilog
上传者
captainjn
发布时间
2017-01-15 00:02
下载统计
52
次
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2 积分
自己在设计中的总结的设计要点 - 资源详细说明
自己在设计中的总结的设计要点,其中经历了几个项目,把其中的心得里路在其中,希望对各位同学和同事有帮助
自己在设计中的总结的设计要点 - 源码文件列表
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1
verilog hdl设计的要点.doc
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