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一个完整的viterbi译码程序和测试的程序
一个完整的viterbi译码程序和测试的程序
VHDL/FPGA/Verilog
269 K
177 次下载
2013-12-24
资源详细信息
文件格式
压缩包
文件大小
269 K
资源分类
VHDL/FPGA/Verilog
上传者
shicg666666
发布时间
2013-12-24 11:30
下载统计
177
次
所需积分
2 积分
一个完整的viterbi译码程序和测试的程序 - 资源详细说明
一个完整的viterbi译码程序和测试的程序
一个完整的viterbi译码程序和测试的程序 - 源码文件列表
本资源包含 33 个源码文件
支持在线预览,点击文件名即可查看
1
vi_bench.vhd
查看源码
2
auk_vit_vit_var_enc_arc_rtl.vhd
查看源码
3
vi_interface.vhd
查看源码
4
viterbi_node_sync_testbench.vhd
查看源码
5
bench_vit_par_atl_ent_node_sync.vhd
查看源码
6
bench_vit_par_atl_arc_ben_node_sync.vhd
查看源码
7
vi_functions.vhd
查看源码
8
auk_vit_vit_var_enc_ent.vhd
查看源码
9
ber_threshold.vhd
查看源码
10
a_txsym.txt
查看源码
11
viterbi_ber_bb.v
查看源码
12
viterbi_ber.vhd
查看源码
13
block_period_stim.txt
查看源码
14
viterbi_ber_logiclock_script.tcl
查看源码
15
rotate_node_sync.vhd
查看源码
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