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VHDL/FPGA/Verilog
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利用FPGA实现的脉宽测试技术,基于VHDL,测试误差为时钟
利用FPGA实现的脉宽测试技术,基于VHDL,测试误差为时钟周期
VHDL/FPGA/Verilog
267 K
180 次下载
2014-08-04
资源详细信息
文件格式
RAR
文件大小
267 K
资源分类
VHDL/FPGA/Verilog
上传者
jhjfjh22544
发布时间
2014-08-04 06:59
下载统计
180
次
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2 积分
利用FPGA实现的脉宽测试技术,基于VHDL,测试误差为时钟周期 - 资源详细说明
利用FPGA实现的脉宽测试技术,基于VHDL,测试误差为时钟周期
利用FPGA实现的脉宽测试技术,基于VHDL,测试误差为时钟周期 - 源码文件列表
本资源包含 59 个源码文件
支持在线预览,点击文件名即可查看
1
freq_cnt.map.rpt
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2
freq_cnt.tan.summary
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3
freq_cnt.sim.rpt
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4
freq_cnt.vwf
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5
freq_cnt.map.summary
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6
freq_cnt.tan.rpt
查看源码
7
freq_cnt.pin
查看源码
8
freq_cnt.fit.summary
查看源码
9
freq_cnt.qpf
查看源码
10
freq_cnt.vhd
查看源码
11
freq_cnt.done
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12
freq_cnt.flow.rpt
查看源码
13
freq_cnt.qsf
查看源码
14
freq_cnt.asm.rpt
查看源码
15
freq_cnt.fit.smsg
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