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移位乘法器的输入为两个4位操作数a和b
移位乘法器的输入为两个4位操作数a和b
VHDL/FPGA/Verilog
128 K
78 次下载
2014-01-03
资源详细信息
文件格式
RAR
文件大小
128 K
资源分类
VHDL/FPGA/Verilog
上传者
dingjuan_01
发布时间
2014-01-03 18:37
下载统计
78
次
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2 积分
移位乘法器的输入为两个4位操作数a和b - 资源详细说明
移位乘法器的输入为两个4位操作数a和b,启动乘法器由stb控制,clk信号提供系统定时。乘法器的结果为8位信号result,乘法结束后置信号done为1. 乘法算法采用原码移位乘法,即对两个操作数进行逐位的移位相加,迭代4次后输出结果。具体算法: 1. 被乘数和乘数的高位补0,扩展成8位。 2. 乘法依次向右移位,并检查其最低位,如果为1,则将被乘数和部分和相加,然后将被乘数向左移位;如果为0,则仅仅将被乘数向左移位。移位时,被乘数的低端和乘数的高端均移入0. 3. 当乘数变成全0后,乘法结束。
移位乘法器的输入为两个4位操作数a和b - 源码文件列表
本资源包含 2 个源码文件
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1
mult.vhd
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2
移位乘法器.pdf
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