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VHDL/FPGA/Verilog资源 文件大小：18 K

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文件格式
RAR
所属分类
VHDL/FPGA/Verilog
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18 K
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资源简介

这个文件中使用verilog hdl简单的利用基本运算实现了微型的cpu设计开发过程

源码文件列表

📂 共 17 个源码文件 点击文件名可在线查看源代码

1 📄
sim.do
大小: 69 B
查看源码
2 📄
counter.v
大小: 433 B
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3 📄
defines.v
大小: 402 B
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4 📄
cputest3.dat
大小: 2.43 KB
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5 📄
vlog.args
大小: 125 B
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6 📄
transcript
大小: 2.28 KB
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7 📄
cpu.v
大小: 2.84 KB
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8 📄
memory.v
大小: 294 B
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9 📄
cputest2.dat
大小: 2.04 KB
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10 📄
cputest1.dat
大小: 2.53 KB
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11 📄
alu.v
大小: 636 B
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12 📄
scalable_mux.v
大小: 257 B
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13 📄
vsim.wlf
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14 📄
control.v
大小: 2.19 KB
查看源码
15 📄
clockgen.v
大小: 528 B
查看源码
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