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VHDL/FPGA/Verilog
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一个最大公约数七段显示器编码VHDL代码设计
一个最大公约数七段显示器编码VHDL代码设计
VHDL/FPGA/Verilog
4 K
175 次下载
2014-11-28
资源详细信息
文件格式
RAR
文件大小
4 K
资源分类
VHDL/FPGA/Verilog
上传者
woainijiajia123
发布时间
2014-11-28 18:14
下载统计
175
次
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2 积分
一个最大公约数七段显示器编码VHDL代码设计 - 资源详细说明
一个最大公约数七段显示器编码VHDL代码设计
一个最大公约数七段显示器编码VHDL代码设计 - 源码文件列表
本资源包含 4 个源码文件
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1
readme.txt
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2
63_stim.vhd
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3
63_vhdl.vhd
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4
63_gcd_disp.vhd
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