分布式算法在实现乘加功能时 - 免费下载

VHDL/FPGA/Verilog资源文件大小：1998 K

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VHDL/FPGA/Verilog

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2016-04-06 10:15

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分布式算法在实现乘加功能时，是通过将各输入数据的每一对应位产生的部分积预先进行相加形成相应的部分积，然后再对各个部分积累加形成最终结果的，而传统算法是等到所有乘积已经产生之后再来相加完成乘加运算的。与传统串行算法相比，分布式算法可极大地减少硬件电路的规模，提高电路的执行速度。实现一个FIR滤波器，基于分布式算法输入数据宽度：8位输出数据宽度：16位阶数：16阶滤波器经转换后（右移16位）的特征参数为： h[0]=h[15]=0000 h[1]=h[14]=0065 h[2]=h[13]=018F h[3]=h[12]=035A h[4]=h[11]=0579 h[5]=h[10]=078E h[6]=h[9]=0935 h[7]=h[8]=0A1F

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