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这是一个量化编码当中关于A律和u律压缩和扩展的源程序

VHDL/FPGA/Verilog 62 K 198 次下载 2016-03-06

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文件格式

RAR

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62 K

资源分类

VHDL/FPGA/Verilog

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发布时间

2016-03-06 00:46

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这是一个量化编码当中关于A律和u律压缩和扩展的源程序 - 资源详细说明

这是一个量化编码当中关于A律和u律压缩和扩展的源程序，程序由VerilogHDL语言编写，算法在Modelsim上进行仿真过

这是一个量化编码当中关于A律和u律压缩和扩展的源程序 - 源码文件列表

本资源包含 26 个源码文件支持在线预览，点击文件名即可查看

1

sim_linear2ulaw.v

2

verilog.asm

3

_primary.dat

4

_primary.vhd

5

verilog.asm

6

_primary.dat

7

_primary.vhd

8

_info

9

verilog.asm

10

_primary.dat

11

_primary.vhd

12

verilog.asm

13

_primary.dat

14

_primary.vhd

15

u-law_expansion.cr.mti

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