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VHDL/FPGA/Verilog
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这是quicklogic公司的直接频率合成(DDS)Veri
这是quicklogic公司的直接频率合成(DDS)Verilog代码
VHDL/FPGA/Verilog
23 K
78 次下载
2013-12-19
资源详细信息
文件格式
RAR
文件大小
23 K
资源分类
VHDL/FPGA/Verilog
上传者
LANCEZHANGL
发布时间
2013-12-19 08:36
下载统计
78
次
所需积分
2 积分
这是quicklogic公司的直接频率合成(DDS)Verilog代码 - 资源详细说明
这是quicklogic公司的直接频率合成(DDS)Verilog代码
这是quicklogic公司的直接频率合成(DDS)Verilog代码 - 源码文件列表
本资源包含 18 个源码文件
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1
phasea.v
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2
loadfw.v
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3
pngen.v
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4
transcript
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5
phasemod.v
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6
claadd8s.tre
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7
claadd8s.sch
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8
loadpw.v
查看源码
9
sinlup.v
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10
csac1.sym
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11
ddspa.tf
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12
dds.v
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13
csalowc1.sym
查看源码
14
csalowc1.sch
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15
romtab.v
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