本原代码中利用VHDL语言编写了RAM、FIFO、ROM等常用的存储和缓冲部件 - 免费下载

VHDL/FPGA/Verilog资源文件大小：3 K

📋 资源详细信息

文件格式

RAR

所属分类

VHDL/FPGA/Verilog

上传用户

上传时间

2013-12-07 21:41

文件大小

3 K

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2 积分

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⭐⭐⭐⭐⭐ (5/5)

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资源简介

本原代码中利用VHDL语言编写了RAM、FIFO、ROM等常用的存储和缓冲部件，完全的代码在ALTERA的FPGA上已经通过仿真测试，保证可用.

源码文件列表

📂 共 3 个源码文件点击文件名可在线查看源代码

1 📃

16x8bit ram.txt

大小: 1.33 KB

2 📃

fifo.txt

大小: 2.21 KB

3 📃

通用ram.txt

大小: 1.44 KB

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