这样就可以在FPGA内实现双口RAM了...
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my_async_fifo.edn
96.6 KB
包内组件
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my_async_fifo.xco
1.3 KB
包内组件
3
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readme_ise.txt
3.6 KB
包内组件
4
FILE
design_top.v
882 B
包内组件
5
FILE
71i_async_fifo_v6_1_ver.ise
5.1 KB
包内组件
6
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my_async_fifo.v
4.4 KB
包内组件
7
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design_top_tb.tf
20.2 KB
包内组件
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my_async_fifo.veo
3.2 KB
包内组件