💻 sevenseg_case verilog code - 源码文件列表

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源码文件总数： 50 个
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序号
文件名
文件大小
操作
1
📄 sevenseg_case.cdf
309 B
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2
📄 sevenseg_case.fld
34 B
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3
📄 sevenseg_case.qpf
949 B
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4
📄 sevenseg_case.vwf
7.2 KB
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5
📄 sevenseg_case.map.eqn
12.85 KB
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6
📄 sevenseg_case.pof
0 B
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7
📃 serv_req_info.txt
551 B
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8
📄 sevenseg_case.sof
0 B
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9
📄 sevenseg_case.map.rpt
10.33 KB
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10
📄 sevenseg_case.pin
55 KB
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11
📄 sevenseg_case.map.summary
399 B
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12
📄 sevenseg_case.fit.eqn
14.3 KB
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13
📄 sevenseg_case.v
871 B
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14
📄 sevenseg_case.asm.rpt
365 B
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15
📄 sevenseg_case.done
26 B
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16
📄 sevenseg_case.tan.summary
1.22 KB
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17
📄 sevenseg_case.fit.summary
461 B
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18
📄 sevenseg_case.qws
1.37 KB
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19
📄 sevenseg_case.ppl
0 B
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20
📄 sevenseg_case_assignment_defaults.qdf
34.14 KB
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21
📄 sevenseg_case.fit.rpt
6.33 KB
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22
📄 sevenseg_case.pre_map.hdb
0 B
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23
📄 sevenseg_case.asm.qmsg
1.14 KB
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24
📄 sevenseg_case.sim.hdb
0 B
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25
📄 sevenseg_case.(0).cnf.cdb
0 B
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26
📄 sevenseg_case.db_info
151 B
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27
📄 sevenseg_case.map.qmsg
1.13 KB
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28
📄 sevenseg_case.cmp.tdb
0 B
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29
📄 sevenseg_case.rtlv_sg.cdb
0 B
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30
📄 sevenseg_case.sld_design_entry_dsc.sci
0 B
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31
📄 sevenseg_case.hif
467 B
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32
📄 sevenseg_case.signalprobe.cdb
0 B
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33
📄 sevenseg_case.map.cdb
0 B
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34
📄 sevenseg_case.hier_info
1 KB
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35
📄 sevenseg_case.sim.qmsg
1.37 KB
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36
📄 sevenseg_case.psp
0 B
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37
📄 sevenseg_case.rtlv_sg_swap.cdb
0 B
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38
📄 sevenseg_case_sim.qrpt
0 B
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39
📄 sevenseg_case.eds_overflow
4 B
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40
📄 sevenseg_case.tan.qmsg
1.26 KB
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41
📄 sevenseg_case.sld_design_entry.sci
0 B
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42
📄 sevenseg_case.cmp.cdb
0 B
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43
📄 sevenseg_case.rtlv.hdb
0 B
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44
📄 sevenseg_case_cmp.qrpt
0 B
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45
📄 sevenseg_case.map.hdb
0 B
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46
📄 sevenseg_case.cmp.rdb
0 B
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47
📄 sevenseg_case.sim.rdb
0 B
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48
📄 sevenseg_case.sgdiff.hdb
0 B
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49
📄 sevenseg_case.pre_map.cdb
0 B
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50
📄 sevenseg_case.sim.vwf
11.7 KB
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