💻 基于Quartus II FPGA/CPLD数字系统设计实例（VHDL源代码文件） - 源码文件列表

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源码文件总数： 50 个
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序号
文件名
文件大小
操作
6751
📄 bianma8_3.rtlv_sg.cdb
0 B
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6752
📄 bianma8_3.map.cdb
0 B
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6753
📄 bianma8_3.fnsim.cdb
0 B
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6754
📄 bianma8_3.fnsim.qmsg
4.34 KB
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6755
📄 bianma8_3.syn_hier_info
0 B
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6756
📄 bianma8_3.cmp.cdb
0 B
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6757
📄 bianma8_3.vhd
505 B
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6758
📄 bianma8_3.flow.rpt
4.8 KB
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6759
📄 sub4.vhd
423 B
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6760
📄 sub4.asm.rpt
6.75 KB
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6761
📄 sub4.done
26 B
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6762
📄 sub4.fit.rpt
62.61 KB
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6763
📄 sub4.pin
19.22 KB
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6764
📄 sub4.map.rpt
14.38 KB
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6765
📄 sub4.tan.summary
712 B
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6766
📄 sub4.flow.rpt
4.34 KB
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6767
📄 sub4.qpf
900 B
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6768
📄 sub4.sim.rpt
10.05 KB
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6769
📄 sub4.vwf
8.74 KB
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6770
📄 sub4.tan.rpt
8.59 KB
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6771
📄 sub4.fit.smsg
513 B
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6772
📄 sub4.pss
0 B
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6773
📄 sub4.eds_overflow
2 B
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6774
📄 sub4.sgdiff.cdb
0 B
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6775
📄 sub4.rtlv_sg.cdb
0 B
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6776
📄 sub4.fnsim.hdb
0 B
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6777
📄 sub4.(0).cnf.hdb
0 B
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6778
📄 sub4.pre_map.cdb
0 B
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6779
📄 sub4.cmp.logdb
4 B
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6780
📄 sub4.sim.qmsg
3.51 KB
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6781
📄 sub4.(0).cnf.cdb
0 B
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6782
📄 sub4.hif
575 B
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6783
📄 sub4.cmp.cdb
0 B
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6784
📝 sub4.cbx.xml
0 B
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6785
📄 sub4.map.qmsg
1.54 KB
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6786
📄 sub4.sld_design_entry.sci
0 B
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6787
📄 sub4.asm.qmsg
1.76 KB
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6788
📄 sub4.cmp2.ddb
0 B
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6789
📄 sub4.cmp.kpt
204 B
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6790
📄 sub4.sim_ori.vwf
8.17 KB
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6791
📄 sub4.cmp.hdb
0 B
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6792
📄 sub4.map.cdb
0 B
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6793
📄 sub4.asm_labs.ddb
0 B
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6794
📄 sub4.map.logdb
4 B
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6795
📄 sub4.syn_hier_info
0 B
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6796
📄 sub4.pre_map.hdb
0 B
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6797
📄 sub4.tan.qmsg
6.08 KB
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6798
📄 sub4.sim.rdb
0 B
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6799
📄 sub4.fit.qmsg
21.85 KB
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6800
📄 sub4.rtlv.hdb
0 B
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