💻 《ALTERA FPGACPLD高级篇》LogicLock设计实例 - 源码文件列表

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源码文件总数： 50 个
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序号
文件名
文件大小
操作
151
📄 fir_top.qsf
64 KB
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152
📄 fir_top.vqm
0 B
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153
📄 fir_top_st_model.v
8.28 KB
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154
📄 fir_top.qsf
64 KB
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155
📄 fir_top.pin
64 KB
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156
📄 lc_tdl.esf
73 B
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157
📄 lc_tdl_mr.esf
73 B
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158
📄 fir_top.vec
428 B
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159
📄 zero.hex
234 B
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160
📄 fir_top.vhd
3.91 KB
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161
📄 fir_top_st.inc
98 B
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162
📄 fir_top_st_model.vhd
10.58 KB
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163
📄 fir_top_st.v
8.29 KB
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164
📄 fir_top_coef_0.mif
3.38 KB
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165
📄 lc_tdl_strat.esf
74 B
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166
📄 fir_top_rpt.htm
2.68 KB
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167
📄 fir_top_coef_1.v
2.8 KB
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168
📄 fir_top_coef_0.v
2.8 KB
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169
📄 fir_top.bsf
3.25 KB
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170
📄 fir_top.pof
0 B
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171
📄 fir_top.fit.rpt
64 KB
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172
📃 fir_top_silent_param.txt
1.4 KB
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173
📄 fir_top.tan.summary
1.64 KB
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174
📄 fir_top.sof
0 B
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175
📄 fir_top.fit.eqn
64 KB
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176
📄 fir_top(20).cnf.hdb
0 B
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177
📄 fir_top.cmp.rdb
0 B
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178
📄 fir_top.cdb.qmsg
1.68 KB
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179
📄 fir_top(19).cnf.cdb
0 B
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180
📄 fir_top(22).cnf.hdb
0 B
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181
📄 fir_top(0).cnf.cdb
0 B
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182
📄 fir_top.map.qmsg
19.49 KB
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183
📄 fir_top(16).cnf.hdb
0 B
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184
📄 fir_top(8).cnf.hdb
0 B
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185
📄 fir_top(7).cnf.hdb
0 B
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186
📄 fir_top(6).cnf.cdb
0 B
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187
📄 fir_top(18).cnf.cdb
0 B
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188
📄 fir_top(15).cnf.hdb
0 B
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189
📄 fir_top(0).cnf.hdb
0 B
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190
📄 fir_top(17).cnf.cdb
0 B
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191
📄 fir_top.cmp.tdb
0 B
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192
📄 fir_top(7).cnf.cdb
0 B
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193
📄 fir_top(10).cnf.hdb
0 B
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194
📄 fir_top(3).cnf.hdb
0 B
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195
📄 fir_top.cmp.ddb
0 B
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196
📄 fir_top(14).cnf.cdb
0 B
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197
📄 fir_top(21).cnf.cdb
0 B
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198
📄 fir_top.rtlv.hdb
0 B
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199
📄 fir_top.pre_map.hdb
0 B
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200
📄 fir_top(16).cnf.cdb
0 B
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