💻 FPGA开发光盘各章节实例的设计工程与源码 - 源码文件列表

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源码文件总数： 50 个
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序号
文件名
文件大小
操作
401
📄 start_rtl.rtlv.hdb
0 B
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402
📄 start_rtl.cmp.rdb
0 B
查看源码
403
📄 start_rtl.map_bb.cdb
0 B
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404
📄 start_rtl.rtlv_sg_swap.cdb
0 B
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405
📄 start_rtl.asm.qmsg
1.75 KB
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406
📄 start_rtl.hif
582 B
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407
📄 start_rtl.map.hdb
0 B
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408
📄 start_rtl.sgdiff.cdb
0 B
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409
📄 wed.wsf
2.84 KB
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410
📄 start_rtl.pre_map.hdb
0 B
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411
📄 start_rtl.(0).cnf.hdb
0 B
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412
📄 start_rtl.sld_design_entry_dsc.sci
0 B
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413
📄 start_rtl.map_bb.hdb
0 B
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414
📄 start_rtl.merge.qmsg
2.02 KB
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415
📄 start_rtl.rtlv_sg.cdb
0 B
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416
📄 start_rtl.map.logdb
4 B
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417
📄 start_rtl.(0).cnf.cdb
0 B
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418
📄 start_rtl.cmp.logdb
4 B
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419
📄 start_rtl.cmp.bpm
0 B
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420
📄 start_rtl.tan.qmsg
17.75 KB
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421
📄 start_rtl.sim.rdb
0 B
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422
📄 start_rtl.syn_hier_info
0 B
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423
📄 start_rtl.psp
3 B
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424
📄 start_rtl.map.cdb
0 B
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425
📄 start_rtl.pre_map.cdb
0 B
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426
📄 start_rtl.pss
37 B
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427
📄 start_rtl.cmp_bb.rcf
0 B
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428
📄 start_rtl.dbp
0 B
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429
📄 start_rtl.sim.hdb
0 B
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430
📄 start_rtl.cmp_bb.logdb
4 B
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431
📄 start_rtl.cmp0.ddb
0 B
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432
📄 start_rtl.hier_info
156 B
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433
📄 start_rtl.db_info
136 B
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434
📄 start_rtl.cmp.hdb
0 B
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435
📄 start_rtl.cmp_bb.hdb
0 B
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436
📄 start_rtl.map.summary
531 B
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437
📄 start_rtl.pof
0 B
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438
📄 start_rtl.fit.rpt
64 KB
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439
📄 test1.vhd
222 B
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440
📄 t_procedure.vhd
752 B
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441
📄 state_s3.vhd
1.49 KB
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442
📄 state_s3.sim.rpt
9.68 KB
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443
📄 state_s3.qsf
1.99 KB
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444
📄 state_s3.fit.summary
481 B
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445
📄 state_s3.asm.rpt
7.89 KB
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446
📄 state_s3.done
26 B
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447
📄 state_s3.pin
64 KB
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448
📄 state_s3.map.summary
529 B
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449
📄 state_s3.fit.smsg
5.92 KB
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450
📄 state_s3.tan.rpt
16.74 KB
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