💻 FPGA开发光盘各章节实例的设计工程与源码 - 源码文件列表

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源码文件总数： 50 个
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序号
文件名
文件大小
操作
1
📄 comp.vhd
1.25 KB
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2
📄 bin27seg.flow.rpt
4.46 KB
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3
📄 bin27seg.map.summary
529 B
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4
📄 bin27seg.asm.rpt
7.89 KB
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5
📄 bin27seg.pin
64 KB
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6
📄 bin27seg.tan.rpt
8.96 KB
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7
📄 bin27seg.qsf
2.01 KB
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8
📄 bin27seg.pof
0 B
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9
📄 bin27seg.sof
0 B
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10
📄 bin27seg_vhd_vec_tst.vhd
2.45 KB
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11
📄 bin27seg.tan.summary
723 B
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12
📄 bin27seg.done
26 B
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13
📄 bin27seg.merge.rpt
7.37 KB
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14
📄 bin27seg.qws
1.84 KB
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15
📄 bin27seg.fit.rpt
64 KB
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16
📄 bin27seg.fit.summary
483 B
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17
📄 bin27seg.sim.rpt
10.7 KB
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18
📄 bin27seg.sld_design_entry_dsc.sci
0 B
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19
📄 bin27seg.rtlv_sg_swap.cdb
0 B
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20
📄 bin27seg.cmp.rdb
0 B
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21
📄 bin27seg.signalprobe.cdb
0 B
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22
📄 bin27seg.eds_overflow
3 B
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23
📄 bin27seg.pre_map.cdb
0 B
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24
📄 bin27seg.cmp_bb.hdb
0 B
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25
📄 bin27seg.eco.cdb
0 B
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26
📄 bin27seg.cmp.ecobp
0 B
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27
📄 bin27seg.pss
36 B
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28
📄 bin27seg.map_bb.cdb
0 B
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29
📄 bin27seg.cmp.logdb
4 B
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30
📄 bin27seg.db_info
136 B
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31
📄 bin27seg.tan.qmsg
5.04 KB
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32
📄 bin27seg.map_bb.logdb
4 B
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33
📄 bin27seg.map.qmsg
3.96 KB
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34
📝 bin27seg.cbx.xml
0 B
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35
📄 bin27seg.sim.rdb
0 B
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36
📄 bin27seg.pre_map.hdb
0 B
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37
📄 bin27seg.cmp.cdb
0 B
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38
📄 bin27seg.sim.cvwf
0 B
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39
📄 bin27seg.dbp
0 B
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40
📄 bin27seg.merge.qmsg
2.01 KB
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41
📄 bin27seg.sim.qmsg
3.07 KB
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42
📄 bin27seg.syn_hier_info
0 B
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43
📄 bin27seg.map.hdb
0 B
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44
📄 bin27seg.cmp0.ddb
0 B
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45
📄 wed.wsf
4.57 KB
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46
📄 bin27seg.hif
577 B
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47
📄 bin27seg.rtlv.hdb
0 B
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48
📄 bin27seg.map.cdb
0 B
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49
📄 bin27seg.map.bpm
0 B
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50
📄 bin27seg.map.logdb
4 B
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